半導(dǎo)體存儲(chǔ)器ppt課件(2)(參考版)
2025-05-09 12:44本頁(yè)面
【正文】 返回本節(jié) 第 7章 半導(dǎo)體存儲(chǔ)器 THANK YOU VERY MUCH ！ ?本章到此結(jié)束， ?謝謝您的光臨！ 返回本章首頁(yè) 結(jié) 束放映 。 由于高速緩存器容量遠(yuǎn)小于低速大容量主存儲(chǔ)器 ， 所以它不可能包含后者的所有信息 。 返回本節(jié) 第 7章 半導(dǎo)體存儲(chǔ)器 高速緩存器 Cache 當(dāng) CPU進(jìn)行第一次訪問時(shí) ， 也把數(shù)據(jù)存到高速緩存區(qū) 。 （ 4） 虛擬存儲(chǔ)器的概念：由存儲(chǔ)器管理機(jī)制以及一個(gè)大容量的快速硬盤存儲(chǔ)器或光盤支持 。 第 7章 半導(dǎo)體存儲(chǔ)器 2．虛地址保護(hù)方式 （ 1） 存儲(chǔ)器管理機(jī)制： 80386先使用段機(jī)制 ， 把包含兩個(gè)部分的虛擬地址空間轉(zhuǎn)化為一個(gè)中間地址空間的地址 ， 然后再用分頁(yè)機(jī)制把線性地址轉(zhuǎn)化為物理地址 （ 2） 分段分頁(yè)機(jī)制：是所管理的存儲(chǔ)器塊具有固定的大小它把線性地址空間中的任一頁(yè)映射到物理空間的一頁(yè) 。 第 7章 半導(dǎo)體存儲(chǔ)器 RAS CAS A7 ～ A0 或 A15 ～ A8 校驗(yàn)位標(biāo)志 總線數(shù)據(jù) D7 — D0 D7 — D0 校驗(yàn)位寫入 校驗(yàn)位讀出 DRAM 2164 9 DRAM 2164 9 DRAM 2164 9 DRAM 2164 9 奇偶校驗(yàn) 邏輯 數(shù)據(jù) 收發(fā)器 R/W 控制信號(hào) 刷新控制信號(hào) 地址總線 A19 ～ A16 A15 ～ A0 DRAM 刷新邏輯 片選譯碼 電路 地址 多路器 電路 校驗(yàn)位標(biāo)志總線數(shù)據(jù) 校驗(yàn)位寫入校驗(yàn)位讀出 奇偶校驗(yàn)邏輯 數(shù)據(jù)收發(fā)器 校驗(yàn)位標(biāo)志 總線數(shù)據(jù) D7 ～ D0 D7 ～ D0 校驗(yàn)位寫入 校驗(yàn)位讀出 奇偶校驗(yàn)邏輯 數(shù)據(jù)收發(fā)器 圖 724 IBMPC/XT的讀寫存儲(chǔ)器子系統(tǒng)的組成框圖 返回本節(jié) 第 7章 半導(dǎo)體存儲(chǔ)器 尋址范圍 ?表 76 不同 CPU的尋址范圍 返回本節(jié) 第 7章 半導(dǎo)體存儲(chǔ)器 存儲(chǔ)器的管理 1．實(shí)地址方式 實(shí)地址方式是 80286~80486最基本的工作方式 ， 尋址范圍只能在 1MB范圍內(nèi) ， 故不能管理和使用擴(kuò)展存儲(chǔ)器 。 第 7章 半導(dǎo)體存儲(chǔ)器 表 74 線選方式地址分布 A15 A14 A13 A12 A11 A10 地址分布 0 0 1 1 1 0 第一組： 3800H~3BFFH 0 0 1 1 0 1 第二組： 3400H~07FFH 0 0 1 0 1 1 第三組： 2C00H~2FFFH 0 0 0 1 1 1 第四組： 1C00H~1FFFH 第 7章 半導(dǎo)體存儲(chǔ)器 圖 719 用 2114芯片組成 4K RAM線選控制譯碼結(jié)構(gòu)圖 A9 ～ A0 D7 ～ D 0 A9 ～ A0 CS OE 2114 WE D7 ～ D0 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS OE 2114 WE D7 ～ D0 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS OE 2114 WE D7 ～ D0 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS OE 2114 WE D7 ～ D0 A13 A12 A11 A10 A9 ～ A0 D7 ～ D0 WE RD 第 7章 半導(dǎo)體存儲(chǔ)器 圖 720 用 2114芯片組成 4K RAM局部譯碼結(jié)構(gòu)圖 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS 2114 WE D7 ～ D0 譯碼器 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS 2114 WE D7 ～ D0 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS 2114 WE D7 ～ D0 A9 ～ A0 D7 ～ D0 A9 ～ A0 CS 2114 WE D7 ～ D0 ～～～CS WE ～A15 ︰ A12 A11 A10 A9 ～ A0 IO/M CPU WE
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