基于vhdl的數(shù)字鐘動態(tài)掃描顯示電路設(shè)計-資料下載頁
2024-11-07 08:37本頁面
【導(dǎo)讀】隨著電子技術(shù)的發(fā)展，應(yīng)用系統(tǒng)向著小型化、快速化、大容量、重量輕的方向發(fā)展，用中越來越廣泛。在這個階段，人們開始追求貫徹整個系統(tǒng)設(shè)計的自動化，可以從繁重的設(shè)。計工作中徹底解脫出來，把精力集中在創(chuàng)造性的方案與概念構(gòu)思上，從而可以提高設(shè)計效率，縮短產(chǎn)品的研制周期。整個過程通過EDA工具自動完成，大大減輕了設(shè)計人員的工作強度，提高了設(shè)計質(zhì)量，減少了出錯的機會。和內(nèi)部，即設(shè)計實體的內(nèi)部功能和算法完成部分。應(yīng)的數(shù)碼管不顯示數(shù)據(jù)。間分隔為6個周期的循環(huán)，如下圖。40HZ,如1kHZ，可實現(xiàn)6個數(shù)碼管的動態(tài)掃描顯示。不亮，認為是一直點亮的。數(shù)據(jù)選擇器，掃描控制電路，七段顯示譯碼器等組成。A13—A10，A23—A20，A33—A30，A43—A40，A53—A50，7根LED七段顯示譯碼輸出。線a，b，c，d，e，f，g和6根位選通sel0，sel1，sel2，sel3，sel4，sel5。描頻率足夠高的情況下，6個數(shù)碼管能穩(wěn)定顯示6個數(shù)碼。行同一系統(tǒng)的設(shè)計。
【正文】 e38 l24xuan4c library ieee。 use 。 entity l24xuan4c is port(no1,no2,no3,no4,no5,no6:in std_logic_vector(3 downto 0)。 st:in std_logic_vector(5 downto 0)。 yout:out std_logic_vector(3 downto 0)。 sel:out std_logic_vector(2 downto 0))。 end l24xuan4c。 architecture bhv2 of l24xuan4c is signal s:std_logic_vector(5 downto 0)。 begin s=st。 process(s) begin case s is when 100000=yout=no6。 sel=000。 when 010000=yout=no5。 sel=001。 when 001000=yout=no4。 sel=010。 when 000100=yout=no3。 sel=011。 when 000010=yout=no2。 sel=100。 when 000001=yout=no1。 sel=101。 when others=yout=1111。 sel=111。 end case。 end process。 end bhv2。 configuration l24xuan4c_con of l24xuan4c is for bhv2 end for。 end l24xuan4c_con。 l24xuan4c dec7s library ieee。 use 。 entity dec7s is port(a:in std_logic_vector(3 downto 0)。 led7s:out std_logic_vector(6 downto 0))。 end dec7s。 architecture one of dec7s is begin process(a) begin case a is when 0000=led7s=1111110。 when 0001=led7s=0110000。 when 0010=led7s=1101101。 when 0011=led7s=0110011。 when 0100=led7s=1011011。 when 0101=led7s=1011111。 when 0110=led7s=1110000。 when 0111=led7s=1111111。 when 1000=led7s=1111011。 when others=led7s=0000000。 end case。 end process。 end one。 configuration dec7s_con of dec7s is for one end for。 end dec7s_con。 dec7s
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