eda數(shù)字時鐘實驗報告-資料下載頁
2024-08-29 12:19本頁面
【導(dǎo)讀】四.討論與心得····························
【正文】 實驗來熟悉掌握 MAX+Plus2 軟件 和 ALTERA FLEX EPF10K10LC844 實驗平臺 。實驗的難度循序漸進(jìn)。為后來自己設(shè)計數(shù)字時鐘打下基礎(chǔ)。 在時鐘設(shè)計電路時，遇到了不少困難，比如說時鐘與鬧鈴的顯示切換。想了一天，沒有結(jié)果 ，最后還是晚上在宿舍與室友討論時，得到結(jié)果的。 通過這次實驗，我了解了一般數(shù)字時鐘的構(gòu)成 原理。并且學(xué)會與同學(xué)共同發(fā)現(xiàn)問題，討論問題，解決問題。 21 參考文獻(xiàn) 1.《 EDA與數(shù)字系統(tǒng)設(shè)計》李國麗 朱維勇 欒銘主編 2.《數(shù)字電子技術(shù)基礎(chǔ)》 閻石 主編 3.《電子技術(shù)基礎(chǔ)實驗》 李國麗 劉春 朱維勇主編 22 附件 課程設(shè)計任務(wù)書 （ 2020 ~2020 學(xué)年） 設(shè) 計 題 目 ： EDA與數(shù)字系統(tǒng)課程設(shè)計 學(xué)院名稱 ： 電氣與自動化工程學(xué)院 專 業(yè) （班 級） ： 自動化 20201級 姓 名 （學(xué) 號） ： 丁興宇 20201965 起 訖 日 期 ： 2020年 7月 1日－ 2020年 7月 30日 指 導(dǎo) 教 師 ： 劉春 朱維勇 胡存剛 系（教研室）負(fù)責(zé)人 。 儲昭碧 下發(fā)任務(wù)書日期 2020年 7月 1日 23 合 肥 工 業(yè) 大 學(xué) 課程設(shè)計任務(wù)書 設(shè)計題目 EDA與數(shù)字系統(tǒng)課程設(shè)計 主要內(nèi)容 了解各種 PLD器件的基本結(jié)構(gòu)，掌握 MAX+Plus2的使用方法，用圖形輸入法和 Verilog HDL完成規(guī)定的基本練習(xí)題 ，在此基礎(chǔ)上完成一個數(shù)字系統(tǒng)設(shè)計題的設(shè)計、仿真、下載（ FPGA實現(xiàn)）。 應(yīng)收集的資 料 1.《 EDA與數(shù)字系統(tǒng)設(shè)計》李國麗 朱維勇 欒銘主編 2.《數(shù)字電子技術(shù)基礎(chǔ)》 閻石 主編 設(shè) 計 進(jìn) 度 計 劃 講課： EDA簡介 實驗一： Max+Plus2使用練習(xí)，完成一個簡單門電路的圖形設(shè)計輸入、編譯、仿真、管腳分配、下載。（ 4學(xué)時） 實驗二：圖形設(shè)計輸入 38 譯碼器 , 同步十進(jìn)制加法計數(shù)器、同步六十進(jìn)制計數(shù)器。 用 六十進(jìn)制計數(shù)器 制作十二進(jìn)制計數(shù)器（ 01～ 12），二十四進(jìn)制計數(shù)器 （ 00～ 23）和百進(jìn)制計數(shù)器。 設(shè)計輸入、編譯、仿真、管腳分配、下載。 （ 8 學(xué)時） 實驗三：完成以上實驗的 Verilog HDL 設(shè)計輸入 。（ 4 學(xué)時） 實驗四：完成掃描顯示 141， 142。 （ 4 學(xué)時） 講課：布置一個數(shù)字系統(tǒng)設(shè)計題，講解設(shè)計要求、原理框圖、設(shè)計提示。 方案設(shè)計、設(shè)計調(diào)試、下載驗證。（ 12 學(xué)時） 設(shè)計考核驗收，寫課程設(shè)計報告。 (2學(xué)時 ) 主要參考文 獻(xiàn) 1 李國麗編，《 EDA 與數(shù)字系統(tǒng)設(shè)計》， 2020 2 王金明編，《數(shù)字系統(tǒng)設(shè)計與 Verilog HDL》電子工業(yè)出版社， 2020 3 閻石，《數(shù)字電子技術(shù)基礎(chǔ)》 高教出版社， 2020 指導(dǎo)教師意 見 按照設(shè)計進(jìn)度計劃要求完成每一步任務(wù) 備注 24 合 肥 工 業(yè) 大 學(xué) 課程設(shè)計審閱 /答辯成績評定書 學(xué)生姓名 課題名稱： 指導(dǎo)教師過程檢查評語： 指導(dǎo)教師簽字： 年 月 日 指導(dǎo)教師評語： 建議成績： 指導(dǎo)教師簽字： 年 月 日 系或?qū)I(yè)答辯組評語： 成績： 負(fù)責(zé)人 (組長 )簽字： 年 月 日 25
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