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正文內(nèi)容

大年夜學(xué)卒業(yè)論文基于fpga的數(shù)字鐘設(shè)計(jì)[整理版(編輯修改稿)

2025-01-06 23:23 本頁面
 

【文章內(nèi)容簡(jiǎn)介】 統(tǒng)集成電路,是一種帶有邏輯處理的加速處理器。而 PG是特殊的 SIC芯片,與其他的 SIC芯片相比,它具有設(shè)計(jì)開發(fā)周期短、設(shè)計(jì)制造成本低、開發(fā)工具先進(jìn)、標(biāo)準(zhǔn)產(chǎn)品無需測(cè)試、質(zhì)量穩(wěn)定以及可實(shí)時(shí)在線檢測(cè)等優(yōu)點(diǎn)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì) ( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 在控制系統(tǒng)中,鍵盤是常用的人機(jī)交換接口,當(dāng)所設(shè)置的功能鍵或數(shù)字鍵按下的時(shí)候,系統(tǒng)應(yīng)該完成該鍵所設(shè)置的功能。因此,鍵信息輸入是與軟件結(jié)構(gòu)密切相關(guān)的過程。根據(jù)鍵盤的結(jié)構(gòu)不同,采用不同的編碼方法。但無論有無編碼以及采用什么樣的編碼 ,最后都要轉(zhuǎn)換成為相應(yīng)的鍵值,以實(shí)現(xiàn)按鍵功能程序的轉(zhuǎn)移。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 鐘表的數(shù)字化給人們生產(chǎn)生活帶來了極大的方便,而且大大地?cái)U(kuò)展了鐘表原先的報(bào)時(shí)功能。諸如定時(shí)自動(dòng)報(bào)警、 定時(shí)啟閉電路、定時(shí)開關(guān)烘箱、通斷動(dòng)力設(shè)備,甚至各種定時(shí)電氣的自動(dòng)啟用等,所有 這些,都是以鐘表數(shù)字化為基礎(chǔ)的。因此,研究數(shù)字鐘及擴(kuò)大其應(yīng)用,有著非?,F(xiàn)實(shí)的意義。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾 餒 選題背景 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 本節(jié)將從 PG 嵌入式應(yīng)用開發(fā)技術(shù)與數(shù)字鐘技術(shù)發(fā)展的客觀實(shí)際出發(fā),通過對(duì)該技術(shù)發(fā)展?fàn)顩r的了解,以及課題本身的需要,指出研究基于 PG 的芯片 系統(tǒng)與設(shè)計(jì) —— 數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn)的必要性。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí) 現(xiàn) )摘 要 本 設(shè) 計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 課題相關(guān)技術(shù)的發(fā)展 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 當(dāng)今電子產(chǎn)品正向功能多元化 ,體積最小化 ,功耗最低化的方向發(fā)展 。 它與傳統(tǒng)的電子產(chǎn)品在設(shè)計(jì)上的顯著區(qū)別師大量使用大規(guī)模可編程邏輯器件,使產(chǎn)品的性能提高,體積縮小,功耗降低 .同時(shí)廣泛運(yùn)用現(xiàn)代計(jì)算機(jī)技術(shù),提高產(chǎn)品的自動(dòng)化程度和競(jìng)爭(zhēng)力,縮短研發(fā) 周期。 ED 技術(shù)正是為了適應(yīng)現(xiàn)代電子技術(shù)的要求,吸收眾多學(xué)科最新科技成果而形成的一門新技術(shù)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 美國 LTER 公司的可編程邏輯器件采用全新的結(jié)構(gòu)和先進(jìn)的技術(shù),加上 MxplusII(或最新的 QURTUS)開發(fā)環(huán)境,更具有高性能,開發(fā)周期短等特點(diǎn),十分方便進(jìn)行電子產(chǎn)品的開發(fā)和設(shè)計(jì)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì) 數(shù) ; 具 有 校對(duì) 功 能 以 及整 點(diǎn) 報(bào) 時(shí) 功 能 。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 ED 技術(shù),技術(shù)以大規(guī)??删幊踢壿嬈骷?設(shè)計(jì)載體,以硬件描述語言為系統(tǒng)邏輯描述主要表達(dá)方式,以計(jì)算機(jī)、大規(guī)??删幊踢壿嬈骷拈_發(fā)軟件及實(shí)驗(yàn)開發(fā)系統(tǒng)為設(shè)計(jì)工具,通過有關(guān)的開發(fā)軟件,自動(dòng)完成用軟件的方式設(shè)計(jì)的電子系統(tǒng)到硬件系統(tǒng)的邏輯編譯,邏輯化簡(jiǎn),邏輯分割,邏輯映射,編程下載等工作。最終形成集成電子系統(tǒng)或?qū)S眉尚酒囊婚T新技術(shù)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 本設(shè)計(jì)利用 VHDL 硬件描述語言結(jié)合可編程邏輯器件進(jìn)行的,并通過數(shù)碼管動(dòng)態(tài)顯示計(jì)時(shí)結(jié)果。數(shù)字鐘可以由各種技術(shù)實(shí)現(xiàn),如單片機(jī)等 .利用可編程邏輯器件具有其他方式?jīng)]有的特點(diǎn),它具有易學(xué),方便,新穎,有趣,直觀,設(shè)計(jì)與實(shí)驗(yàn)項(xiàng)目成功率高,理論與實(shí)踐結(jié)合緊密,體積小,容量大, I/O 口豐富,易編程和加密等特點(diǎn),并且它還具有開放的界面,豐富的設(shè)計(jì)庫,模塊化的工具以及 LPM 定制等優(yōu)良性能,應(yīng)用非 常方便。因此,本設(shè)計(jì)采用可編程邏輯器件實(shí)現(xiàn)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的 數(shù) 字 鐘 ,具 有 年 、 月 、日 、 時(shí) 、 分、 秒 計(jì) 數(shù) 顯 示功 能 , 以24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 課題研究的必要性 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 現(xiàn)在是一個(gè)知識(shí)爆炸的新時(shí)代。新 產(chǎn)品、新技術(shù)層出不窮,電子技術(shù)的發(fā)展更是日新月異??梢院敛豢鋸埖恼f,電子技術(shù)的應(yīng)用無處不在,電子技術(shù)正在不斷地改變我們的生活,改變著我們的世界。在這快速發(fā)展的年代,時(shí)間對(duì)人們來說是越來越寶貴,在快節(jié)奏的生 活時(shí),人們往往忘記了時(shí)間,一旦遇到重要的事情而忘記了時(shí)間,這將會(huì)帶來很大的損失。因此我們需要一個(gè)定時(shí)系統(tǒng)來提醒這些忙碌的人。數(shù)字化的鐘表給人們帶來了極大的方便。近些年,隨著科技的發(fā)展和社會(huì)的進(jìn)步,人們對(duì)數(shù)字鐘的要求也越來越高,傳統(tǒng)的時(shí)鐘已不能滿足人們的需求。多功能數(shù)字鐘不管在性能還是在樣式上都發(fā)生了質(zhì)的變化,有電子鬧鐘、數(shù)字鬧鐘等等。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán) 計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 課題研究的內(nèi)容 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩 滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 本設(shè)計(jì)主要研究基于 PG 的數(shù)字鐘,要求時(shí)間以 24 小時(shí)為一個(gè)周期 ,顯示年、月、日、時(shí)、分、秒。具有校時(shí)以及報(bào)時(shí)功能,可以對(duì)年、月、日、時(shí)、分及秒進(jìn)行單獨(dú)校對(duì),使其校正到標(biāo)準(zhǔn)時(shí)間。校對(duì)時(shí)間由 44矩形鍵盤進(jìn)行控制,為了保證計(jì)時(shí)的穩(wěn)定及準(zhǔn)確須由晶體振蕩器提供時(shí)間基準(zhǔn)信號(hào)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以 及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 本設(shè)計(jì)小組成員共有三人:其他兩人分別采用原理圖設(shè)計(jì)和 Verilog HDL 語言設(shè)計(jì)。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷 兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 2 PG 簡(jiǎn)介 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 PG 概述 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 PG是現(xiàn)場(chǎng)可編程門陣列( ield Progrmmble Gte rry) 的簡(jiǎn)稱,與之相應(yīng)的 CPLD是復(fù)雜可編程邏輯器件( Complex Progrmmble Logic Device)的簡(jiǎn)稱,兩者的功能基本相同,只是實(shí)現(xiàn)原理略有不同,所以有時(shí)可以忽略這兩者的區(qū)別,統(tǒng)稱為可編程邏輯器件或 CPLD/PG。 CPLD/PG幾乎能完成任何數(shù)字器件的功能,上至高性能 CPU,下至簡(jiǎn)單的 74電路。它如同一張白紙或是一堆積木,工程師可以通過傳統(tǒng)的原理圖輸入或硬件描述語言自由的設(shè)計(jì)一個(gè)數(shù)字系統(tǒng)。通過軟件仿真可以事先驗(yàn)證設(shè)計(jì)的正確性,在 PCB完成以后,利用 CPLD/PG的在線修改功能,隨時(shí)修改設(shè)計(jì)而不必改動(dòng)硬件電路。使用 CPL/PG開發(fā)數(shù)字電路,可以大大縮短設(shè)計(jì)時(shí)間,減少 PCB面積,提高系統(tǒng)的可靠性。這些優(yōu)點(diǎn)使得 CPL/PG技術(shù)在 20世紀(jì) 90年代以后得到飛速的發(fā)展,同時(shí)也大大推動(dòng)了 ED軟件和硬件描述語言 HDL的進(jìn)步。 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 PG 基本結(jié)構(gòu) 大學(xué)畢業(yè)論文 基于 PG的數(shù)字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì)( VHDL語言實(shí)現(xiàn))摘要本設(shè)計(jì)為一個(gè)多功能的數(shù)字鐘,具有年、月、日、時(shí)、分、秒計(jì)數(shù)顯示功能,以 24小時(shí)循環(huán)計(jì)數(shù);具有校對(duì)功能以及整點(diǎn)報(bào)時(shí)功能。本設(shè)計(jì)采用 ED技鴉萎楓訖遼蠟青言瞇瓶慶豎冪青撒簧己旅拷兔缸毆螺也珠劣纓眩軟燒吊居疊丫竿棟尾儲(chǔ)浩滅聞甜媽毆潦橢時(shí)箍涪低性滋嗆毋諸蔚繭鄉(xiāng)芬裁輪予唾餒 PG具有掩膜可編程門陣列的通用結(jié)構(gòu),它由邏輯功能塊排成陣列,并由可編程的互連資源連接這些邏輯功能塊來實(shí)現(xiàn)不同的設(shè)計(jì)。 大學(xué)畢業(yè)論文 基于 PG的數(shù) 字鐘設(shè)計(jì) 42大學(xué)畢業(yè)論文基于 PG的數(shù)字鐘設(shè)計(jì) ( VH
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