fpga設(shè)計(jì)基礎(chǔ)基于quartusii的fpga設(shè)計(jì)基本流程-資料下載頁(yè)
2025-05-01 23:36本頁(yè)面
【正文】 are Setup對(duì)話框，下頁(yè)圖所示，在此添加硬件設(shè)備。 ? 配置編程硬件后，選擇下載模式，在 Mode中指定的編程模式為 JTAG模式； ? 確定編程模式后，單擊 添加相應(yīng)的 ，選中 Program/Configure選項(xiàng)，然后點(diǎn)擊 圖標(biāo)下載設(shè)計(jì)文件到器件中， Process進(jìn)度條中顯示編程進(jìn)度，編程下載完成后就可以進(jìn)行目標(biāo)芯片的硬件驗(yàn)證了。 ? 界面如圖 JTAG方式下載 西安郵電學(xué)院計(jì)算機(jī)系 30 2021/6/7 JTAG方式下載 圖 編程下載對(duì)話框 西安郵電學(xué)院計(jì)算機(jī)系 31 2021/6/7 AS主動(dòng)串行編程模式下載步驟： ? 選擇 QuartusⅡ 主窗口 Assignments菜 Device命令，進(jìn)入 Settings對(duì)話框的 Device頁(yè)面進(jìn)行設(shè)置，如圖 。 ? 選擇 QuartusⅡ 主窗口 的 Tools菜單下的 Programmer命令或點(diǎn)擊圖標(biāo) ，進(jìn)入器件編程和配置對(duì)話框，添加硬件，選擇編程模式為 Active Serial Program； ? 單擊 添加相應(yīng)的 ，選中文件后的Program/Configure、 Verify和 Blank Check項(xiàng)，單擊圖標(biāo) 下載設(shè)計(jì)文件到器件中， Process進(jìn)度條中顯示編程進(jìn)度。下載完成后程序固化在 EPCS中，開(kāi)發(fā)板上電后 EPCS將自動(dòng)完成對(duì)目標(biāo)芯片的配置，無(wú)須再?gòu)挠?jì)算機(jī)上下載程序。 AS方式下載 西安郵電學(xué)院計(jì)算機(jī)系 32 2021/6/7 AS方式下載 圖 AS下載模式 西安郵電學(xué)院計(jì)算機(jī)系 33 2021/6/7 10 SignalTap II ?SignalTapⅡ 邏輯分析儀是 QuartusⅡ 軟件中集成的一個(gè)內(nèi)部邏輯分析軟件， 主要是用來(lái)觀察設(shè)計(jì)的內(nèi)部信號(hào)波形，方便查找設(shè)計(jì)中的缺陷。 ?在復(fù)雜的設(shè)計(jì)中，不能從外部的輸入輸出引腳上觀察內(nèi)部端口之間（如模塊 與模塊之間）的信號(hào)波形是否正確，這就可以使用 SignalTapⅡ 邏輯分析儀來(lái) 進(jìn)行觀察。 ?通過(guò)菜單 【 Tools】 【 SignalTap II Logic Analyzere】 打開(kāi) SignalTapII 窗口，將自動(dòng)新建一個(gè) STP文件，如圖 。 西安郵電學(xué)院計(jì)算機(jī)系 34 2021/6/7 圖 SignalTap 窗口 10 SignalTap II 西安郵電學(xué)院計(jì)算機(jī)系 35 2021/6/7 設(shè)置采樣時(shí)鐘 設(shè)置采樣深度及 調(diào)用存儲(chǔ)器類型 設(shè)置采樣模式 觸發(fā)時(shí) 刻在采樣數(shù)據(jù)段的位置 在上頁(yè)界面中 進(jìn)行如下設(shè)置： 進(jìn)行采集信號(hào)的選取，觸發(fā)條件的設(shè)置等 10 SignalTap II 圖 信號(hào)采集設(shè)置窗口 西安郵電學(xué)院計(jì)算機(jī)系 36 2021/6/7 設(shè)置采樣信號(hào) 采樣數(shù)據(jù)顯示 10 SignalTap II 圖 數(shù)據(jù)采集窗口 西安郵電學(xué)院計(jì)算機(jī)系 37 2021/6/7 10 SignalTap II 最后，重新編譯包含 STP文件的工程，檢測(cè)硬件配置鏈，捕獲數(shù)據(jù)觀察波形。 圖 分析數(shù)據(jù) 西安郵電學(xué)院計(jì)算機(jī)系 38 2021/6/7 11 小結(jié) ?介紹了 Quartus II的操作界面、工程的創(chuàng)建及輸入； ?介紹了 FPGA工程開(kāi)發(fā)的一般流程及各個(gè)環(huán)節(jié)的概念與操作。
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