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正文內(nèi)容

eda汽車尾燈控制課程設(shè)計(jì)報(bào)告-資料下載頁

2025-03-03 16:42本頁面

【導(dǎo)讀】設(shè)計(jì)的基本內(nèi)容························································1. 3汽車尾燈控制器的設(shè)計(jì)過程··············································3

  

【正文】 出為 1 表示左側(cè)燈亮,當(dāng) BRAKE 為 1 時(shí), LEDB 輸出為 1 表示左側(cè)燈亮,當(dāng) NIGHT 為 1 時(shí), LEDN 輸出為 1 表示左側(cè)燈亮。當(dāng) LR 為 1 時(shí),左側(cè)三盞燈輸出均為 0。即沒有燈亮。 右邊燈控制模塊仿真及分析 右邊燈控制模塊 由 VHDL 程序?qū)崿F(xiàn)后,其功能仿真圖如圖 ( a)所示 以及時(shí)序仿真如圖 ( b)所示。 圖 ( a)右 邊燈控制模塊功能仿真圖 13 圖 ( b)右 邊燈控制模塊 時(shí)序 仿真圖 對(duì)時(shí)序仿真圖進(jìn)行分析: RP, LR,NIGHT,BRAKE 為輸入信號(hào), LR 為 1 表示左轉(zhuǎn), RP 為 1 表示右轉(zhuǎn), NIGHT 為 1 表示夜間行路, BRAKE 為 1 表示剎車。LEDR,LEDB,LEDN 為輸出信號(hào) ,表示汽車右側(cè)的三盞燈。如圖所示:當(dāng) RP 為 1 時(shí),LEDR 輸出為 1 表示右側(cè)燈亮,當(dāng) BRAKE 為 1 時(shí), LEDB 輸出為 1 表示右側(cè)燈亮,當(dāng) NIGHT 為 1 時(shí), LEDN 輸出為 1 表示右側(cè)燈亮。當(dāng) LR 為 1 時(shí), 右側(cè)三盞燈輸出均為 0。即沒有燈亮。 整個(gè)系統(tǒng)仿真及分析 按 圖 組裝系統(tǒng)后的功能仿真如圖 ( a)所示以及時(shí)序仿真如圖 ( b)所示。 圖 ( a)整個(gè)系統(tǒng)功能仿真圖 14 圖 ( b)整個(gè)系統(tǒng)時(shí)序仿真圖 對(duì)時(shí)序仿真圖進(jìn)行分析: RIGHT, LEFT,NIGHT,BRAKE 為輸入信號(hào), RIGHT 為 1 表示右轉(zhuǎn), LEFT 為 1 表示左轉(zhuǎn), NIGHT 為 1 表示夜間行路, BRAKE 為 1 表示剎車。RD1,RD2,RD3 為輸出信號(hào),表示汽車右側(cè)的三盞燈。 LD1,LD2,LD3 為輸出信號(hào),表示汽車左側(cè)的三盞燈 。如圖所示:當(dāng) RIGHT 為 1 時(shí), RD1 輸出為 1 表示右側(cè)燈亮,當(dāng) LEFT 為 1 時(shí), LD1 為輸出為 1 表示左側(cè)燈亮,當(dāng) NIGHT 為 1 時(shí), LD2,RD2輸出均為 1,表示左,右兩側(cè)各有一盞燈亮。當(dāng) BRAKE 為 1 時(shí), LD3,RD3 輸出均為 1,表示左,右兩側(cè)各有一盞燈亮。 各個(gè)模塊的功能: :這塊的功能是對(duì)左右兩邊的 LLED RLED1 的閃爍時(shí)間間隔,以 CLK 為輸入信號(hào), CP 為輸出信號(hào),在程序中定義一個(gè)八位節(jié)點(diǎn)信號(hào) COUNT來放計(jì)數(shù)值,當(dāng) CLK 的上升沿到來時(shí)就開始計(jì)數(shù),最后將 COUNT(3)給 CP,實(shí)現(xiàn)對(duì) CLK 的八分頻。再將 CP 的電平信號(hào)分別和 LEDL、 LEDR 電平與,最后用輸出的電平來控制汽車左右的 LLED RLED1,實(shí)現(xiàn)左右轉(zhuǎn)的指示功能。 : 該段程序用于對(duì)汽車尾燈進(jìn)行整體控制,當(dāng)輸入為左轉(zhuǎn)信號(hào)時(shí),輸出左側(cè)燈控制信號(hào);當(dāng)輸入為右轉(zhuǎn)信號(hào)時(shí),輸出右側(cè)燈控制信號(hào);當(dāng)同時(shí)輸入 LEFT 和 RIGHT 信號(hào)時(shí),輸出錯(cuò)誤控制信號(hào)。當(dāng)輸入為剎車信號(hào)時(shí),輸出剎車控制信號(hào);當(dāng)輸入為夜間行駛信號(hào)時(shí),輸出為夜間行駛控制信號(hào)。 : 本程序用于控制左側(cè)燈的亮、滅和閃爍情況,當(dāng)時(shí)鐘上升沿信號(hào)和左側(cè)燈控制信號(hào)或剎車控制信號(hào)或夜間行駛信號(hào)同時(shí)出現(xiàn)時(shí),左側(cè)相 15 應(yīng)的燈亮或出現(xiàn)閃爍。當(dāng)錯(cuò)誤控制信號(hào)出現(xiàn)時(shí), LD1 燈不亮。 4. 右邊燈控制模塊作用: 本描述用于控制右側(cè)燈的亮、滅和閃爍情況,當(dāng)時(shí)鐘上升沿信號(hào)和右側(cè)燈控制信號(hào)或剎車控制信號(hào)或夜間行駛信號(hào)同時(shí)出現(xiàn)時(shí),右側(cè)相應(yīng)的燈亮或出現(xiàn)閃爍。當(dāng)錯(cuò)誤控制信號(hào)出現(xiàn)時(shí), RD1 燈不亮。 拼腳引用: 輸入: 開關(guān) 引腳 BRAKE SW1 32 LEFT SW2 33 RIGHT SW3 36 BIGHT SW4 37 輸出: LEFT RIGHT LD1 LD2 LD3 RD1 RD2 RD3 D112 D111 D110 D103 D102 D101 31 30 29 20 19 18 實(shí)驗(yàn)現(xiàn)象: 。 。 ,右側(cè)的一盞指示燈亮。 ,左側(cè)的一盞指示燈亮。 ,左右兩側(cè)的一盞指示燈同時(shí)亮。 ,左右兩側(cè)有指示燈同時(shí)一直亮,供照明使用。 結(jié)束語 通過本次課程設(shè)計(jì),我們對(duì) EDA 技術(shù)有了更深的了解,初步學(xué)會(huì)了采用自頂向下的系 統(tǒng)設(shè)計(jì)方法設(shè)計(jì)系統(tǒng),并熟練掌握了利用 VHDL 語言進(jìn)行簡(jiǎn)單的電路模塊設(shè)計(jì)。此外,我們還進(jìn)一步熟悉了 MAX+PLUSII 這款軟件的使用,深刻體會(huì)到了用軟件實(shí)現(xiàn)硬件設(shè)計(jì)的便捷與優(yōu)越。 本次課程設(shè)計(jì)不僅培養(yǎng)了我們實(shí)際操作能力,也培養(yǎng)了我們靈活運(yùn)用課本知識(shí),理論聯(lián)系實(shí)際,分析問題和解決問題的能力。它不僅僅是一個(gè)學(xué)習(xí)新知識(shí)新方法的好機(jī)會(huì),同時(shí)也是對(duì)我所學(xué)知識(shí)的一次綜合的檢驗(yàn)和復(fù)習(xí),使我明白了自己的缺陷所在,從而查漏補(bǔ)缺。 16 本設(shè)計(jì)采用自頂向下設(shè)計(jì)方法,底層為一些具有獨(dú)立功能的小模塊,由小組人員分工完成,即一人完成一個(gè)到多 個(gè)模塊,最后再合到一起完成頂層文件的設(shè)計(jì)。從局部到整體,不僅使得系統(tǒng)設(shè)計(jì)的思路清晰明了,減少了錯(cuò)誤的產(chǎn)生,更方便了程序的調(diào)試以及系統(tǒng)功能的擴(kuò)充。在設(shè)計(jì)過程中,能與同學(xué)相互交流討論,分工合作,不僅降低了設(shè)計(jì)難度,縮短了設(shè)計(jì)周期,更是進(jìn)一步培養(yǎng)了我們的團(tuán)隊(duì)合作精神。 在此次設(shè)計(jì)過程中,不僅要求我們掌握扎實(shí)的理論知識(shí),分析問題能從根本原理出發(fā),聯(lián)系實(shí)際解決問題,還要求我們要有耐心,毅力及細(xì)心。稍有不慎,一個(gè)小小的錯(cuò)誤就會(huì)導(dǎo)致結(jié)果的不正確,而對(duì)錯(cuò)誤的檢查更要求我們要有足夠的耐心,反復(fù)調(diào)試,直到程序順利通過。 這次設(shè) 計(jì)中我也遇到了一些問題,但通過相關(guān)資料的查詢,在老師的指導(dǎo)和同學(xué)們的幫助下,都順利得以解決。這些經(jīng)歷使我得以積累了一定的經(jīng)驗(yàn),相信對(duì)以后學(xué)習(xí)設(shè)計(jì)工作也會(huì)有一定的幫助! 指導(dǎo)老師意見 參考書目 [1] 黃正瑾,《系統(tǒng)編程技術(shù)及其應(yīng)用》,南京,東南大學(xué)出版社, 1997 年 [2] 潘松,黃繼業(yè),《 EDA 實(shí)用教程》,北京,科學(xué)出版社, 2021 年 [3] 鄭家龍,王小海,《集成電子技術(shù)基礎(chǔ)教程》,北京,高等教育出版社, 2021 年 [4] 盧杰,賴毅,《 VHDL 與數(shù)字電路設(shè)計(jì)》,北京,科學(xué)出版社, 2021 年 [5] 張明,《 Verilog HDL 實(shí)用教程》,成都,電子科技大學(xué)出版社, 1999 年
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