編碼器和譯碼器的設(shè)計(jì)(doc畢業(yè)設(shè)計(jì)論文)(編輯修改稿)
2025-07-17 13:11 本頁(yè)面
【文章內(nèi)容簡(jiǎn)介】 EPF8282P55P56P57EPF10K10P53P54P58三八譯碼器由VHDL程序?qū)崿F(xiàn)后，： 對(duì)其仿真圖進(jìn)行仿真分析：cs譯碼輸出標(biāo)志，datain為輸入信號(hào)組，它由datain[2]datain[0]三個(gè)二進(jìn)制代碼輸入信號(hào)組成。Dataout為輸出信號(hào)組， 它由dataout[7]dataout[0]八個(gè)輸出信號(hào)組成。cs為1時(shí)候表示輸出。當(dāng)輸入為：111時(shí)，譯碼后為指定的狀態(tài)，即輸出10000000，緊接著依次類(lèi)推，當(dāng)輸入為：110時(shí)，輸出輸出01000000，當(dāng)輸入為101時(shí)，輸出00100000，當(dāng)輸入為100時(shí)，輸出00010000，輸入011時(shí)，輸出為00001000，輸入為010時(shí)，輸出00000100，輸入為001時(shí)，輸出00000010，輸入為000時(shí)，輸出為00000001。二四譯碼器由VHDL程序?qū)崿F(xiàn)后，：對(duì)其仿真圖進(jìn)行仿真分析： i為輸入信號(hào)組，它由i[1]i[0]兩個(gè)二進(jìn)制代碼輸入信號(hào)組成。o為輸出信號(hào)組， 它由o[3]o[0]四個(gè)輸出信號(hào)組成。當(dāng)輸入為：11時(shí)，譯碼后為指定的狀態(tài)，即輸出1000，緊接著依次類(lèi)推，當(dāng)輸入為：10時(shí)，輸出輸出0100，當(dāng)輸入為01時(shí)，輸出0010，當(dāng)輸入為00時(shí)，輸出0001。：i0i1o0o1o2o3EPF8282P01P02P55P56P57P58EPF10K10P03P05P53P54P58P59結(jié)束語(yǔ)通過(guò)兩星期的緊張工作，最后完成了我的設(shè)計(jì)任務(wù)——基于VHDL編碼器和譯碼器的設(shè)計(jì)。通過(guò)本次課程設(shè)計(jì)的學(xué)習(xí)，我深深的體會(huì)到設(shè)計(jì)課的重要性和目的性所在。本次設(shè)計(jì)課不僅僅培養(yǎng)了我們實(shí)際操作能力，也培養(yǎng)了我們靈活運(yùn)用課本知識(shí)，理論聯(lián)系實(shí)際，獨(dú)立自主的進(jìn)行設(shè)計(jì)的能力。它不僅僅是一個(gè)學(xué)習(xí)新知識(shí)新方法的好機(jī)會(huì)，同時(shí)也是對(duì)我所學(xué)知識(shí)的一次綜合的檢驗(yàn)和復(fù)習(xí)，使我明白了自己的缺陷所在，從而查漏補(bǔ)缺。希望學(xué)校以后多安排一些類(lèi)似的實(shí)踐環(huán)節(jié)，讓同學(xué)們學(xué)以致用。在設(shè)計(jì)中要求我要有耐心和毅力，還要細(xì)心，稍有不慎，一個(gè)小小的錯(cuò)誤就會(huì)導(dǎo)致結(jié)果的不正確，而對(duì)錯(cuò)誤的檢查要求我要有足夠的耐心，通過(guò)這次設(shè)計(jì)和設(shè)計(jì)中遇到的問(wèn)題，也積累了一定的經(jīng)驗(yàn)，對(duì)以后從事集成電路設(shè)計(jì)工作會(huì)有一定的幫助。在應(yīng)用VHDL的過(guò)程中讓我真正領(lǐng)會(huì)到了其在電路設(shè)計(jì)上的優(yōu)越性。用VHDL硬件描述語(yǔ)言的形式來(lái)進(jìn)行數(shù)字系統(tǒng)的設(shè)計(jì)方便靈活，利用EDA軟件進(jìn)行編譯優(yōu)化仿真極大地減少了電路設(shè)計(jì)時(shí)間和可能發(fā)生的錯(cuò)誤，降低了開(kāi)發(fā)成本，這種設(shè)計(jì)方法必將在未來(lái)的數(shù)字系統(tǒng)設(shè)計(jì)中發(fā)揮越來(lái)越重要的作用。致謝本設(shè)計(jì)是在肖曉麗老師的精心指導(dǎo)和嚴(yán)格要求下完成的，從課題選擇到具體設(shè)計(jì)和調(diào)試，都得到肖老師的悉心指導(dǎo)，無(wú)不凝聚著肖老師的心血和汗水，她多次為我指點(diǎn)迷津，幫助我開(kāi)拓設(shè)計(jì)思路，精心點(diǎn)撥、熱忱鼓勵(lì)。她淵博的知識(shí)、開(kāi)闊的視野和敏銳的思維給了我深深的啟迪。通過(guò)這次課程設(shè)計(jì)我從肖老師那學(xué)到不少有用的知識(shí)，也積累了一定的電路設(shè)計(jì)的經(jīng)驗(yàn)。最后非常感謝肖曉麗老師對(duì)我的指導(dǎo)與大力的幫助。參考文獻(xiàn)[1] 楊剛,:電子工業(yè)出版社,2004[2] :清華大學(xué)出版社,2006[3］[M].成都:電子科技大學(xué)出版社,2000 附錄：程序名：library ieee。use 。entity priority is port(i:in bit_vector(7 downto 0)。 a:out bit_vector(2 downto 0)。 gs:out bit)。編碼輸出標(biāo)志end priority。architecture a of priority isbegin process(i) begin gs=39。139。 a=100。 if i(7)=39。139。then a=111。 elsif i(6)=39。139。then a=110。 elsif i(5)=39。139。then a=101。 elsif i(4)=39。139。then a=100。 elsif i(3)=39。139。then a=011。 elsif i(2)=39。139。then a=010。 elsif i(1)=39。139。then a=001。 elsif i(0)=39。139。then a=000。 else gs=39。039。 end if。 end process。 end a。：fuction：以撥盤(pán)開(kāi)關(guān)作為數(shù)據(jù)輸入端，用發(fā)光二極管表示譯碼后的信息； datain(0)datain(2) 分別為c39。b39。a對(duì)應(yīng)撥盤(pán)開(kāi)關(guān)上的13號(hào)鍵；library IEEE。use 。use 。use 。entity yima_138 is Port (datain : in std_logic_vector(2 downto 0
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