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正文內(nèi)容

基于cpld數(shù)字頻率計設計開題報告-資料下載頁

2024-11-17 22:05本頁面

【導讀】在開題報告中要求給出你對課題的理解,類似的研究在國內(nèi)外的進展情況,數(shù)字頻率計的設計,其功能是實現(xiàn)信號的頻率、周期、占空比。數(shù)字頻率計是用數(shù)字顯示被測信號頻率的儀器,被測信號可以是正弦波,數(shù)字頻率計是應用很廣泛的。該款產(chǎn)品各項技術指標均領。先于市場同級別產(chǎn)品,更以其高性價比受到了市場的廣泛關注。國際上數(shù)字頻率計研究和發(fā)展比較早,精測公司生產(chǎn)數(shù)字示波器,電源,電橋,1)使用CPLD自帶的計數(shù)器對輸入脈沖進行計數(shù),或者測量信號的周期;2)CPLD外部使用計數(shù)器對脈沖信號進行計數(shù),計數(shù)值再由單片機讀取。在低頻段的相對測量誤差可能達到50%,即在低頻段不能滿足設計要求。用一般中小規(guī)模CPLD芯片難以實現(xiàn)。74LS165并入串出移位寄存器讀入CPLD,實現(xiàn)測頻、測脈寬及測占空比等功能,七段LED動態(tài)顯示,由8個芯片74LS164分別驅(qū)動數(shù)碼管。各測試功能的轉(zhuǎn)換;P2口為雙向控制口。

  

【正文】 P ) 置零,即為選擇測頻。然后通過鍵盤將預置門的時間值讀入 FPGA,打開預置門進行測頻計數(shù),等預置門時間到后,關斷預置門,關斷預置門后將給 FPGA 一個結束信號,程序讀到結束信號后,通過置 [SS1, SSO]的四個編碼狀態(tài),分四次將測頻結果的 32 位數(shù)據(jù)讀入,計算后將結果轉(zhuǎn)換為 BCD碼送 LED 顯示輸出。 四、 進度安排 順序 階段日期 計 劃 完 成 內(nèi) 容 備注 1 學生 開題 ,查閱有關 資料,完成開題報告。 2 深入學習相關理論,初步提出方案。 3 進入設計實質(zhì)階段,細化并確定方案,并提出實現(xiàn)的方法,完成論文初稿。 4 反復論證方案,防疫外文文獻,文成論文并按照學院要求打印, 指導教師審查畢業(yè)設計論文,學生準備論文答辯。 5 答辯并評定成績。 五、 參考文獻 [1]徐輝 ,王祖強 ,王照君 .基于高速串行 BCD 碼除法的數(shù) 字頻率計的設計 . 電子技術應用 , 2020, 31(09) : 61~ 67 [2]徐成 ,劉彥 ,李仁發(fā) ,等 .一種全同步數(shù)字頻率測量方法的研究 .電子技術應用 , 2020, 38 (12) : 43 [3]侯伯亨 ,顧新 .VHDL 硬件描述語言與數(shù)字邏輯電路設計 (第 3版 ) .西安 : 西安電子科技大學出版社 ,1999 [4]譚會生 ,張昌凡 .EDA 技術及應用 .西安 : 西安電 子科技大學出版社 , 2020 [5]魏忠 ,蔡勇 ,雷紅衛(wèi) .嵌入式開發(fā)詳解 .電子工業(yè)出版社 [6]周如輝 .實時視頻處理系統(tǒng)中乒乓存儲控制器的設計 [J].電子元器件應用 ,2020(4):6668. [7]馬忠梅 .單片機的 C 語言應用程序設計 .北京航空航天大學出版社 . [8]宋萬杰 ,羅豐 ,吳順君 .CPLD 技術極其應用 .西安電子科技大學出版社 . [9]常青 ,陳輝煌 .可編程專用集成電路及其應用與設計實踐 .國防工業(yè)出版社 . [10]王金明 ,楊吉斌 .數(shù)字系統(tǒng)設計與 VHDL[M].北京 :電子工業(yè)出版社 ,2020,1. [11]林明權 .VHDL 數(shù)字控制系統(tǒng)設計范例 [M].電子工業(yè)出版社 ,2020. [12]張凌 .VHDL 語言在 FPGA/CPLD 開發(fā)中的應用 .電子工程師 ,2020. [13]任曉東 ,文博 .CPLD/FPGA 高級應用開發(fā)指南 .電子工業(yè)出版社 [14]來金梅 . FPGA現(xiàn)狀及其發(fā)展趨勢 [M]. 復旦大學 FPGA培訓教程 .2020. [15] 姜雪松 ,張海風 . 可編程邏輯器件和 EDA設計技術 [M], 北京 : 機械工業(yè)出版社 , 六、 指導教師意見 指導教師簽名: 年 月 日
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