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正文內(nèi)容

33v串口擴展芯片xr16m654中文翻譯-文庫吧資料

2025-07-01 05:32本頁面
  

【正文】 4]對于RHR中的數(shù)據(jù)自己,提供接收數(shù)據(jù)錯誤類型D、 LSR[5]指示THR為空E、 LSR[6]指示發(fā)送FIFO和TSR都為空F、 LSR[7]指示在RX FIFO中最近一個字符的一個數(shù)據(jù)錯誤IER[0]:RHR中斷使能產(chǎn)生接收數(shù)據(jù)準備好中斷,當RHR中有一個數(shù)據(jù)在非FIFO模式,或者接收FIFO已經(jīng)達到被編程的出發(fā)點在FIFO模式中。 IER對應接收/發(fā)送FIFO查詢模式操作當FCR[0]=1時,F(xiàn)IFO使能;重設置IER【0:3】使能XR16M654在FIFO查詢模式操作。C、 一個字符從一位寄存器傳輸?shù)浇邮誇IFO時,接收數(shù)據(jù)準備好位被置位(LSR[0])。B、 當FIFO觸發(fā)點被達到時,F(xiàn)IFO水平將被反映到ISR寄存器中。 IER對應接收FIFO中斷模式操作當接收FIFO(FCR[0]=1)和接收中斷(IER[0]=1)被使能時,RHR中斷(ISR[2:3])狀態(tài)將反映如下:A、 當FIFO到達被編程的觸發(fā)點,接收數(shù)據(jù)有效,被傳送到主機。 內(nèi)部寄存器描述 接收保持寄存器RHR只讀寄存器參見19頁“接收器”章節(jié) 發(fā)送保持寄存器THR只寫寄存器參見17頁“發(fā)送器”章節(jié) 中斷使能寄存器IER讀/寫中斷使能寄存器IER屏蔽來自接收數(shù)據(jù)準備好、發(fā)送空、線狀態(tài)和調(diào)制狀態(tài)寄存器的中斷。 串口內(nèi)部寄存器M654的每個串口擁有自己的配置寄存器,有地址線A0,A1,A2和指定的通道進行選擇(參見Table 1 和 Table 2)。當RTS和DTR被撤銷,CTS,DSR,CD,RI輸入被忽略,TX引腳保持高電平或屏蔽狀態(tài)。Figure14顯示了如何調(diào)制端口信號被重新配置。內(nèi)部回環(huán)模式通過設置MCR[4:1]使能。RHR被讀取后,下一個字符字節(jié)被載入到RHR寄存器,錯誤標志也連同當前數(shù)據(jù)被立即更新到LSR[2:4]中。3個額外位為3個錯誤標志,反映在LSR寄存器中。對主機提供接收數(shù)據(jù)接口。RHR中斷由IER[0]使能,參見Figure10和Figure11。當接收到一個字符或者延遲直到到達FIFO觸發(fā)點時,RHR產(chǎn)生一個接收數(shù)據(jù)準備中斷。如果發(fā)生了錯誤,在LSR[2:4]中被反映出來。以這種方式評估起始位阻止接收器裝載一個錯誤字符。8個時鐘(如果8X,則為4個時鐘,如果4X,則為2個時鐘)后,起始位周期應該在起始位中間。RSR在即將到來字符的每位數(shù)據(jù)中間進行檢驗。 接收器接收器單元由8位接收移位單元(RSR)和64字節(jié)FIFO,包括一字節(jié)寬的接收保持寄存器(RHR)組成。發(fā)送空中斷標志由IER[1]使能。當FIFO空時,THR空標志(LSR[5])被置位。當TSR變成完全空時,TSR標志(LSR[6])被置位。當數(shù)據(jù)字節(jié)被傳輸?shù)絋SR時,THR空標志(LSR[5])被置位。每次一個寫操作到THR,F(xiàn)IFO數(shù)據(jù)指針自動跳轉(zhuǎn)到下一個序列數(shù)據(jù)位置。最低符號位(bit0)首先發(fā)送。 發(fā)送保持寄存器(THR)只寫功能發(fā)送保持寄存器是一個8位寄存器,提供和連接數(shù)據(jù)接口。發(fā)送器發(fā)送起始位,緊接著數(shù)據(jù)位,如果是能奇偶校驗位,則插入奇偶校驗位,最后增加停止位。移位寄存器TSR在內(nèi)部16X/8X/4X時鐘下發(fā)送每個數(shù)據(jù)位。AB表明將A向右移動B位,例如,0x78A38=0x0078。ROUND(N)=N朝著最接近的整數(shù)取整數(shù)值。例如,TRUNC()=5。采用非標準波特率晶振或外部時鐘,分頻器的值可以通過下列公式計算。特別注意,在8X采樣速率模式,位時間將會有(177。在8X采樣速率條件下,波特率加倍。Table 6 為在24MHz晶振或外部16X時鐘速率的條件下的標準數(shù)據(jù)波特率。僅僅DLD的低四位被使用,他們被用作選擇一個從0(設置為0000)(設置為1111)。因此BRG必須在初始化操作數(shù)據(jù)波特率期間進行編程。采樣時鐘被用作發(fā)送器數(shù)據(jù)位移位和接收器數(shù)據(jù)采樣。預分頻器時鐘輸出到BRG。預分頻器通過MCR寄存器中通過軟件控制。進一步閱讀關于晶振電路,參看官網(wǎng)EXAR’S 上DAN108應用。典型晶振連接如Figure 6。參見15頁“,Programmable Baud Rate Generator with Fractionan Divisor”。在每個UART鐘,石英晶振提供為波特率發(fā)生器(BGR)單元系統(tǒng)時鐘。(Crystal Oscillator or Extern Clock Input) M654含有一個片上晶振(XTAL1和XTAL2)為器件的UART單元產(chǎn)生時鐘。當收發(fā)FIFO被使能,DMA模式被禁用(FCR[3]=0),M654被設置為單字符收發(fā)模式。當發(fā)送器空或者為更多數(shù)據(jù)擁有空位置,LSR[5]、LSR[6]提供一個指示。DMA模式影響RXRDY和TXTDY AD輸出引腳狀態(tài)。 DMA Mode該期間不支持直接內(nèi)存訪問。Table3 和 Table4總結了發(fā)送和接收的操作行為。所有寄存器在后面的詳細章節(jié),參見26頁“Section ,UART INTERNAL REGISTERS”。這些寄存器,諸如數(shù)據(jù)保持寄存器(THR/RHR),中斷狀態(tài)和控制寄存器(ISR/IER),F(xiàn)IFO控制寄存器(FCR),接收線狀態(tài)和控制寄存器(LSR/LCR),調(diào)制狀態(tài)和控制寄存器(MSR/MCR),可編程數(shù)據(jù)時鐘分頻寄存器(DLL/DLM/DLD)和用戶可訪問的暫存寄存器(SPR)。 Channels AD Internal Registers(通道AD內(nèi)部寄存器)為了控制、監(jiān)聽、數(shù)據(jù)上載和下載,M654,M654的每一個UART通道都有一組增強的寄存器。A3和A4地址解碼功能僅僅在摩托羅拉總線模式下被使用。在Motorola總線模式下(16/68引腳連接到GND),接口引腳被配置成連接摩托羅拉或者其他主流處理器總線類型。在上電期間,選擇所有串口寫所有相同的寄存器,但是不要企圖四個串口同時去讀。 Channel Selection(通道選擇)UART串口提供用戶在外部CPU和外部通信器件間進行雙向傳輸信息的能力。一個長于40ns的持續(xù)高電平脈沖將是器件復位功能激活。對于Intel和Motorola模式,典型數(shù)據(jù)總線互聯(lián)如Figure5所示。每個總線周期都是異步的,使用CSA~D,IOR,IOW或者CS3,RW,A4,A3輸入。M654數(shù)據(jù)接口支持兼容Intel類型的CPU和兼容工業(yè)標準期間16C550 UART。對于標準異步調(diào)制解調(diào)數(shù)據(jù)輸出,這些輸出也被額外提供。在訪問獨立通道時,降低了輪詢時間。對于正常操作,CHCCLK引腳必須被連接到XTAL2引腳或者對于MIDI應用,必須連接到外部MIDI(音樂工業(yè)數(shù)字接口)振蕩器。100引腳封裝提供幾個其他加強功能。CLKSEL引腳選擇波特率發(fā)生器預分頻系數(shù)為1或者4。然而兩種不同的LQFP封裝被提供,XR16M654IV操作結合MCR[3],通過在內(nèi)部連接INTSEL到GND。在16位模式下,INTSEL和MCR[3]能夠提供軟件控制或持續(xù)中斷能力。自動硬件/軟件流控制,可選擇收發(fā)FIFO觸發(fā)點,可選擇波特率,紅外編碼/解碼接口,調(diào)制解調(diào)接口控制和睡眠模式都是標準特征。通過軟件選擇,用戶能夠設置時鐘預分頻位和采樣速率。Data Rata(數(shù)據(jù)傳輸速率),內(nèi)部4X采樣時鐘速率下,M654數(shù)據(jù)傳輸速率達16Mbps。除此之外,對于大數(shù)據(jù)量吞吐性能,特別是操作一個多通道的系統(tǒng)可編程的FIFO出發(fā)點中斷和自動硬件/軟件流控制被特別的提供。然而,帶有64字節(jié)FIFO的M654。這樣就允許外部處理器去處理更多的工作任務在一個給定的時間內(nèi)。M654被設計工作在高性能數(shù)據(jù)通信系統(tǒng),需要快速數(shù)據(jù)處理時間。M654采用先進的CMOS處理方法制造。這些配置寄存器對于控制、狀態(tài)和數(shù)據(jù)發(fā)送,都和16550UART兼容。VCC2,24,374,35,5213,47,646,46,6610,61,86PWR~GND21,4714,28,45,616,23,40,5716,36,56,7620,46,71,96PWR電源地GNDCenterPADN/AN/AN/AN/APWR1,2,20,21,22,27,40,41,42,60,61,62,80不連接八、 產(chǎn)品描述XR16M654(M654)整合4個增強型16C550通用一部收發(fā)器(UART)的功能。該引腳功能相近,但是為40ns低電平脈沖將復位寄存器和輸出。在復位周期內(nèi),輸出復位(Table17)。在這種情況下,最小40ns的高電壓脈沖出現(xiàn)在該引腳上,將復位內(nèi)部寄存器和輸出。該引腳僅僅可以在100個引腳的QFP中可用。一個外部16X波特率時鐘或石英晶振蕩器輸出,XTAL2,為了正常操作,必須被連接到該引腳。波特率發(fā)生器章節(jié)參見MCR[7]和Figure7。連接到VCC,分頻為1(默認),連接到GND,分頻為4。CLKSEL21302635I通道AD波特率發(fā)生器輸入時鐘預分頻選擇。當16/68引腳為低電平,器件操作在Motorola總線類型接口。XTAL11825353140I晶振或外部時鐘輸入XTAL21926363241O晶振或外部時鐘輸出16/68143136IIntel或Motorola總線選擇(輸入內(nèi)部帶上拉)。不使用連接到VCC。該輸入對串口沒影響。CDACDBCDCCDD641831499274
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