基于vhdl語言vga顯示系統(tǒng)的設(shè)計(jì)(參考版)
2025-06-30 19:06本頁面
【正文】 CG。digital tube。passed.Keywords: SPCE061Aonboarddownloaded tooverall systemsimulation.asastheadesign, gives thethatandsubsystemideas andgives theThethedesign, systemidea ofofsinceofsystemlevelexperimentscontrol.movementsquarebannershorizontal and verticalthe64 kinds oftheand graphics.controlVGA display controller,described inThedisplay systemfor the[1] 張昌凡，龍永紅，：華南工學(xué)院出版社，2001[2] 盧杰，：科學(xué)出版社，2001[3] 王金明， ：電子工業(yè)出版社，2002 [4] ：電子科技大學(xué)出版社，1999[5] 欒銘，：第三屆全球智能與自動化大會，2000[6] ， ：機(jī)械工業(yè)出版社，2000[7] 劉明業(yè)，將敬旗，：清華大學(xué)出版社，2001[8] .侯伯亨，：西安電子科技大學(xué)出版社，1999VHDL languagebased VGA display system designLI YakunAbstract: This study還要感謝選題相同的班級同學(xué)和我探討交流，大家一起激發(fā)思維的火花，討論遇到的問題，互相促進(jìn)，達(dá)到了協(xié)作的良好效果。以上就是我此次實(shí)驗(yàn)的總結(jié)與收獲。應(yīng)該敘述通過以上的分析和設(shè)計(jì)自己得到的結(jié)果是什么，所得到的結(jié)論是什么。代碼只不過是設(shè)計(jì)者思考和想法的外在表現(xiàn)而已，真正精華的是設(shè)計(jì)思路。我相信這種系統(tǒng)設(shè)計(jì)的思路將給我以后的實(shí)驗(yàn)和開發(fā)提供有益的參考。三周下來，自主學(xué)習(xí)了大量的資料，積累了不少經(jīng)驗(yàn)。這一過程雖然辛苦，但卻讓人快樂。正是這一限制條件，讓硬件描述更加有趣，更加值得去深究。硬件語言不是簡單的寫幾行代碼實(shí)現(xiàn)幾個邏輯，其精髓在于從硬件的角度去理解系統(tǒng)，然后用其固有的VHDL語言去描述。這一思路讓人眼前一亮。狀態(tài)機(jī)和系統(tǒng)的設(shè)計(jì)當(dāng)時(shí)在我的腦海里就是一團(tuán)亂麻，“剪不斷，理還亂”。剛進(jìn)入實(shí)驗(yàn)室，我參考了網(wǎng)絡(luò)上給出的類似代碼，簡單地認(rèn)為實(shí)驗(yàn)是簡單而愉快的。注意：要有一些自己的東西。表格用三線格的形式。這樣就有黑、紅彩條了。 525( 場周期 )= Hz 。顯示控制器設(shè)計(jì)提示：顯示器技術(shù)規(guī)格提供的行頻一般在 30 kHz 45 kHz( 保守?cái)?shù)據(jù) ) ，場頻一般在 50 Hz ～ 75 Hz( 保守?cái)?shù)據(jù) ) 。b001。b100。d1) |(pixel_t==639。d1)|(line_t==539。 // 白 else if(strip_t=6‘d12) rgb=3’b110。line_t對行數(shù)進(jìn)行計(jì)數(shù)，為32進(jìn)制計(jì)數(shù)模式6：/*（6）模式6：橫彩條2從上至下，每6行顯示一種顏色， 分別為白、黃、粉、紅、淺藍(lán)、綠、黑、藍(lán)，并重復(fù)此規(guī)律。 END a。 end if。 vga_read_dispaly = GRB(1)。139。139。139。 PROCESS (clk) BEGIN if clk39。 vga_vs_control = vs。 k:=k+1。139。 elsif k = 524 then k:=0。 then if k 2 then vs = 39。event and hs = 39。139。 then k:=2。 BEGIN if reset = 39。 END PROCESS 。 end if。 i:=i+1。 j:=0。 end if。 else hs = 39。039。139。 elsif clk39。 hs = 39。 i:=96。139。
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