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組合電路分析與設(shè)計(jì)-資料下載頁

2025-01-18 21:16本頁面

　　

【正文】增加乘積項(xiàng) 3. 輸出端并聯(lián)電容器。 P115 增加乘積項(xiàng) BCBAY ??Y1 ABC 00 01 11 100 0 0 0 11 0 1 1 1ABC123≥ 14amp。amp。有圈相切，則有競爭冒險(xiǎn) ACBCBAY ???增加冗余項(xiàng)，消除競爭冒險(xiǎn) Y1ABC12534≥ 1amp。amp。amp。本節(jié)小結(jié) ① 組合電路的特點(diǎn)：在任何時(shí)刻的輸出只取決于當(dāng)時(shí)的輸入信號，而與電路原來所處的狀態(tài)無關(guān) 。實(shí)現(xiàn)組合電路的基礎(chǔ)是邏輯代數(shù)和門電路。 ② 組合電路的邏輯功能可用邏輯圖、真值表、邏輯表達(dá)式、卡諾圖和波形圖等 5種方法來描述，它們在本質(zhì)上是相通的，可以互相轉(zhuǎn)換。 ③ 組合電路的分析步驟：邏輯圖 → 寫出邏輯表達(dá)式→ 邏輯表達(dá)式化簡 → 列出真值表 → 邏輯功能描述。 ④ 組合電路的設(shè)計(jì)步驟：列出真值表 → 寫出邏輯表達(dá)式或畫出卡諾圖 → 邏輯表達(dá)式化簡和變換 → 畫出邏輯圖。在許多情況下，如果用中、大規(guī)模集成電路來實(shí)現(xiàn)組合函數(shù) ，可以取得事半功倍的效果。

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