第三章時(shí)序邏輯(編輯修改稿)
2024-10-22 16:18 本頁面
【文章內(nèi)容簡介】 0 0 0 0 0 1化簡得： DQ0Q2120Q1DDCPZ電路圖： 12. 用D觸發(fā)器設(shè)計(jì)3位二進(jìn)制加法計(jì)數(shù)器，并畫出波形圖。解: 13. 用下圖所示的電路結(jié)構(gòu)構(gòu)成五路脈沖分配器，試分別用簡與非門電路及74LS138集成譯碼器構(gòu)成這個(gè)譯碼器，并畫出連線圖。解：先寫出激勵(lì)方程，然后求得狀態(tài)方程 若用與非門實(shí)現(xiàn)，譯碼器輸出端的邏輯函數(shù)為： 若用譯碼器74LS138實(shí)現(xiàn),譯碼器輸出端 的邏輯函數(shù)為： 14. 用74LS290構(gòu)成模為8和9的計(jì)數(shù)器，各采用兩種方案畫出其接線圖解：，預(yù)置值應(yīng)為多少？畫出狀態(tài)圖及輸出波形圖。解：預(yù)置值應(yīng)C=0，B＝1，A＝1。 16. 用一片74LS163計(jì)數(shù)器和2片74LS138譯碼器構(gòu)成一個(gè)具有12 路脈沖輸出的數(shù)據(jù)分配器。畫出連接圖，在圖上標(biāo)明第1 路到第12 路輸出的位置解： 17. 改用一片74LS195移位寄存器來代替上題中的74LS163，完成同樣的設(shè)計(jì)解： 18. 分析下圖所示同步時(shí)序邏輯電路，作出狀態(tài)轉(zhuǎn)移表和狀態(tài)圖，說明它是Mealy型電路還是Moore型電
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