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基于fpga的數(shù)字系統(tǒng)設(shè)計(jì)三層電梯控制器(存儲(chǔ)版)

  

【正文】 “1010”=q=”0011000000000000”。 when “0110”=q=”0000000000000110”。 24 end case。電梯在 1 樓( dir=“ 0000”)時(shí)處于等待狀態(tài),有 2 個(gè)乘客進(jìn)入電梯,一個(gè)到 2 樓( dir=”0001”) ,一 個(gè)到 3 樓(“ dir=0010”) ,則 dir 的第 2 位和第 3 位置位。這種設(shè)計(jì)方法必在將來(lái)的數(shù)字系統(tǒng)設(shè)計(jì)中發(fā)揮越來(lái)越重要的作用。因此編程時(shí)要注意在選中某個(gè)片子之前,要先將計(jì)算出的數(shù)據(jù)信號(hào)先放到數(shù)據(jù)總線上。 致謝 26 參考文獻(xiàn) [1]夏宇聞 從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn) . 北京:高等教育出版社 . [2]劉必虎,沈建國(guó) 數(shù)字邏輯電路 北京:科學(xué)出版社 . [3]龔建榮 可編程器件綜述 軍事通信技術(shù) 1997,( 63): 33- 36. [4] (美) James Gray VHDL Design Representation and Synthesis(Second Edition) PH PTR [5] 曾繁泰,陳美金 VHDL 數(shù)字系統(tǒng)設(shè)計(jì)(第二版) 清華大學(xué)出版社 202011 [6] 曾繁泰,陳美金 VHDL 程序設(shè)計(jì) 清華大學(xué)出版社 202011 [7] 盧毅 VHDL 與數(shù)字電路設(shè)計(jì) 北京:科學(xué)出版社 . [8] 北京理工大學(xué) ASIC 研究所 VHDL 語(yǔ)言 100 例詳解 清華大學(xué)出版社 202031 。 (3)有的程序可能在仿真時(shí)時(shí)序是完全正確的,而將程序下載到板子上之后卻發(fā)現(xiàn)不對(duì)。這樣設(shè)計(jì)者可以 采用自頂向下的設(shè)計(jì)方法和并行工作的設(shè)計(jì)原則。 仿真結(jié)果 該控制器由 VHDL 語(yǔ)言實(shí)現(xiàn)。 when “1100”=q=”0000000000110000”。 when “0100”=q=”0000000000011000”。 when “1000”=q=”1111111111111111”。 end dian。 模塊 DIAN 見(jiàn)圖 5。 architecture seg_arc of seg is begin process(clk) begin if clk’event and clk=’1’then case a is when “001”=q=”0000110”。 模塊 SEG 見(jiàn)圖 4。 end if。 if ceng1=”001”then state:=c1。 y:=’1’。 end if。 end if。 end if。 if ting1(1)=’1’or up1(1)=’1’then state:=kai。 18 end if。 end if。 variable mo,x,y,z:std_logic。 //up1,up2:是一層、二層的上升請(qǐng)求 use 。當(dāng)電梯處于上升狀態(tài)時(shí),如果有上升請(qǐng)求的分控制器所在樓層數(shù)大于電梯所在的樓層數(shù),當(dāng)電梯運(yùn)行到相應(yīng)的樓層數(shù)時(shí),電梯開(kāi)門,讓有請(qǐng)求的乘客進(jìn)入電梯。 Switch=1 ur=1 ur=0,dr=0 ur=0,dr=0 ur =1 Wait(等待 ) Upper(上升 ) Down(下降) 14 dr=1 ur=1 圖 2 電梯控制器的狀態(tài)轉(zhuǎn)換圖 當(dāng)電梯開(kāi)關(guān) switch 為“ 0”時(shí),為等待狀態(tài),狀態(tài) 指示信號(hào) ladd 為“ 00”。 樓層請(qǐng)求寄存器的復(fù)位和置位。電梯所在的樓層數(shù)通過(guò)譯碼器譯碼從而在樓層顯示器中顯示。 ( 3)電梯每秒升(降)一層樓。設(shè)計(jì)本身與工藝脫離,最后的物理實(shí)現(xiàn)可以根據(jù)不同的需要采取多種方式來(lái)完成 . (2)采用自頂向下的設(shè)計(jì)流程和不同層次間的并行設(shè)計(jì),以確保設(shè)計(jì)一次成功,而設(shè)計(jì)人員只要把精力集中在系統(tǒng)概念和方案的優(yōu)化上。 當(dāng)前中國(guó) EDA市場(chǎng)已漸趨成熟,據(jù)最新統(tǒng)計(jì)顯示,中國(guó)止在成為電子設(shè)計(jì)自動(dòng)化領(lǐng)域發(fā)展最快的市場(chǎng),年復(fù)合增民率達(dá) 到了 50%.不過(guò)大部分設(shè)計(jì) 的是 PC主板和小型 ASIC領(lǐng)域,僅有小部分 (約 11%)的設(shè)計(jì)人員開(kāi)發(fā)復(fù)雜芯片上系統(tǒng)器件。 ,有助于設(shè)計(jì)者組織描述,對(duì)行為功能進(jìn)一步分類 : ,便于作為標(biāo)準(zhǔn)的設(shè)計(jì)文檔保存,也便于設(shè)計(jì)資源的重用。 ,既支持自底向上 (Botomup)的設(shè)計(jì),也支持自頂向 下(Topdown)的設(shè)計(jì) 。 VHDL的基本技術(shù)特征 VHDL是一種獨(dú)立于實(shí)現(xiàn)技術(shù)的語(yǔ)言,它不受某一種特定工藝的束縛,允許使用 者在其范圍內(nèi)選擇工藝和方法,為了適應(yīng)未來(lái)的數(shù)字硬件技術(shù), VHDL還提供將新技術(shù)引入現(xiàn)有設(shè)計(jì)的潛力。 第 2章 VHDL、 EDA語(yǔ)言 簡(jiǎn)介 VHDL語(yǔ)言產(chǎn)生于 80年代,它的全稱是“超高速集成電路硬件描述語(yǔ)言 (VHSIC Hardware Description Language), VHDL的結(jié)構(gòu)和方法受到〔 DA語(yǔ)言的影響, 吸收了其它硬件描述語(yǔ)言的某些優(yōu)點(diǎn), 1986年 3月, IEE開(kāi)始致力于 VHDL的標(biāo)準(zhǔn)化工作,為此,成立了審查和完善 VHDL的標(biāo)準(zhǔn)化小組。本文采用 VHDL 語(yǔ)言來(lái)設(shè)計(jì)實(shí)用電梯控制器,其代碼具有良好的可讀性和易理解性。 EDA 技術(shù)不是某一學(xué)科的分支,或某種新的技能技術(shù),它是一們綜合性學(xué)科,融合多學(xué)科于一體,打破了軟件和硬件間的壁壘,使計(jì)算機(jī)的軟件與硬件實(shí)現(xiàn)、設(shè)計(jì)效率和產(chǎn)品性能合二為一,它代表了電子設(shè)計(jì)技術(shù)和應(yīng)用技術(shù)的發(fā)展方向。 EDA是指以計(jì)算機(jī)為工作平臺(tái),融合了應(yīng)用電子技術(shù)、計(jì)算機(jī)技術(shù)、信息處理及智能化技術(shù)的最新成果,進(jìn)行電子產(chǎn)品的 字自 動(dòng) 設(shè)計(jì) 。VHDL具有與具體硬件電路無(wú)關(guān)和設(shè)計(jì)平臺(tái)無(wú)關(guān)的特性,并且具有良好的電路行為描述和系統(tǒng)描述的能力,并在語(yǔ)言易讀性和層次化結(jié)構(gòu)化設(shè)計(jì)方面,表現(xiàn)了強(qiáng)大的生命力和應(yīng)用潛力。因此 EDA 技術(shù)為現(xiàn)代電力理論和設(shè)計(jì)的表達(dá)與實(shí)現(xiàn)提供了可能 5 性。用VHDL 進(jìn)行電子系統(tǒng)的設(shè)計(jì)的一個(gè)很大的特點(diǎn)是設(shè)計(jì)者可以專心致力于其功能的實(shí)現(xiàn),而不需要對(duì)不影響功能的與工藝有關(guān)的因素花費(fèi)過(guò)多的時(shí)間和精力。電梯業(yè)作 6 為建筑業(yè)的重要產(chǎn)業(yè),必須電梯群控技術(shù)展開(kāi)深入地研究,提高我國(guó)電梯控制領(lǐng)域的水平, 這樣 電梯工業(yè)以及其它行業(yè)的發(fā)展會(huì)有極大的促進(jìn)作用,必將帶來(lái)很大的經(jīng)濟(jì)效益和社會(huì)效益。現(xiàn)在, VHDL和 Verilog作為 IEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言,得到了眾多 EDA公司的 持,已經(jīng)成為了事實(shí)上的通用硬件描述語(yǔ)言。描述形式可以是結(jié)構(gòu)描述,也可以是行為描述,或者二者兼而有之 。VHDL是強(qiáng)類型語(yǔ)言,設(shè)計(jì)電路的安全性好 。 為了迅速推動(dòng)中國(guó) EDA產(chǎn)業(yè)的迅速發(fā)展,中國(guó)自 1995年以來(lái)加速發(fā)展半導(dǎo)體產(chǎn)業(yè),尤其是在近幾年更是加大了對(duì)此行業(yè)的扶持力度,建立了多個(gè)國(guó)家級(jí)集成電路設(shè)計(jì)產(chǎn)業(yè)化基地,推動(dòng)系列設(shè)計(jì)活動(dòng)以應(yīng)對(duì)亞太地區(qū)其它 EDA市場(chǎng)的競(jìng)爭(zhēng)。具體地說(shuō),它有以下特點(diǎn) : (l)從概念提出,系統(tǒng)劃分,到電路設(shè)計(jì),物理實(shí)現(xiàn)的全過(guò)程自動(dòng)化設(shè)計(jì)成為現(xiàn)實(shí)。 12 ( 2)設(shè)有電梯所處位置指示裝置級(jí)電梯運(yùn)行模式(上升或下降)指示裝置。乘客在電梯中選擇所要到達(dá)的樓層,同過(guò)主控制器的處理, 電梯開(kāi)始運(yùn)行,狀態(tài)顯示器顯示電梯的運(yùn)行狀態(tài)。程序中定義 urr( 3b 上升寄存器), drr( 3b 的下降寄存器), ur(上升寄存器各位相或 ), dr(下降寄存器各位相或), let(判斷狀態(tài)的使能信號(hào)),輸出端口 qout, lamp 的內(nèi)部信號(hào) lift、 ladd, 時(shí)序內(nèi)部信號(hào) time。狀態(tài) 圖如圖 2所示。下降原理類似。 圖 3 模塊 VERYHARDD librar
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