你問我答之pcb設(shè)計技巧疑難解析-在線瀏覽
2025-08-03 21:31本頁面
【正文】 致性。如何處理實際布線中的一些理論沖突的問題1. 基本上, 將模/數(shù)地分割隔離是對的。2. 晶振是模擬的正反饋振蕩電路, 要有穩(wěn)定的振蕩信號, 必須滿足loop gain 與phase的規(guī)范,而這模擬信號的振蕩規(guī)范很容易受到干擾, 即使加ground guard traces 可能也無法完全隔離干擾。所以, 一定要將晶振和芯片的距離進(jìn)可能靠近。但基本原則是因EMI 所加的電阻電容或ferritebead, 不能造成信號的一些電氣特性不符合規(guī)范。最后才用電阻電容或ferrite bead 的方式, 以降低對信號的傷害。各家EDA 公司的繞線引擎能力和約束條件的設(shè)定項目有時相差甚遠(yuǎn)。這會影響到自動布線出來的走線方式是否能符合設(shè)計者的想法。例如, 走線的推擠能力, 過孔的推擠能力, 甚至走線對敷銅的推擠能力等等。關(guān)于test coupon。一般要控制的阻抗有單根線和差分對兩種情況。最重要的是測量時接地點的位置。1在高速PCB 設(shè)計中，信號層的空白區(qū)域可以敷銅，而多個信號層的敷銅在接地和接電源上應(yīng)如何分配？一般在空白區(qū)域的敷銅絕大部分情況是接地。也要注意不要影響到它層的特性阻抗， 例如在dual stripline 的結(jié)構(gòu)時。例如四層板: 頂層電源層地層底層， 這時頂層走線特性阻抗的模型是以電源平面為參考平面的微帶線模型。另外，如果走線太密且加測試點的規(guī)范比較嚴(yán)，則有可能沒辦法自動對每段線都加上測試點，當(dāng)然，需要手動補齊所要測試的地方?；旧贤饧拥臏y試點(不用線上既有的穿孔(via or DIP pin)當(dāng)測試點)可能加在線上或是從線上拉一小段線出來。這兩個情況都會對高速信號多多少少會有點影響，影響的程度就跟信號的頻率速度和信號緣變化率(edge rate)有關(guān)。原則上測試點越小越好(當(dāng)然還要滿足測試機(jī)具的要求)分支越短越好。這地層上的電流會找阻抗最小的地方流回去。另外，也可以分析整個電流環(huán)路，尤其是電流較大的部分，調(diào)整地層或地線的接法，來控制電流的走法(例如，在某處制造低阻抗，讓大部分的電流從這個地方走)，降低對其它較敏感信號的影響。在通信網(wǎng)路方面，PCB 板的工作頻率已達(dá)GHz 上下，迭層數(shù)就我所知有到40 層之多。因應(yīng)這高速高密度走線需求，盲埋孔(blind/buried vias)、mircrovias 及buildup 制程工藝的需求也漸漸越來越多。1兩個常被參考的特性阻抗公式：(microstrip)Z={87/[sqrt(Er+)]}ln[(+T)] 其中，W 為線寬，T 為走線的銅皮厚度，H 為走線到參考平面的距離，Er 是PCB 板材質(zhì)的介電常數(shù)(dielectric constant)。(stripline)Z=[60/sqrt(Er)]ln{4H/[(T+)]} 其中，H 為兩參考平面的距離，并且走線位于兩參考平面的中間。因為差分信號的應(yīng)用原理最重要的一點便是利用差分信號間相互耦合(coupling)所帶來的好處，如flux cancellation，抗噪聲(noise immunity)能力等。1剛?cè)岚逶O(shè)計是否需要專用設(shè)計軟件與規(guī)范？國內(nèi)何處可以承接該類電路板加工？可以用一般設(shè)計PCB 的軟件來設(shè)計柔性電路板(Flexible Printed Circuit)。由于制造的工藝和一般PCB 不同，各個廠商會依據(jù)他們的制造能力會對最小線寬、最小線距、最小孔徑(via)有其限制。至于生產(chǎn)的廠商可上網(wǎng)“FPC”當(dāng)關(guān)鍵詞查詢應(yīng)該可以找到。例如，通常在高頻器件或時鐘產(chǎn)生器附近可以借固定用的螺絲將PCB 的地層與chassis ground 做連接，以盡量縮小整個電流回路面積，也就減少電磁輻射。有些多重電源的系統(tǒng)可能會要求某些電源之間起來的順序與快慢有某種規(guī)范。3. 確認(rèn)reset 信號是否達(dá)到規(guī)范要求。接下來依照系統(tǒng)運作原理與busprotocol 來debug。以下提供幾個注意的地方：。一般?？吹降拈g距為兩倍線寬。不同芯片信號的結(jié)果可能不同。，甚至有走線正好上下重迭在一起，因為這種串?dāng)_比同層相鄰走線的情形還大。但是PCB 板的制作成本會增加。除此以外，可以預(yù)留差分端接和共模端接，以緩和對
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