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正文內(nèi)容

數(shù)字電子技術(shù)基礎(chǔ)-文庫吧資料

2025-06-23 17:08本頁面
  

【正文】 需要有一個專門的譯碼器,該譯碼器不但要完成譯碼功能,還要有相當?shù)尿?qū)動能力。一個LED數(shù)碼管可用來顯示一位0~9十進制數(shù)和一個小數(shù)點。二進制譯碼器還能方便地實現(xiàn)邏輯函數(shù),如圖463所示,實現(xiàn)的邏輯函數(shù)是 Z=+ABC 圖462 作數(shù)據(jù)分配器 圖463 實現(xiàn)邏輯函數(shù) 利用使能端能方便地將兩個 3/8譯碼器組合成一個4/16譯碼器,如圖464所示。根據(jù)輸入地址的不同組合譯出唯一地址,故可用作地址譯碼器。若在S1輸入端輸入數(shù)據(jù)信息,==0,地址碼所對應(yīng)的輸出是S1數(shù)據(jù)信息的反碼;若從端輸入數(shù)據(jù)信息,令S1==0,地址碼所對應(yīng)的輸出就是端數(shù)據(jù)信息的原碼。 (a) (b)圖461 3-8線譯碼器74LS138邏輯圖及引腳排列二進制譯碼器實際上也是負脈沖輸出的脈沖分配器。當S1=1,+=0時,器件使能,地址碼所指定的輸出端有信號(為0)輸出,其它所有輸出端均無信號(全為1)輸出。以3線-8線譯碼器74LS138為例進行分析,圖461(a)、(b)分別為其邏輯圖及引腳排列。若有n個輸入變量,則有2n個不同的組合狀態(tài),就有2n 個輸出端供其使用。前者又分為變量譯碼器和代碼變換譯碼器。不同的功能可選用不同種類的譯碼器。它的作用是把給定的代碼進行“翻譯”,變成相應(yīng)的狀態(tài),使輸出通道中相應(yīng)的一路有信號輸出?! ?.熟悉數(shù)碼管的使用方法。4.組合電路設(shè)計體會。2.根據(jù)所選用的器件畫出邏輯電路圖,并安裝調(diào)試電路。5.帶*的實驗項目為選做內(nèi)容。3.當與非門中某一端不用時應(yīng)作處理。圖454 血型關(guān)系示意圖 五、實驗注意事項1.根據(jù)所給的標準器件完成設(shè)計組合電路的任務(wù),并畫出邏輯電路圖。試用與非門設(shè)計一電路,判斷輸血和受血者是否符合規(guī)定。輸血時。要求先用3位二進制數(shù)對這些字母進行編碼,然后進行譯碼顯示。試設(shè)計一個8421BCD碼譯碼器。 ②8421BCD譯碼器的設(shè)計與實驗: 此電路有輸入端四個,輸入8421BCD碼;有十個輸出端,分別表示十進制數(shù)碼0~9。(5)編碼器、譯碼器的設(shè)計與實驗 ①8421BCD編碼器的設(shè)計與實驗: 此電路具有10個數(shù)碼輸入端0~9,當某一輸入端為高電平而其余輸入端全為低電平時,表示有某一個十進制數(shù)碼輸入,輸出仍為相應(yīng)的4位二進制數(shù)碼,這個數(shù)碼稱做BCD碼。其輸出端有兩個:一是和(差)數(shù)Si(Di),另一個是向高位發(fā)出的進位Ci+1:(借位Bi+1)。其輸入變量為加數(shù)Ai(被減數(shù)Xi)、被加數(shù)Bi(減數(shù)Yi)、低位來的進位Ci(借位Bi),以及控制加/減運算的控制變量M。(4)要求設(shè)計一個3位二進制全減器。要求設(shè)計一個3位二進制全加器。(3)奇偶校驗電路的設(shè)計與實驗: 用一個3線—8線譯碼器和最少的門電路設(shè)計一個奇偶校驗電路,要求當輸入的四個變量中有偶數(shù)個1時輸出為1,否則為0。設(shè)計一個組合邏輯電路,使之能區(qū)分下列三種情況0≤X≤4;5≤X≤9;10≤X≤15:要求用與非門及八選一數(shù)據(jù)選擇器兩種方法實現(xiàn)。2.設(shè)計一個三人表決器,設(shè)計要求A具有否決權(quán),用與非門完成電路,要求按本文所述的設(shè)計步驟進行,直到測試電路邏輯功能符合設(shè)計要求為止。按圖452接線,輸入端A、B、C、D接至邏輯開關(guān)輸出插口,輸出端Z接邏輯電平顯示輸入插口,按真值表(自擬)要求,逐次改變輸入變量,測量相應(yīng)的輸出值,驗證邏輯功能,與表451進行比較,驗證所設(shè)計的邏輯電路是否符合要求。 Z=ABC+BCD+ACD+ABD=根據(jù)邏輯表達式畫出用“與非門”構(gòu)成的邏輯電路如圖452所示。設(shè)計步驟:根據(jù)題意列出真值表如表451所示,再填入卡諾圖表452中。2.組合邏輯電路設(shè)計舉例 用“與非”門設(shè)計一個表決電路。 根據(jù)簡化后的邏輯表達式,畫出邏輯圖,用標準器件構(gòu)成邏輯電路。然后用邏輯代數(shù)或卡諾圖化簡法求出簡化的邏輯表達式。設(shè)計組合電路的一般步驟如圖4
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