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eda技術(shù)實(shí)驗(yàn)報(bào)告-文庫(kù)吧資料

2025-02-12 15:02本頁(yè)面
  

【正文】 1 年 5 月 19 日 指導(dǎo)教師簽字: 成績(jī): 實(shí)驗(yàn)四 用原理圖輸入方法設(shè)計(jì) 8 位全加器 1.實(shí)驗(yàn)?zāi)康暮鸵? 本實(shí)驗(yàn)為綜合性實(shí)驗(yàn),綜合了 簡(jiǎn)單組合電路邏輯、 QuartusII 的原理圖輸入方法、 層次化設(shè)計(jì)的方法 等內(nèi)容 。對(duì)于程序語(yǔ)言不大會(huì)寫(xiě),立化操作更是不會(huì),幸虧在同學(xué)的幫助下,理解了實(shí)驗(yàn)的操作思路,圓滿完成了實(shí)驗(yàn)。 END 軟件編譯: 6.實(shí)驗(yàn)數(shù)據(jù)處理與分析 仿真分析 硬件測(cè)試和實(shí)驗(yàn)過(guò)程: 7.質(zhì)疑、建議、問(wèn)題討論 本實(shí)驗(yàn)通過(guò) 按 鍵 鍵 鍵 6 和鍵 5,來(lái)觀察數(shù)碼 8 的輸出 。 END CASE 。 WHEN 1111 = LED7S = 1110001 。 WHEN 1101 = LED7S = 1011110 。 WHEN 1011 = LED7S = 1111100 。 WHEN 1001 = LED7S = 1101111 。 WHEN 0111 = LED7S = 0000111 。 WHEN 0101 = LED7S = 1101101 。 WHEN 0011 = LED7S = 1001111 。 WHEN 0001 = LED7S = 0000110 。 END 。 ENTITY DECL7S IS PORT ( A : IN STD_LOGIC_VECTOR(3 DOWNTO 0)。 5.實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)數(shù)據(jù)記錄 程序設(shè)計(jì): LIBRARY IEEE 。注意,這里沒(méi)有考慮表示小數(shù)點(diǎn)的發(fā)光管,如果要考慮,需要增加段 h,此時(shí)實(shí)體說(shuō)明中的 LED7S:OUT STD_LOGIC_VECTOR(6 DOWNTO 0)應(yīng)改為 ? (7 DOWNTO 0)。 7段數(shù)碼顯示譯碼器的輸出信號(hào) LED7S 的 7位分別接共陰 7段數(shù)碼管的 7個(gè)段,高位在左,低位在右。 其目的是 熟悉 QuartusII 的 VHDL 文本設(shè)計(jì)流程全過(guò)程。每次修改過(guò)程都應(yīng)該注意保存,才能將修改的結(jié)果反映到所輸出的波形中,剛開(kāi)始常常忘記,經(jīng)過(guò)多次操作后才能夠熟練運(yùn)用。 END ARCHITECTURE one 。 END IF。 THEN y = a 。 ARCHITECTURE one OF mux21a IS BEGIN PROCESS (a,b,s) BEGIN IF s = 39。 y : OUT BIT )。 將設(shè)計(jì)好的 2 選 1 多路多路選擇器看成是一個(gè)元件 mux21a,利用元件例化語(yǔ)句描述下圖,并將此文件放在同一目錄 E:\muxfile 中。 2.實(shí)驗(yàn)原理 2選 1多路選擇器真值表 s a b y L L L L H H H L L H H H 3.主要儀器設(shè)備(實(shí)驗(yàn)用的軟硬件環(huán)境) 實(shí)驗(yàn)的硬件環(huán)境是: 微機(jī)一臺(tái) GW48 EDA 實(shí)驗(yàn)開(kāi)發(fā)系統(tǒng)一套 電源線一根 十芯 JTAG 口線一根 USB 下載線一根 USB 下載器一個(gè) 實(shí)驗(yàn)的軟件環(huán)境是: Quartus II 軟件 4.操作方法與實(shí)驗(yàn)步驟 首先利用 QuartusII 完成 2 選 1 多 路選擇器的文本編輯輸入( ) 和仿真測(cè)試等步驟,然后進(jìn)行仿真。 福建農(nóng)林大學(xué)計(jì)算機(jī)與信息學(xué)院信息工程類實(shí)驗(yàn)報(bào)告 系: 電子信息工程 專業(yè): 電子信息工程 年級(jí): 2021 級(jí) 姓名: 學(xué)號(hào): 實(shí)驗(yàn)課程: EDA 技術(shù) 實(shí)驗(yàn)室號(hào): _田實(shí) 405 實(shí)驗(yàn)設(shè)備號(hào): 實(shí)驗(yàn)時(shí)間: 2021 年 5 月 18 日 指導(dǎo)教師簽字: 成績(jī): 實(shí)驗(yàn)二 用文本輸入法設(shè)計(jì) 2 選 1 多路選擇器 1.實(shí)驗(yàn)?zāi)康暮鸵? 本實(shí)驗(yàn)為綜合性實(shí)驗(yàn),綜合了 簡(jiǎn)單組合電路邏輯、 QuartusII 的使用方法、多層次 電路設(shè)計(jì)、仿真和硬件測(cè)試 等內(nèi)容 。在調(diào)試過(guò)程中出現(xiàn)的 error 信息要特別關(guān)注,根據(jù)錯(cuò)誤提示信息,對(duì)其進(jìn)行正確改正。 VHDL 有些關(guān)鍵詞也比較特別,例如 eslif 不能錯(cuò)寫(xiě)成 elseif。 7.質(zhì)疑、建議、問(wèn)題討論 QuartusII 和 Modelsim 軟件環(huán)境設(shè)置比較多,學(xué)習(xí)時(shí)要認(rèn)真細(xì)心。 利用 Quartus II 軟件實(shí)現(xiàn)原理圖輸入設(shè)計(jì)文件的編輯和產(chǎn)生相應(yīng)的原理 圖符號(hào)元件。 5.實(shí)驗(yàn)內(nèi)容及實(shí)驗(yàn)數(shù)據(jù)記錄 6.實(shí)驗(yàn)數(shù)據(jù)處理與分析 利用 Quartus II 軟件實(shí)現(xiàn) EDA 的基本設(shè)計(jì)流程:創(chuàng)建工程、編輯文
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