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正文內(nèi)容

數(shù)字邏輯實驗報告(參考版)

2024-08-15 16:29本頁面
  

【正文】 我會回去多問問同學,上網(wǎng)找資料了解的。另外在波形仿真的時候?qū)覍也怀晒Γ瓉硎菦]有對更改過的波形文件保存并對以前的波形文件進行覆蓋,所以一直都還是報出以前的錯?!▽嶒灥男牡茫嶒炦^程中經(jīng)過…對MaxplusⅡ的操作有了進一步的認識。三態(tài)門的使能端可對低電平有效。七.Programming芯片編程因為沒有數(shù)據(jù)線,暫時沒有進行芯片編程。 實驗結果與分析三態(tài)門 編譯過程a)編譯過程、調(diào)試結果 文件語法檢查沒有錯誤,見圖1:圖1,見圖2:圖2新工程santai創(chuàng)建子模塊的符號文件成功,見圖3:圖3,見圖4:圖4,如圖5圖5 功能仿真a)功能仿真過程及仿真結果,見圖6:圖6,見圖7:圖7b)結果分析及結論制作的波形圖如圖8所示:圖8功能仿真結果如圖9所示:圖9當輸入端en的輸入信號為高電平1時,輸出端b的輸出信號與輸入端a的輸入信號一致;當輸入端en的輸入信號為低電平0時,輸出端b輸出信號為高電阻態(tài),實現(xiàn)了三態(tài)門的使能端對低電平有效。點擊“Processing”中的“Start simulation”,開始功能仿真。出現(xiàn)成功后提示如下圖16后,點擊”assignments“中”settings”,出現(xiàn)界面6。 波形仿真及驗證。點擊”View”中的”Zoom out”命令縮小波形顯示。界面12點擊“Edit”中“end time”,出現(xiàn)界面3, us.點擊“Edit”中“grid size”,出現(xiàn)界面4,將周期設定為100ns.界面4點擊,使其節(jié)點a成為高亮狀態(tài),點擊左側(cè)欄中的,進入界面15,將開始時間“start time”設為0,結束時間“end time”,周期“period”設定為100ns,相位位移“offset ”設為0,占空比“Duty cycle”設為50%。3. 點擊File中得New建立一個波形文件。點擊“File”中“Save”,保存在工程文件夾里,命名為“”.點擊“processing”選擇“Analyze current file”,檢查語法錯誤直至出現(xiàn)圖14.點擊“processing”中的“start”選擇”start analysis amp。 b=c。end ponent。ponent ocport(datain:in std_logic。end jidianji。entity jidianji isport(a:in std_logic。VHDL語言設計如下:結構體描述:library ieee。 2. 行為描述編譯成功后,關閉QuartusⅡ軟件
點擊復制文檔內(nèi)容
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