eda課程設(shè)計(jì)基于fpga的任意波形發(fā)生器-資料下載頁
2025-06-19 14:05本頁面
【正文】 生三角波（trig_wave）時(shí)送到 DAC0832 的數(shù)據(jù)：綜合實(shí)踐14 由仿真結(jié)果可知，改變 select[1:0]的值，能夠正確的將對(duì)應(yīng)的波形數(shù)據(jù)送到 DAC0832，從而完成了整體設(shè)計(jì)結(jié)論在研究的過程中，通過學(xué)習(xí)和參閱過內(nèi)外相關(guān)的文獻(xiàn)，并從網(wǎng)絡(luò)上獲取最新的硬件開發(fā)指南和芯片開發(fā)手冊(cè)，同時(shí)不斷向身邊的老師請(qǐng)教和學(xué)習(xí)，通過系統(tǒng)的學(xué)習(xí)和實(shí)際工作的鍛煉，積累了必要的基礎(chǔ)知識(shí)，培養(yǎng)了實(shí)際的開發(fā)技能。通過本設(shè)計(jì)工作，基本掌握了 Quartus II 的使用技術(shù)，進(jìn)一步加深了對(duì)數(shù)字信號(hào)處理技術(shù)的理解，提高了使用可編程邏輯器件設(shè)計(jì)數(shù)字系統(tǒng)的能力和軟件編程的能力，為將來從事科研工作打下了良好的基礎(chǔ)。綜合實(shí)踐15參考文獻(xiàn)[1] FPGA 年 09 期[2] HDL ，2022 [3] 王文華. 基于 DDS 技術(shù)的任意波形發(fā)生器研究. 浙江大學(xué), 2022 .[4] Altera II .簡易用戶使用入門指南 [5] Verilog HDL ，2022 綜合實(shí)踐16附錄 程序如下：module Wave_gen(address,inclk,select,freq)。output[8:0] address。 //輸出控制 ROM 的地址input inclk。 //系統(tǒng)始終，時(shí)間應(yīng)該保證 D/A 能轉(zhuǎn)換完畢input[1:0] select。 //波形選擇，具體值代表的波形見下面定義input[3:0] freq。 //控制輸出波形的頻率reg[7:0] Qout。reg[8:0] address。reg[7:0] k,m。parameter sina_wave=239。b00,swat_wave=239。b01,squr_wave=239。b10,trig_wave=239。b11。always @(posedge inclk) begincase(select)sina_wave:beginif(select==1) address=128。if(select==2) address=256。if(select==3) address=384。if(freq==0||freq==1)begin if(address=127) address=0。 else address=address+1。endelsebegin k=127/freq。 m=freq*k。 if(address=m) address=0。 else address=address+freq。 end endswat_wave:beginif(select==0) address=0。if(select==2) address=256。if(select==3) address=384。if(address128) address=128。else begin綜合實(shí)踐17if(freq==0||freq==1)begin if(address=255) address=128。 else address=address+1。endelsebegin k=127/freq。 m=freq*k。 if(address=(m+128)) address=128。 else address=address+freq。 end end endsqur_wave:beginif(select==0) address=0。if(select==1) address=128。if(select==3) address=384。if(address256) address=256。else beginif(freq==0||freq==1)begin if(address=383) address=256。 else address=address+1。endelsebegin k=127/freq。 m=freq*k。 if(address=(m+256)) address=256。 else address=address+freq。 end end endtrig_wave:beginif(select==1) address=128。if(select==2) address=256。if(select==3) address=384。if(address384) address=384。綜合實(shí)踐18else beginif(freq==0||freq==1)begin if(address=511) address=384。 else address=address+1。endelsebegin k=127/freq。 m=freq*k。 if(address=(m+384)) address=384。 else address=address+freq。 end end endendcase end endmodule
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