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2025-02-14 15:11本頁面
【正文】 (4) 門級時序仿真 。 常用 EDA工具 適配器（布局布線器） 適配器的任務(wù)是完成目標系統(tǒng)在器件上的布局布線 。 適配， 即結(jié)構(gòu)綜合通常都由可編程邏輯器件的廠商提供的專門針對器件開發(fā)的軟件來完成 。 這些軟件可以單獨或嵌入在廠商的針對自己產(chǎn)品的集成 EDA開發(fā)環(huán)境中存在 。 下載器（編程器） 把適配器輸出的下載文件通過編程器下載到實際可編程器件中 ， 實現(xiàn)硬件設(shè)計 。 常用 EDA工具 ALTERA： MAX+PLUSII、 QUARTUSII LATTICE： isp EXPERT SYSTEM、 isp Synario ispDesignExpert SYSTEM ispCOMPILER、 PACDESIGNER XILINX： FOUNDATION、 ISE FPGA Compiler、 FPGA Express、 Synplify、 Leonardo Spectrum ... EDA公司 ： CADENCE、 EXEMPLAR、 MENTOR GRAPHICS、 OrCAD、 SYNOPSYS、 SYNPLICITY、 VIEWLOGIC、 ... 常用 EDA工具 MAX+plusII概述 圖形或 HDL 編輯器 MAX+plusII設(shè)計流程 編譯網(wǎng)表提取、數(shù)據(jù)庫建立、邏輯綜合、邏輯分割、適配 延時網(wǎng)表提取、編程文件匯編 編 程 器 設(shè) 計 輸 入 綜合或 編 輯 適 配 器 件 下 載 仿 真 MAX+plusII概述 MAX+plusII概述 MAX+plusII概述 MAX+plusII概述 IP（ Intellectual Property）即知識產(chǎn)權(quán)核或知識產(chǎn)權(quán)模塊。 IP核 軟 IP 固 IP 硬 IP IP核 IP核 ?軟 IP： 由 HDL寫成的功能模塊，常以 HDL源文件 形式出現(xiàn)； ? 開發(fā)周期短，設(shè)計投入少；靈活性大； ? 需要修正；不可能完全優(yōu)化 ?固 IP： 是完成了綜合的功能塊，有較大設(shè)計深度，以 網(wǎng)表 形式提交客戶使用； ?硬 IP： 提供設(shè)計的最終階段產(chǎn)品： 掩膜 。 大規(guī)模 FPGA Nios嵌入式系統(tǒng) IP軟核 Flash ROM 固體硬盤 SRAM 內(nèi)存 SDRAM 內(nèi)存 嵌入式 Bios 嵌入式 ROM 嵌入式 RAM 嵌入式 FIFO SDRAM控制模塊 硬件 DSP模塊 RS232 CAN控制器 DMA VGA控制器 RS232接口電路 PS2鍵盤接口 PS2鼠標接口 Ether接口 內(nèi)部時鐘 PIC接口 浮點算術(shù)協(xié)處理器 VGA接口 PS/2鍵盤 / 鼠標接口 D/A接口 A/D接口 LCD接口 LED接口 USB控制器 UART FIFO 并行接口 圖象或語音采樣接口 立體聲輸出接口 通用 I/O口 應(yīng)用系統(tǒng) SOPC IP核 必須為易于重用按嵌入式應(yīng)用專門設(shè)計 IP核內(nèi)涵 必須實現(xiàn) IP模塊的優(yōu)化設(shè)計 必須符合 IP標準 ?一個 SoC可能包含上百個 IP模塊，一家公司很難完全擁有所需的 IP，從外界獲得 IP已經(jīng)迫在眉睫； ?2022年美國前十大 IP供應(yīng)商 IP交易額接近 7億美圓； ?支付授權(quán)費交易占 65% ?專利費交易占 21% ?服務(wù) /維護費交易占 14% ?2022年美國的 IP成交量占世界 IP總交易額的 53%，日本占 21%，歐洲占 17%，亞太地區(qū)僅占 9%。 IP核 IP核 ?IP核來源： ?芯片設(shè)計公司自身積累 ?Foundry積累 ?專業(yè) IP公司 ?EDA廠商 ?設(shè)計服務(wù)公司 ?為使從各方獲得的 IP核能有效地集成，需要建立 IP核標準體系，制定 IP核標準 /規(guī)范。 IP核 IP核的標準化體系 IP核標準、規(guī)范 復(fù)用設(shè)計標準 轉(zhuǎn)讓規(guī)范 \標準 質(zhì)量標準 交易標準 國家 IP核庫網(wǎng)站： 小結(jié)：本次課重點 ?EDA技術(shù)的概念； ?自頂向下的設(shè)計方法； ?VHDL的綜合； ?FPGA/CPLD的開發(fā)流程 輸入、綜合、適配（仿真）、下載（編程和配置） ?常用 EDA工具 ?IP核
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