vhdl的物件objects宣告-資料下載頁(yè)
2025-09-20 19:39本頁(yè)面
【導(dǎo)讀】<物件種類><物件名稱>:<資料型態(tài)>[:=<初始值>];在VHDL中的訊號(hào)是指電路上的連接點(diǎn),供有正負(fù)號(hào)型態(tài)用。提供無(wú)正負(fù)號(hào)型態(tài)用。整數(shù)資料型態(tài)其長(zhǎng)度雖然是32bits,以調(diào)整最節(jié)省硬體的大小。這個(gè)資料型態(tài)並不被許多合成工具支援。計(jì)時(shí)大多數(shù)會(huì)使用整數(shù)方式宣告。在VHDL的std_logic_arith包裝中提供了轉(zhuǎn)換功能函數(shù),弱制約性的未知值,邏輯狀態(tài):高電位‘1?
【正文】 減 * 乘 / 除 ,*只在編譯時(shí)設(shè)定數(shù)值運(yùn)算用 ** 指數(shù) *只在編譯時(shí)設(shè)定數(shù)值運(yùn)算用 Abs 絕對(duì)值 ,取正值 Mod 求模數(shù) *只在編譯時(shí)設(shè)定數(shù)值運(yùn)算用 Rem 求餘數(shù) *只在編譯時(shí)設(shè)定數(shù)值運(yùn)算用 VHDL的算術(shù)運(yùn)算 = 等於 ,如果兩值相等則為真 (true),否則為假 (false) 如果其中有一未知值 ,則輸出未知值 X /= 不等於 ,如果兩值不相等則為真 (true),否則為假 (false) 如果其中有一未知值 ,則輸出未知值 X 小於 ,如果左值小於右值則為真 (true),否則為假 (false) 如果其中有一未知值 ,則輸出未知值 X = 小於等於 ,如果左值小於等於右值則為真 (true),否則為假 (false) 如果其中有一未知值 ,則輸出未知值 X 大於 ,如果左值大於右值則為真 (true),否則為假 (false) 如果其中有一未知值 ,則輸出未知值 X = 大於等於 ,如果左值大於等於右值則為真 (true),否則為假 (false) 如果其中有一未知值 ,則輸出未知值 X VHDL的邏輯運(yùn)算 Not 取相反 And 及 Or 或 Nand 反及 Nor 反或 Xor 互斥或 Xnor 反互斥或 VHDL的位移運(yùn)算 Sll 邏輯性左移 Srl 邏輯性右移 Sla 算術(shù)性左移 (牽涉正負(fù)號(hào) ) Sra 算術(shù)性右移 (牽涉正負(fù)號(hào) ) Rol 向左旋轉(zhuǎn) Ror 向右旋轉(zhuǎn) VHDL的其它運(yùn)算 取負(fù)值 amp。 字元或字串串接運(yùn)算 LIBRARY IEEE。 USE 。 USE 。 USE 。 ENTITY exercise is PORT( A : IN STD_LOGIC_VECTOR(3 DOWNTO 0)。 B : IN STD_LOGIC_VECTOR(3 DOWNTO 0)。 C : OUT STD_LOGIC_VECTOR(7 DOWNTO 0) )。 END exercise。 ARCHITECTURE architec OF exercise IS BEGIN C(0) = Not A(0)。 C(2 downto 1) = A(2 downto 1) and B(2 downto 1)。 C(3) = 39。139。 xor A(3) 。 C(7 downto 4) = 1111 WHEN (A /= B) else 0000。 END architec。
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