2進(jìn)制-10進(jìn)制(bcd碼)數(shù)碼轉(zhuǎn)換器設(shè)計-資料下載頁
2024-09-01 17:47本頁面
【導(dǎo)讀】BCD碼亦稱二進(jìn)碼十進(jìn)數(shù)或二-十進(jìn)制代碼。用4位二進(jìn)制數(shù)來表示1位十進(jìn)制數(shù)中。的0~9這10個數(shù)碼。是一種二進(jìn)制的數(shù)字編碼形式，用二進(jìn)制編碼的十進(jìn)制代碼。得以快捷的進(jìn)行。本文就是在quartus軟件環(huán)境下利用VHDL語言將輸入的八位二進(jìn)制轉(zhuǎn)。換為BCD十進(jìn)制數(shù)并且在數(shù)碼管中顯示出來。這種編碼技巧，最常用于會計系統(tǒng)的設(shè)計里，因為會計制度。相對于一般的浮點式記數(shù)法，采用BCD碼，既?？杀４鏀?shù)值的精確度，又可免卻使電腦作浮點運算時所耗費的時間。此外，對于其他需要。高精確度的計算，BCD編碼亦很常用。
【正文】 展訓(xùn)練》課程設(shè)計說明書 12 4 整體設(shè)計電路圖 與仿真 結(jié)果分析 整體設(shè)計電路圖 在 quartus 環(huán)境下把以上各個環(huán)節(jié)連成一個完整的電路，并且進(jìn)行仿真試驗， 整個電路的電路原理圖如圖 41 所示： 圖 41 電路原理圖 仿真結(jié)果 電路經(jīng)編譯后沒 問題然后進(jìn)行仿真， 在“ Name”標(biāo)簽區(qū)內(nèi)雙擊鼠標(biāo)左鍵，彈出添加節(jié)點的對話框，把要顯示的仿真的節(jié)點添加到標(biāo)簽區(qū)內(nèi) 仿真結(jié)果如 圖 42 所示： 圖 42 仿真結(jié)果圖 V C CC LK IN P U Ts elo ut [ 7. . 0]O U T P U TAO U T P U TBO U T P U TCO U T P U TDO U T P U TEO U T P U TFO U T P U TGO U T P U TVG A[ 3. . 0]O U T P U Tdin[ 11. . 0] y 0[ 3. . 0]y 1[ 3. . 0]y 2[ 3. . 0]bc dins tdin [ 7. . 0] bc d[ 11 . . 0]bin 2b c dins t 1SEL[ 2. . 0] Q[ 7. . 0]dec ode3 _8ins t 2N U M [ 3. . 0] ABCDEFGDPD EL EDins t 3C LK 2y 0[ 3. . 0]y 1[ 3. . 0]y 2[ 3. . 0]D AO U T [ 3. . 0]SE L[ 2. . 0]SE LT I M Eins t 4V C CG N Dv ga 0v ga 2v ga 3v ga 1武漢理工大學(xué)《能力拓展訓(xùn)練》課程設(shè)計說明書 13 仿真結(jié)果分析 對于仿真出來的波形，前七位為輸出的十進(jìn)制數(shù)，當(dāng)輸入二進(jìn)制數(shù)時這個輸出口都能輸出正確的十進(jìn)制數(shù)，中間八位是輸入的二進(jìn)制數(shù)， 最后八位是正在顯示的數(shù)的位，在 時，輸入為 00000010，即十進(jìn)制的 2，此時個位應(yīng)該輸出 2，用七段數(shù)碼管表示即是 1101101，輸出完全正確，由此可見，仿真結(jié)果正確，整個電路完成。 5 小結(jié)與體會 經(jīng)過一個星期的努力終于把整個 課程設(shè)計給全部完成了， 途中經(jīng)歷了各種艱辛，也出現(xiàn)了各種錯誤，在自己的努力和同學(xué)的幫助下也一一克服，更加明白了一個道理，那就是要想做好一件事情，必須真正的付出才行。 本次課程設(shè)計 主要用到了 quartus 這個軟件，以前基本上沒有接觸過這個軟件，所以剛開始用的時候發(fā)現(xiàn)簡直就是一個全新的東西，后來查閱了各種參考書，在網(wǎng)上也是查閱了各種資料 然后才對 quartus 有了初步的認(rèn)識，但是用起來還是手生的很，但是我知道這也沒辦法，其實也是對我自己接受新事物的一種鍛煉，當(dāng)我不停的使用這個軟件時，才越來越發(fā)現(xiàn)這個軟件的強(qiáng)大之處，不僅僅能通過編程實現(xiàn)各種功能，還有各種芯片可供仿真時使用，對一些芯片進(jìn)行編程就可以實現(xiàn)其功能，然后進(jìn)行仿真，就可以看到實際的效果，如果不行可以進(jìn)行調(diào)試，然后再仿真直到成功為止，這樣變可以節(jié)省成本，對實際的設(shè)計制作起著參考作用，如果實際制作東西的時候發(fā)現(xiàn)有錯誤整個電路就都浪費了，這樣會對資源造成大量的浪費，而有了 quartus 這個軟件就可以避免這個問題， 把一些實驗性的東西在電腦端實現(xiàn)，直到實驗成功才去實際操作，節(jié)約成本的同時也節(jié)約了時間，總得來說， quartus對我們電路的實際設(shè)計和生產(chǎn)提供了很大的幫助，以后我要盡量多利用這個軟件，爭取熟練掌握它，為以后的工作提供便利。 剛拿到本次課程設(shè)計的題目時，感覺應(yīng)該挺簡單的， 2— 10 進(jìn)制的轉(zhuǎn)化應(yīng)該用一些芯片就可以解決了，但是當(dāng)我真正的深入進(jìn)去做的時候發(fā)現(xiàn)還是有很大的問題的，在 quartus環(huán)境下一些芯片并沒有那么好實現(xiàn)，只能每個過程每個過程的進(jìn)行編程，在此又遇到另一個問題那就是在 quartus 環(huán)境下只有兩種語言可以 使用，即 verilog 和 VHDL，但是這兩種語言對我來說也是全新的，以前從來沒有用到過的語言，所以又得從新學(xué)起，又是各種資料滿天飛，經(jīng)過一段時間之后也算終于初步了解了這門語言，雖然編程起來還是會有困難，武漢理工大學(xué)《能力拓展訓(xùn)練》課程設(shè)計說明書 14 但是總也算磕磕絆絆的編了出來，當(dāng)我把所有的程序都編完 的時候心里非常高興，以為終于可以告一段落了，但是后來編譯的時候發(fā)現(xiàn)還是有很多錯誤，然后又經(jīng)歷了漫長而且痛苦的改程序的過程，在不知道改了多少次之后程序終于算是改正確了，然后編譯完成，程序完全正確，心里的石頭終于算是落下來了，當(dāng)時的心情真是相當(dāng)舒暢，說明經(jīng)過自己 的努力后完成的事情還是很值得驕傲的。 本次課程設(shè)計過程中也是遇到了各種各樣的困難，編程時遇到困難，仿真時遇到困難，也出現(xiàn)了各種各樣的錯誤，這些困難靠自己解決實在是很有難度，所以我就不停的查資料問同學(xué)，班里也有幾個對這個軟件比較熟悉的同學(xué)，在他們的幫助下困難都給解決了，在此，也感謝幫助過我的同學(xué)，我也深刻的理解到同學(xué)之間互相幫助的重要性，團(tuán)隊合作的重要性。 在課程設(shè)計過程中，很多次都想著放棄，直接在網(wǎng)上找個抄得了，但是最后都沒有讓自己放縱，事實證明最終也作出來了，這讓我對以后人生的路也更加有信心了，讓我明白了沒 有什么事情是做不成的，只要自己肯努力什么事情都能做的成，什么事情都能完滿的完成 總的來說，這次課程設(shè)計對我的幫助是相當(dāng)大的，不僅僅是在知識上和技術(shù)上，在思想層面也是一種提升，希望學(xué)校以后多開展類似的活動，讓同學(xué)們多一些鍛煉，而不是僅僅停留在紙面上。 武漢理工大學(xué)《能力拓展訓(xùn)練》課程設(shè)計說明書 15 參考文獻(xiàn) [1]伍時和 .《數(shù)字電子技術(shù)基礎(chǔ)》 .清華大學(xué)出版社 .2020 [2]譚會生、張昌凡 .《 EDA 技術(shù)及應(yīng)用》 .西安電子科技大學(xué)出版社 .2020 [3]康華光 .《電子技術(shù)基礎(chǔ)數(shù)字部分》 .高等教育出版社 .2020 [4]王冠、黃熙 .《 verilogHDL 與數(shù)字電路設(shè)計》 .機(jī)械工業(yè)出版社 .2020 [5]張睿、趙艷華 .《基于 quartus 的 FPGA/CPLD 的設(shè)計與應(yīng)用》 .電子工業(yè)出版社 .2020
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