freepeople性欧美熟妇, 色戒完整版无删减158分钟hd, 无码精品国产vα在线观看DVD, 丰满少妇伦精品无码专区在线观看,艾栗栗与纹身男宾馆3p50分钟,国产AV片在线观看,黑人与美女高潮,18岁女RAPPERDISSSUBS,国产手机在机看影片

正文內(nèi)容

多路搶答器設(shè)計(jì)_eda課程設(shè)計(jì)(編輯修改稿)

2025-08-13 22:00 本頁面
 

【文章內(nèi)容簡(jiǎn)介】 (二)計(jì)時(shí)模塊 VHDL 源程序 library ieee。 use 。 use 。 entity js is port(clk,rst,s,stop:in std_logic。 warn:out std_logic。 ta,tb:buffer std_logic_vector(3 downto 0))。 end js。 architecture one of js is signal co:std_logic。 begin p1:process(clk,rst,s,stop,ta) begin 8 if rst=39。039。 or stop=39。139。 then ta=0000。 elsif clk39。event and clk=39。139。 then co=39。039。 if s=39。139。 then if ta=0000 then ta=1001。co=39。139。 else ta=ta1。 end if。 end if。 end if。 end process p1。 p2:process(co,rst,s,stop,tb) begin if rst=39。039。 or stop=39。139。 then tb=0010。 elsif co39。event and co=39。139。 then if s=39。139。 then if tb=0000 then tb=0011。 else tb=tb1。 end if。 end if。 end if。 end process p2。 end one。 仿真圖 9 計(jì)時(shí)模塊圖 在這個(gè)模塊中主要實(shí)現(xiàn)搶答過程中的計(jì)時(shí)功能,在有搶答開始后進(jìn)行 30 秒的倒計(jì)時(shí),并且在 30 秒倒計(jì)時(shí)后無人搶答顯示超時(shí)并報(bào)警。其中有搶答時(shí)鐘信號(hào) clk2;系統(tǒng)復(fù)位信號(hào) rst;搶答使能信號(hào) s;搶答狀態(tài)顯示信號(hào) states;無人搶答警報(bào)信號(hào) warn;計(jì)時(shí)中止信號(hào) stop;計(jì)時(shí)十位和個(gè)位信號(hào) tb, ta。 (三)數(shù)據(jù)選擇模塊 VHDL 源程序 library ieee。 use 。 use 。 use 。 entity sjxz is port (a,b,c: in std_logic_vector(3 downto 0)。 clk2,rst: in std_logic。 s: out std_logic_vector(1 downto 0)。 10 y: out std_logic_vector(3 downto 0) )。 end sjxz。 architecture body_chooser of sjxz is signal count: std_logic_vector (1 downto 0)。 begin s=count。 process(clk2,rst) begin if(rst=39。039。)then count=00。 elsif(clk239。event and clk2=39。139。)then if(count=10)then count=00。 else count=count+1。 end if。 end if。 case count is when 00=y=a。 when 01=y=b。 when 10=y=c。 when others=null。 end case。 end PROCESS。 end body_chooser。 仿真圖 11 數(shù)據(jù)選擇模塊圖 在這個(gè)模塊中主要實(shí)現(xiàn)搶答過程中的數(shù)據(jù)輸入功能,輸入信號(hào) a[3..0]、 b[3..0]、 c[3..0];計(jì)數(shù)輸出信號(hào) s;數(shù)據(jù)輸出信號(hào) y;計(jì)數(shù)脈沖 clk2,實(shí)現(xiàn) a、 b、 c 按脈沖輪流選通,在數(shù)碼管上顯示。 (四)報(bào)警模塊 VHDL 源程序 LIBRARY IEEE。 USE 。 USE 。 ENTITY ALARM IS PORT(CLK,I:IN STD_LOGIC。 Q:OUT STD_LOGIC)。 END ALARM。 12 ARCHITECTURE BEHAVE OF ALARM IS SIGNAL WARN:STD_LOGIC。 SIGNAL N:INTEGER RANGE 0 TO 20。 BEGIN Q= WARN。 PROCESS(CLK) BEGIN IF CLK39。EVENT AND CLK=39。139。 THEN
點(diǎn)擊復(fù)制文檔內(nèi)容
研究報(bào)告相關(guān)推薦
文庫吧 www.dybbs8.com
備案圖片鄂ICP備17016276號(hào)-1