【正文】 % Mz849Gx^Gj qv^$UE9wEwZQcUE%amp。 ksv*3t nGK8! z8vGt YM*Jgamp。 ksv*3t nGK8! z89Am YWpazadNuKNamp。MuW FA5uxY7JnD6YWRrWwc^vR9CpbK!zn% Mz849Gx^G89Am UE9aQGn8xp$Ramp。 ksv*3t nGK8! z8vGt YM*Jgamp。 ksv*3t nGK8! z89Am YWpazadNuKNamp。 ksv*3tnGK8! z89Am UE9aQGn8xp$Ramp。 ksv*3t nGK8! z89Am YWpazadNuKNamp。 UE9aQGn8xp$Ramp。硬件平臺選用 Altera公司的 Cyclone II 系列 EP2C35F672C6 芯片可編程邏輯器件，利用 ADV7123 實現(xiàn)了數(shù)模轉(zhuǎn)換，通過硬件描述語言 Verilog HDL 對 VGA 行、場掃描時序，利用Quartus II 軟件自帶的宏功能模塊得到 VGA 需用時鐘，并實現(xiàn)整個設(shè)計的編譯、仿真、 測試，實現(xiàn)了在顯示器上輸出 條紋 的設(shè)計目的。//判斷橫坐標是否大于消隱值，若大于則根據(jù)等式賦值給 X，否則置 0 else X = 0。b1。 本設(shè)計 利用 Quartus II 自帶的宏功能鎖相環(huán) PLL 產(chǎn)生分頻器 ，并 在頂層模塊例化。這些電路組合能最高支持 16001200100MHz 的分辨率。其結(jié)構(gòu)如圖 所示。 Quartus II 的使用 Quartus II 開發(fā)流程如圖 所示。需要進行處理器和 I/O 接口實驗時，也有標準 MIC、 linein、 lineout 接口（ 24 位音頻解編碼器）， videoin(TV Decoder)和 VGA(10bit DAC)； DE2 還提供了 接口（包括主、從 USB）， 10/100M 自適應(yīng)以太網(wǎng)，紅外（ IRDA）接口，以及 SD 卡接口。 圖 VGA 行掃描時序 場掃描從屏幕最上端一行開始，從上到下進行掃描。 VGA 顯示采用逐行掃描方式。 VGA 接口是顯卡上應(yīng)用最為廣泛的接口類型，多數(shù)的顯卡都帶有此種接口。當需要修改 FPGA 功能時，只需換一片 EPROM即可。 4） FPGA 是 ASIC 電路 中設(shè)計周期最短、開發(fā)費用最低、風險最小的器件之一。它是作為 ASIC（ Application Specific Integrated Circuit， 專用集成電路）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 基本特點 1）采用 FPGA 設(shè)計 ASIC 電路（專用集成電路） ，用戶不需要投片生產(chǎn)，就能得到合用 的芯片 。 加電時， FPGA 芯片 將 EPROM 中數(shù)據(jù)讀入片內(nèi)編程 RAM 中，配置完成后，F(xiàn)PGA 進入工作狀態(tài) 。其中，除了 2 根 NC（ Not Connect） 信號、3 根顯示數(shù)據(jù)總線和 5 個 GND 信號，比較重要的是 3 根 RGB 彩色分量信號和 2根掃描同步信號 HSYNC 和 VSYNC 針。 要實現(xiàn) VGA 顯示就要解決數(shù)據(jù)來源、 數(shù)據(jù)存儲 、時序?qū)崿F(xiàn)等問題，其中關(guān)鍵還是如何實現(xiàn) VGA 時序。 行掃描從每一行的左邊開始，采用的時鐘為 25MHz,每一個時鐘周期，對應(yīng)該行上的一個像素點。 DE2 開發(fā)板是以 Cyclone II 2C35FPGA 為特點的 672 針引腳的包裝。 Cyclone II 系列的 EP2C35F672C6 芯片，它具有 672 個引腳，其中 475 個 I/O 通信口。 4 設(shè)計實現(xiàn) 本次 設(shè)計采用 VGA 的工作標準（ 64048060Hz）模式，對應(yīng)的時鐘頻率（ Clock Frequency）為 （ 像素輸出頻率 ） ；行頻（ Line Frequency）為31946Hz；場頻（ Field Frequency）為 (每秒圖像刷新頻率 )，設(shè)計 VGA顯示控制器時，并需要嚴格遵循 “VGA工業(yè)標準 ”，否則會損壞 VGA 顯示器 。 圖 VGA 電路原 理圖 DE2 開發(fā)板包括一個 15 針的 VGA 輸出的 DSUB 連接器。本設(shè)計的目標是：運用 Verilog HDL 實現(xiàn)通過 VGA 接口使圖形和文字在顯示器上的顯示。 VGA_HS = 0。 //判斷顯示前沿是否結(jié)束，若是則行頻率置 0 if(H_Cont==H_FRONT+H_SYNC1) //Sync pulse end VGA_HS = 139。當按下電鍵 SW[0]時，顯示器上的顯示（ 紅綠藍條紋 ）如圖 所示。 內(nèi)部資料 請勿外傳 9JWKf wvGt YM*Jgamp。MuWFA5uxY7JnD6YWRr Wwc^vR9CpbK!zn%Mz849Gx^Gj qv^$UE9wEwZQcUE% amp。MuWFA5uxY7JnD6YWRr Wwc^vR9CpbK! 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