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正文內(nèi)容

課程設計-基于cpld的交通燈設計-文庫吧資料

2024-11-18 09:27本頁面
  

【正文】 控制模塊 源代碼 A LIBRARY IEEE。 END PROCESS。139。039。 END PROCESS。 END IF。 END IF。)THEN IF(bcd1n=0)THEN IF(vcd10n=0)THEN vcd10n=0000。EVENT AND CLK=39。139。)THEN vcd10n=0001。 PROCESS (clk,cr) BEGIN IF(cr=39。 q1=bcd1n。 END IF。 END IF。 ELSIF(bcd1n=0 and vcd10n=0)THEN bcd1n=0000。139。)THEN IF(CLK39。 ELSIF(EN5=39。J1=39。039。 SIGNAL vcd10n:STD_LOGIC_VECTOR(3 DOWNTO 0)。 END djs15。 q1:OUT STD_LOGIC_VECTOR(3 DOWNTO 0)。 EN5:IN STD_LOGIC。 ENTITY djs15 IS PORT (clk:IN STD_LOGIC。 USE 。 END 。 END IF。 IF(bcd1n=0 and vcd10n=0)THEN J4=39。 PROCESS(bcd1n,vcd10n) BEGIN J4=39。 END IF。 END IF。 ELSE vcd10n=vcd10n1。139。)THEN IF(CLK39。 ELSIF(EN4=39。J1=39。039。 y10=vcd10n。 END PROCESS。 END IF。 ELSE bcd1n=bcd1n1。)THEN IF(bcd1n=0 and vcd10n/=0)THEN bcd1n=1001。EVENT AND CLK=39。139。139。)THEN bcd1n=0000。 BEGIN PROCESS(clk,cr) BEGIN IF(cr=39。 ARCHITECTURE a OF djs30 IS SIGNAL bcd1n:STD_LOGIC_VECTOR(3 DOWNTO 0)。 y10:OUT STD_LOGIC_VECTOR(3 DOWNTO 0))。 J4:OUT STD_LOGIC。 cr:IN STD_LOGIC。 USE 。 元件圖 ( 20 秒倒計時計數(shù)器元件圖) 仿真圖 ( 20s 倒計時計數(shù)器仿真圖) 電路圖 ( 20秒倒計時計數(shù)器 RTL 電路圖) 30 秒倒計時計數(shù)器 源代碼 LIBRARY IEEE。 END PROCESS。139。039。 END PROCESS。 END IF。 END IF。)THEN IF(bcd1n=0)THEN IF(vcd10n=0)THEN vcd10n=0000。EVENT AND CLK=39。139。)THEN vcd10n=0010。 PROCESS(clk,cr) BEGIN IF(cr=39。 q1=bcd1n。 END IF。 END IF。 ELSIF(bcd1n=0 and vcd10n=0)THEN bcd1n=0000。139。)THEN IF(CLK39。 ELSIF(EN3=39。J1=39。039。 SIGNAL vcd10n:STD_LOGIC_VECTOR(3 DOWNTO 0)。 END djs20。 q1:OUT STD_LOGIC_VECTOR(3 DOWNTO 0)。 EN3:IN STD_LOGIC。 ENTITY djs20 IS PORT (clk:IN STD_LOGIC。 USE 。 END。 END IF。 IF(bcd1n=0 and vcd10n=0)THEN J1=39。 PROCESS(bcd1n,vcd10n) BEGIN J1=39。 END IF。 END IF。 ELSE vcd10n=vcd10n1。139。)THEN IF(CLK39。 ELSIF (EN1=39。039。 y10=vcd10n。 END PROCESS。 END IF。 ELSE bcd1n=bcd1n1。)THEN IF(bcd1n=0 and vcd10n/=0)THEN bcd1n=1001。EVENT AND CLK=39。139。)THEN bcd1n=0101。 BEGIN PROCESS(clk,cr) BEGIN IF(cr=39。 ARCHITECTURE a OF djs25 IS SIGNAL bcd1n: STD_LOGIC_VECTOR(3 DOWNTO 0)。 y10:OUT STD_LOGIC_VECTOR(3 DOWNTO 0))。 J1:OUT STD_LOGIC。 cr:IN STD_LOGIC。 USE 。 元件圖 ( 5 秒倒計時計數(shù)器元件圖) 仿真圖 ( 5 秒倒計時計數(shù)器仿真圖) 電路圖 ( 5 秒倒計時計數(shù)器 RTL 電路圖) 流程圖 ( 5 秒倒計時計數(shù)器的流程圖) 開始 定義參數(shù) 清零端 cr=0? 使能端 EN2=1 輸入端信號 Bcd1n=Bcd1n1 Bcd1n=0? J2=1 結束 恢復初始值 Y N Y N 25 秒倒計時計數(shù)器 源代碼 LIBRARY IEEE。 END PROCESS。139。039。 q1=bcd1n。 END IF。 END IF。)THEN IF(bcd1n
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