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正文內(nèi)容

基于fpga的交通燈控制課程設(shè)計(jì)報(bào)告-文庫吧資料

2025-03-29 06:33本頁面
  

【正文】 lk_out,clk_in)。default:state=539。b10100:led=839。b00001010。539。b10010:led=839。b00001010。539。b10000:led=839。b00001100。 539。b01110:led=839。b00001100。539。b01100:led=839。b00001100。539。b01010:led=839。b00010001。539。b01000:led=839。b00010001。539。b00110:led=839。b00100001。539。b00100:led=839。b00100001。539。b00010:led=839。b00100001。539。b00000:led=839。b00001。 reg[4:0]state。 output[7:0]led。(3)引腳分配:交通燈設(shè)計(jì)的內(nèi)容主程序module jtd(clk,led)。c. 要求南北方向紅燈亮5秒,同時(shí)東西方向綠燈亮3秒,綠燈結(jié)束后,東西方向黃燈亮2秒。(1)系統(tǒng)功能:實(shí)現(xiàn)十字路口的交通燈顯示。(3)了解VerilogHDL語言設(shè)計(jì)或原理圖
點(diǎn)擊復(fù)制文檔內(nèi)容
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