硬件描述語(yǔ)言-資料下載頁(yè)
2024-10-04 19:02本頁(yè)面
【正文】 declarations CP, OE, S, T pin。 Q3,Q2,Q1,Q0 pin istype 39。reg,buffer39。 set definitions Q = [Q3,Q2,Q1,Q0]。 A = [0, 0, 0, 0]。 B = [0, 0, 0, 1]。 C= [0, 0, 1, 0]。 D = [0, 0, 1, 1]。 E = [0, 1, 0, 0]。 F = [0, 1, 0, 1]。 G = [0, 1, 1, 0]。 H = [0, 1, 1, 1]。 I = [1, 0, 0, 0]。 J = [1, 0, 0, 1]。 K = [1, 0, 1, 0]。 L = [1, 0, 1, 1]。 M = [1, 1, 0, 0]。 N = [1, 1, 0, 1]。 O = [1, 1, 1, 0]。 P= [1, 1, 1, 1]。 輸入輸出信號(hào)定義 計(jì)數(shù)器狀態(tài)定義 狀態(tài)圖段 邏輯方程段 equations [Q3,Q2,Q1,Q0].CLK = CP。 [Q3,Q2,Q1,Q0].OE = !OE。 state_diagram Q state A: goto B。 state B: goto C。 state C: goto D。 state D: goto E。 state E: if (!S amp。 T) then A else F。 state F: goto G。 state G: goto H。 state H: goto I。 state I: goto J。 state J: if (S amp。 !T) then A else K。 state K: goto L。 state L: goto A。 state M: goto O。 state O: goto P。 state P: goto A。 end 四、 ABELHDL語(yǔ)言電路設(shè)計(jì)舉例 例 1 存儲(chǔ)器地址譯碼器的設(shè)計(jì) 存儲(chǔ)器段 地址范圍 (HEX) DRAM IO ROM2 ROM1 0000~DFFF E000~E7FF F000~F7FF F800~FFFF 地址譯碼器的設(shè)計(jì)是 PLD的典型應(yīng)用之一。 存儲(chǔ)器地址譯碼器框圖 module decode title 39。memory decode39。 A15,A14,A13,A12,A11,A10 pin。 ROM1,IO,ROM2,DRAM pin istype 39。39。 H,L,X = 1,0,.X.。 Address = [A15,A14,A13,A12, A11,A10,X,X, X,X,X,X, X,X,X,X]。 equations !DRAM = (Address = ^hDFFF)。 !IO = (Address = ^hE000) amp。 (Address = ^hE7FF)。 !ROM2 = (Address = ^hF000) amp。 (Address = ^hF7FF)。 !ROM1 = (Address = ^hF800)。 test_vectors (Address [ROM1,ROM2,IO,DRAM]) ^h0000 [ H, H, H, L ]。 ^h4000 [ H, H, H, L ]。 ^h8000 [ H, H, H, L ]。 ^hC000 [ H, H, H, L ]。 ^hE000 [ H, H, L, H ]。 ^hE800 [ H, H, H, H ]。 ^hF000 [ H, L, H, H ]。 ^hF800 [ L, H, H, H ]。 end 例 2 4位二進(jìn)制數(shù) /8421BCD碼的碼變換電路的設(shè)計(jì)。 MODULE ICSN16 TITLE 39。B_8421BCD39。 B3,B2,B1,B0 PIN 。 D10,D03,D02,D01,D00 PIN ISTYPE 39。COM39。 H,L,X=1,0,.X.。 TRUTH_TABLE ([B3,B2,B1,B0][D10,D03,D02,D01,D00]) [0,0,0,0][0,0,0,0,0]。 [0,0,0,1][0,0,0,0,1]。 [0,0,1,0][0,0,0,1,0]。 [0,0,1,1][0,0,0,1,1]。 [0,1,0,0][0,0,1,0,0]。 [0,1,0,1][0,0,1,0,1]。 [0,1,1,0][0,0,1,1,0]。 [0,1,1,1][0,0,1,1,1]。 [1,0,0,0][0,1,0,0,0]。 [1,0,0,1][0,1,0,0,1]。 [1,0,1,0][1,0,0,0,0]。 [1,0,1,1][1,0,0,0,1]。 [1,1,0,0][1,0,0,1,0]。 [1,1,0,1][1,0,0,1,1]。 [1,1,1,0][1,0,1,0,0]。 [1,1,1,1][1,0,1,0,1]。 END end
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