【正文】 已經(jīng)定義的,此功能實現(xiàn)了歷史狀況的趨勢再現(xiàn)。 電池組電壓歷史趨勢曲線系統(tǒng)報表畫面設計在空氣環(huán)境監(jiān)測系統(tǒng)中,對氮氧化合物，二氧化硫，二氧化碳，硫化氫參數(shù)的記錄和保存是非常重要的,可用于事后數(shù)據(jù)的查詢和分析。這里利用組態(tài)王提供的SOL 訪問功能,結合MS ACCESS,可以實現(xiàn)微機測控系統(tǒng)或數(shù)據(jù)采集系統(tǒng)中的毫秒級數(shù)據(jù)保存功能。組態(tài)王提供了豐富的報表函數(shù),能制成實時報表和歷史報表,表頭信息利用編輯框輸入,下拉菜單通過程序定義,數(shù)據(jù)包括當時的或某一歷史時間間隔內(nèi)的氮氧化合物，二氧化硫，二氧化碳，硫化氫參數(shù),可以實現(xiàn)歷史數(shù)據(jù)查詢,實時報表和歷史報表的保存、打印等功能。 系統(tǒng)報表顯示、編輯、打印窗口配置系統(tǒng)用戶畫面設計配置系統(tǒng)用戶畫面是用來管理用戶信息的, 用戶以什么樣的身份登陸, 則對應相應的操作權限, 管理員可以添加和刪除用戶, 并且可以同時確定此用戶的操作和瀏覽權限。圖 配置系統(tǒng)用戶畫面 本章小結本章介紹了化工區(qū)環(huán)境監(jiān)測系統(tǒng)的總體軟件設計思想，為實現(xiàn)各個功能展開相應的軟件設計。首先，對軟件開發(fā)環(huán)境做了簡要介紹，針對軟件要實現(xiàn)的功能進行了分析，之后分別圍繞網(wǎng)關節(jié)點、路由設備、終端設備進行了軟件設計，保證了傳輸數(shù)據(jù)的準確性、可靠性、快速性。在對上位機監(jiān)控軟件設計中，本文采用組態(tài)王來實現(xiàn)對其的開發(fā)環(huán)境設計，并詳細介紹了上位機監(jiān)控軟件開發(fā)的步驟，最后針對上位機監(jiān)控界面作了軟件設計，從而實現(xiàn)了上位機的實時監(jiān)控任務。第五章 工作總結本文以基于無線傳感器網(wǎng)絡的化工區(qū)環(huán)境監(jiān)測系統(tǒng)的研究為選題，旨在解決目前在化工區(qū)環(huán)境污染問題，彌補當前化工區(qū)環(huán)境監(jiān)測的缺陷，實現(xiàn)對化工區(qū)環(huán)境的實時監(jiān)測。在開展課題的最初幾個月里，我們小組成員查閱了國內(nèi)外相關的文獻資料，學習研究了無線傳感器網(wǎng)絡應用在監(jiān)測系統(tǒng)的設計思想和實現(xiàn)方案，又在根據(jù)我國目前的環(huán)境現(xiàn)狀，在環(huán)境監(jiān)測方面的不足，實地考察化工區(qū)的生產(chǎn)情況的基礎上，我們提出了基礎無線傳感器網(wǎng)絡的化工區(qū)環(huán)境監(jiān)測系統(tǒng)的設計思想。本文所作的工作如下:(l)在無線傳感器網(wǎng)絡體系結構的基礎上，設計出適合本系統(tǒng)的網(wǎng)絡體系結構；(2)設計并實現(xiàn)了本系統(tǒng)傳感器節(jié)點和網(wǎng)關節(jié)點的硬件電路；(3)對本系統(tǒng)的傳輸協(xié)議進行了設計，實現(xiàn)兩種不同的無線通信方式，加大數(shù)據(jù)傳輸距離，保證了數(shù)據(jù)的安全、可靠、快速等特點；(4)在基站的監(jiān)測平臺上對采集到的數(shù)據(jù)進行比較分析，并得出數(shù)據(jù)是否超標，那種污染氣體超標及其超標量的大小等相關結論。盡管在化工區(qū)環(huán)境監(jiān)測系統(tǒng)的研究和開發(fā)上，我們已經(jīng)做了較多的工作，但是由時間倉促、知識儲備有限等原因，使系統(tǒng)從硬件設計到軟件開發(fā)上都還存在一些可以改進的地方。同時，隨著計算機技術、電子信息技術以及無線傳感器網(wǎng)絡技術的發(fā)展，本系統(tǒng)還有許多可改進和完善的空間。后續(xù)研究工作可以從以下三個方面深入:(l)基站監(jiān)控中心的結構設計還需要進一步的完善，實現(xiàn)更多的功能，以便化工區(qū)環(huán)境監(jiān)測系統(tǒng)能夠方便的推廣應用，滿足各種環(huán)境下的實際監(jiān)測需要；(2)對通信協(xié)議進行更深一步的研究，提高通信質(zhì)量；(3)對開發(fā)節(jié)點的功能進行優(yōu)化，提高節(jié)點的性能比。參考文獻[1] 孫利民,李建中,陳渝,等. 無線傳感器網(wǎng)絡[M].北京:清華大學出版社, 2005: 279287.[2] [J].北京:計算機研究與發(fā)展,2005,42(l):163174.[3] (美) Gene F. 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Must be connected to solid ground plane1VCO_GUARDPower (analog)Connection of guard ring for VCO (to AVDD) shielding2AVDD_VCOPower (analog) V Power supply for VCO3AVDD_PREPower (analog) V Power supply for Prescaler4AVDD_RF1Power (analog) V Power supply for RF frontend5GNDGround (analog)Grounded pin for RF shielding6RF_PRF I/OPositive RF input/output signal to LNA/from PA in receive/transmit mode7TXRX_SWITCHPower (analog)Common supply connection for integrated RF frontend. Must be connected to RF_P and RF_N externally through a DC path8RF_NRF I/ONegative RF input/output signal to LNA/from PA in receive/transmit mode9GNDGround (analog)Grounded pin for RF shielding10AVDD_SWPower (analog) V Power supply for LNA / PA switch11NCNot Connect12NCNot Connect13NCNot Connect14AVDD_RF2Power (analog) V Power supply for receive and transmit mixers15AVDD_IF2Power (analog) V Power supply for transmit / receive IF chain16NCNot Connect17AVDD_ADCPower (analog) V Power supply for analog parts of ADCs and DACs18DVDD_ADCPower (digital) V Power supply for digital parts of receive ADCs19DGND_GUARDGround (digital)Ground connection for digital noise isolation20DGUARDPower (digital) V Power supply connection for digital noise isolation21RESETnDigital InputAsynchronous, active low digital reset22DGNDGround (digital)Ground connection for digital core and pads23DSUB_PADSGround (digital)Substrate connection for digital pads24DSUB_COREGround (digital)Substrate connection for digital modules25Power (digital) V Power supply for digital I/Os26Power (digital) V Power supply for digital core27SFDDigital outputSFD (Start of Frame Delimiter) / digital mux output28CCADigital outputCCA (Clear Channel Assessment) / digital mux output29FIFOPDigital outputHigh when number of bytes in FIFO exceeds threshold / serial RF clock output in test mode30FIFODigital I/OHigh when data in FIFO / serial RF data input / output in test mode31CSnDigital inputSPI Chip select, active low32SCLKDigital inputSPI Clock input, up to 10 MHz33SIDigital inputSPI Slave Input. Sampled on the positive edge of SCLK34SODigital output (tristate)SPI Slave Output. Updated on the negative edge of SCLK. Tristate when CSn high.35DVDD_RAMPower (digital) V Power supply for digital RAM36NCNot Connect37AVDD_XOSC16Power (analog) V crystal oscillator power supply38XOSC16_Q2Analog I/O16 MHz Crystal oscillator pin 239XOSC16_Q1Analog I/O16 MHz Crystal oscillator pin 1 or external clock input40NCNot Connect41VREG_ENDigital inputVoltage regulator enable, active high, held at VREG_IN voltage level when act