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正文內(nèi)容

數(shù)電知識點匯總(編輯修改稿)

2024-11-15 22:15 本頁面
 

【文章內(nèi)容簡介】 電路知識要點一、三極管開、關(guān)狀態(tài)飽和、截止條件:截止:,飽和:反相器飽和、截止判斷二、基本門電路及其邏輯符號與門、或非門、非門、與非門、OC門、三態(tài)門、異或;傳輸門、OC/OD門及三態(tài)門的應(yīng)用三、門電路的外特性輸入端電阻特性:對TTL門電路而言,輸入端通過電阻接地或低電平時,由于輸入電流流過該電阻,會在電阻上產(chǎn)生壓降,當(dāng)電阻大于開門電阻時,相當(dāng)于邏輯高電平。習(xí)題27以下內(nèi)容了解輸入短路電流IIS輸入端接地時的輸入電流叫做輸入短路電流IIS。輸入高電平漏電流IIH輸入端接高電平時輸入電流輸出高電平負(fù)載電流IOH輸出低電平負(fù)載電流IOL扇出系數(shù)NO一個門電路驅(qū)動同類門的最大數(shù)目第三章組合邏輯電路知識要點一、組合邏輯電路:任意時刻的輸出僅僅取決于該時刻的輸入,與電路原來的狀態(tài)無關(guān)二、組合邏輯電路的分析方法(按步驟解題)三、若干常用組合邏輯電路譯碼器(74LS138)全加器(真值表分析)數(shù)選器(74151和74153)四、組合邏輯電路設(shè)計方法(按步驟解題)用門電路設(shè)計用譯碼器、數(shù)據(jù)選擇器實現(xiàn)試設(shè)計一個三位多數(shù)表決電路用與非門實現(xiàn)用譯碼器74LS138實現(xiàn)用雙4選1數(shù)據(jù)選擇器74LS153解:設(shè)A、B、C為三個輸入變量,Y為輸出變量。邏輯1表示同意,邏輯0表示不同意,輸出變量Y=1表示事件成立,邏輯0表示事件不成立。:函數(shù)Y的與非—與非表達(dá)式為:邏輯圖如下:—8譯碼器74LS138實現(xiàn)由于74LS138為低電平譯碼,故有由真值表得出Y的最小項表示法為:用74LS138實現(xiàn)的邏輯圖如下:74LS153內(nèi)含二片雙4選1數(shù)據(jù)選擇器,由于該函數(shù)Y是三變量函數(shù),故只需用一個4選1即可,如果是4變量函數(shù),則需將二個4選1級連后才能實現(xiàn)74LS153輸出Y1的邏輯函數(shù)表達(dá)式為:三變量多數(shù)表決電路Y輸出函數(shù)為:令A(yù)=A1,B=A0,C用D10~D13表示,則∴D10=0,D11=C,D12=C,D13=1邏輯圖如下:注:實驗中1位二進(jìn)制全加器設(shè)計:用138或153如何實現(xiàn)?1位二進(jìn)制全減器呢?第四章觸發(fā)器知識要點一、觸發(fā)器:能儲存一位二進(jìn)制信號的單元二、各類觸發(fā)器框圖、功能表和特性方程RS:SR=0JK:D:T:T':三、各類觸發(fā)器動作特點及波形圖畫法基本RS觸發(fā)器:SD、RD每一變化對輸出均產(chǎn)生影響時鐘控制RS觸發(fā)器:在CP高電平期間R、S變化對輸出有影響主從JK觸發(fā)器:在CP=1期間,主觸發(fā)器狀態(tài)隨R、S變化。CP下降沿,從觸發(fā)器按主觸發(fā)器狀態(tài)翻轉(zhuǎn)。在CP=1期間,JK狀態(tài)應(yīng)保持不變,否則會產(chǎn)生一次狀態(tài)變化。T'觸發(fā)器:Q是CP的二分頻邊沿觸發(fā)器:觸發(fā)器的次態(tài)僅取決于CP(上升沿/下降沿)到達(dá)時輸入信號狀態(tài)。四、觸發(fā)器轉(zhuǎn)換D觸發(fā)器和JK觸發(fā)器轉(zhuǎn)換成T和T’觸發(fā)器第五章時序邏輯電路知識要點一、時序邏輯電路的組成特點:任一時刻的輸出信號不僅取決于該時刻的輸入信號,還和電路原狀態(tài)有關(guān)。時序邏輯電路由組合邏輯電路和存儲電路組成。二、同步時序邏輯電路的分析方法(按步驟解題)邏輯圖→寫出驅(qū)動方程→寫出狀態(tài)方程→寫出輸出方程→畫出狀態(tài)轉(zhuǎn)換圖(詳見例51)三、典型時序邏輯電路。T0=1T1=Q0Ti=Qi1Qi2Q1Q04位同步二進(jìn)制計數(shù)器74LS161:異步清0(低電平),同步置數(shù),CP上升沿計數(shù),功能表4位同步十進(jìn)制計數(shù)器74LS160:同74LS161同步十六進(jìn)制加/減計數(shù)器74LS191:無清0端,只有異步預(yù)置端,功能表雙時鐘同步十六進(jìn)制加減計數(shù)器74LS193:有二個時鐘CPU,CPD,異步置0(H),異步預(yù)置(L)四、時序邏輯電路的設(shè)計(按步驟解題)1.用觸發(fā)器組成同步計數(shù)器的設(shè)計方法及設(shè)計步驟(例53)邏輯抽象→狀態(tài)轉(zhuǎn)換圖→畫出次態(tài)以及各輸出的卡諾圖→利用卡諾圖求狀態(tài)方程和驅(qū)動方程、輸出方程→檢查自啟動(如不能自啟動則應(yīng)修改邏輯)→畫邏輯圖2.用集成計數(shù)器組成任意進(jìn)制計數(shù)器的方法置0法:如果集成計數(shù)器有清零端,則可控制清零端來改變計數(shù)長度。如果是異步清零端,則N進(jìn)制計數(shù)器可用第N個狀態(tài)譯碼產(chǎn)生控制信號控制清零端,如果是同步清零,則用第N1個狀態(tài)譯碼產(chǎn)生控制信號,產(chǎn)生控制信號時應(yīng)注意清零端時高電平還是低電平。置數(shù)法:控制預(yù)置端來改變計數(shù)長度。如果異步預(yù)置,則用第N個狀態(tài)譯碼產(chǎn)生控制信號如果同步預(yù)置,則用第N1個狀態(tài)譯碼產(chǎn)生控制信號,也應(yīng)注意預(yù)置端是高電平還是低電平。兩片間進(jìn)位信號產(chǎn)生:有串行進(jìn)位和并行進(jìn)位二種方法詳見例55至58第六章可編程邏輯器件知識要點一、半導(dǎo)體存儲器的分類及功能(了解)從功能上分二、半導(dǎo)體存儲器結(jié)構(gòu)(了解)ROM、RAM結(jié)構(gòu)框圖以及兩者差異三、RAM存儲器容量擴(kuò)展位擴(kuò)展:增加數(shù)據(jù)位數(shù)字?jǐn)U展:增加存儲單元第八章脈沖波形產(chǎn)生和整形知識要點重點:555電路及其應(yīng)用一、用555組成多諧振蕩器:充電:(R1+R2)C放電:R2C周期:T=(R1+2R2)Cln2占空比:二、用555電路組成施密特觸發(fā)器,回差、三、用555電路組成單穩(wěn)電路穩(wěn)態(tài)時VO=0。Vi2有負(fù)脈沖觸發(fā)時VO=1。第九章數(shù)模和模數(shù)轉(zhuǎn)換知識要點一、D/A轉(zhuǎn)換器D/A轉(zhuǎn)換器的一般形式為:VO=KDi,K為比例系數(shù),Di為輸入的二進(jìn)制數(shù),D/A轉(zhuǎn)換器的電路結(jié)構(gòu)主要看有權(quán)電阻、權(quán)電流、權(quán)電容以及開關(guān)樹型D/A轉(zhuǎn)換器。權(quán)電阻及倒T型電阻網(wǎng)絡(luò)D/A轉(zhuǎn)換器輸出電壓和輸入二進(jìn)制數(shù)之間關(guān)系的推導(dǎo)過程。二、A/D轉(zhuǎn)換器轉(zhuǎn)換器基本原理取樣定理:為保證取樣后的信號不失真恢復(fù)變量信號,設(shè)采樣頻率為,原信號最高頻率為,則。A/D轉(zhuǎn)換器過程:采樣、保持、量化、編碼轉(zhuǎn)換器的工作原理逐次逼近型A/D轉(zhuǎn)換器原理計數(shù)型A/D轉(zhuǎn)換器原理第四篇:數(shù)電課程設(shè)計數(shù)電課程設(shè)計一、課程性質(zhì)數(shù)字電路與邏輯設(shè)計課程實訓(xùn)是同學(xué)們進(jìn)入電子設(shè)計領(lǐng)域的入門課程之一,認(rèn)真仔細(xì)完成本次課程的設(shè)計內(nèi)容可為今后復(fù)雜電路的設(shè)計和制作打下良好的基礎(chǔ)。二、設(shè)計要求根據(jù)附錄所示的相關(guān)內(nèi)容,自選其一,進(jìn)行制作;使用熱轉(zhuǎn)印法進(jìn)行制作,在制作PCB時將學(xué)號印刷在bottom層;設(shè)計作品不局限于附錄所示內(nèi)容,如果自己有設(shè)計項目,可以自行購買器件并完成設(shè)計和制作;需使用仿真軟件進(jìn)行功能仿真后,再進(jìn)行PCB的設(shè)計和制作;課程結(jié)束后,須提交設(shè)計報告1份、電路仿真文件1份、PCB設(shè)計文件1份和最后設(shè)計成品板1份。三、器件說明核心器件為NE555芯片,學(xué)院提供1塊,如有損壞,自行購買;學(xué)院可提供人均1份的熱轉(zhuǎn)印紙和單面覆銅板,超出部分,自行購買;其他小型器件如電阻、電容等,自行解決。附錄:555電路運(yùn)用大全利用555時基集成電路
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