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正文內(nèi)容

在系統(tǒng)可編程技術(shù)多媒體教學(xué)系統(tǒng)(編輯修改稿)

2025-03-07 11:24 本頁面
 

【文章內(nèi)容簡介】 用并行工程( Concurrent Engineering)的設(shè)計(jì)方式,這種設(shè)計(jì)方式的核心是在設(shè)計(jì)階段就對(duì)設(shè)計(jì)對(duì)象(產(chǎn)品)具有全面的可預(yù)見性,它要求設(shè)計(jì)者從一開始就要考慮所設(shè)計(jì)產(chǎn)品的質(zhì)量、成本、開發(fā)周期、用戶需求和市場(chǎng)占有周期等綜合因素。 ②、采用自頂而下 (TopDown)層次化的設(shè)計(jì)方式,設(shè)計(jì)者從系統(tǒng)總體入手,進(jìn)行系統(tǒng)的行為或功能的劃分、描述和驗(yàn)證。這時(shí)設(shè)計(jì)已不再受通用器件的限制,設(shè)計(jì)者的精力主要集中在對(duì)所開發(fā)電子產(chǎn)品的準(zhǔn)確定義上,現(xiàn)在普遍采用高級(jí)語言對(duì)系統(tǒng)進(jìn)行描述和定義,如VHDL語言( VeryHighSpeedIC Hardware Description Language:超高速集成電路硬件描述語言),然后由 EDA系統(tǒng)去完成電子產(chǎn)品的系統(tǒng)級(jí)至物理級(jí)的設(shè)計(jì),并進(jìn)行系統(tǒng)級(jí)的仿真和綜合。以上兩種設(shè)計(jì)方式使設(shè)計(jì)者始終可以在系統(tǒng)層次上把握設(shè)計(jì)的全過程,這一點(diǎn)對(duì)ASIC的設(shè)計(jì)尤為重要。 ? 在設(shè)計(jì)工作環(huán)境方面 : EDA工具是一個(gè)開放式的完整的集成設(shè)計(jì)環(huán)境 , 一般而言 , 同一個(gè) EDA集成開發(fā)環(huán)境至少應(yīng)包括電氣原理圖與硬件描述語言輸入 、 自動(dòng)布局布線 PCB設(shè)計(jì) 、 混合型電路仿真 、 PLD設(shè)計(jì)與下載等功能 。 不同的 EDA工具之間應(yīng)該具有良好的接口特性 , 從而能夠資源共享 。 1. 電子線路 CAD是 EDA發(fā)展的初級(jí)階段( 60年代中期 ~80年代初)。 2. 電子線路 CAE ( ComputerAided Engineering:計(jì)算機(jī)輔助工程)是 EDA發(fā)展的中級(jí)階段( 80年代初 ~90年代初)。 3. ESDA ( Electronic System Design Automation:電子系統(tǒng)設(shè)計(jì)自動(dòng)化)是 EDA發(fā)展的高級(jí)階段( 90年代以來)。 本課程結(jié)合 Lattice公司的 ispLSI 1016芯片主要講解 DATA IO公司的Synario設(shè)計(jì)軟件和
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