基于vhdl的fpga串口通信(編輯修改稿)
2024-07-23 12:16 本頁面
【文章內(nèi)容簡介】 ROCESS(div8_tras_reg) BEGIN IF (div8_tras_reg = 111) THEN clkbaud_tras = 39。139。 在第7個(gè)時(shí)隙，發(fā)送使能信號(hào)有效，將數(shù)據(jù)發(fā)出 ELSE clkbaud_tras = 39。039。 END IF。 END PROCESS。 PROCESS(clkbaud8x,rst) BEGIN IF (NOT rst = 39。139。) THEN txd_reg = 39。139。 trasstart = 39。039。 txd_buf = 00000000。 state_tras = 0000。 send_state = 000。 key_entry2 = 39。039。 ELSE IF(clkbaud8x39。EVENT AND clkbaud8x = 39。139。) THEN IF (NOT key_entry2 = 39。139。) THEN IF (key_entry1 = 39。139。) THEN key_entry2 = 39。139。 txd_buf = 01110111。 w END IF。 ELSE CASE state_tras IS WHEN 0000 = 發(fā)送起始位 IF ((NOT trasstart=39。139。) AND (send_state 111) ) THEN trasstart = 39。139。 ELSE IF (send_state 111) THEN IF (clkbaud_tras = 39。139。) THEN txd_reg = 39。039。 state_tras = state_tras + 0001。 END IF。 ELSE key_entry2 = 39。039。 state_tras = 0000。 END IF。 END IF。 WHEN 0001 = 發(fā)送第1位 IF (clkbaud_tras = 39。139。) THEN txd_reg = txd_buf(0)。 txd_buf(6 DOWNTO 0) = txd_buf(7 DOWNTO 1)。 state_tras = state_tras + 0001。 END IF。 WHEN 0010 = 發(fā)送第2位 IF (clkbaud_tras = 39。139。) THEN txd_reg = txd_buf(0)。 txd_buf(6 DOWNTO 0) = txd_buf(7 DOWNTO 1)。 state_tras = state_tras + 0001。 END IF。 WHEN 0011 = 發(fā)送第3位 IF (clkbaud_tras = 39。139。) THEN txd_reg = txd_buf(0)。 txd_buf(6 DOWNTO 0) = txd_buf(7 DOWNTO 1)。 state_tras = state_tras + 0001。 END IF。 WHEN 0100 = 發(fā)送第4位 IF (clkbaud_tras = 39。139。) THEN txd_reg = txd_buf(0)。 txd_buf(6 DOWNTO 0) = txd_buf(7 DOWNTO 1)。 state_tras = state_tras + 0001。 END IF。 WHEN 0101 = 發(fā)送第5位 IF (clkbaud_tras = 39。139。) THEN txd_reg =
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