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正文內(nèi)容

觸發(fā)器與時(shí)序邏輯電路(編輯修改稿)

2025-06-19 22:56 本頁(yè)面
 

【文章內(nèi)容簡(jiǎn)介】 FF0 Q Q Q Q Q Q nQJ 20 ? nQK 20 ?nQJ 01 ? nQK 01 ?nQJ 12 ? nQK12 ? 將驅(qū)動(dòng)方程代入 JK觸發(fā)器特征方程 得觸發(fā)器狀態(tài)方程 nn QKQJQ ??? 1驅(qū)動(dòng)方程 nnnnnnnn KQJQ 20202021010 ??????nnnnnnnn KQJQ 01010111111 ??????nnnnnnnn KQJQ 12121222212 ??????,列狀態(tài)表 現(xiàn)態(tài) 次態(tài) 輸出 Q2n Q1n Q0n Q2n+1 Q1n+1 Q0n+1 Y 0 0 0 0 0 1 1 0 0 1 0 1 1 1 0 1 0 1 0 1 1 0 1 1 1 1 1 1 1 0 0 0 0 0 0 1 0 1 0 1 0 1 1 1 0 1 0 0 1 1 1 1 1 1 0 1 /1 000 001 011 111 110 100 /1 /1 /1 /1 /0 101 010 /1 /1 有效狀態(tài)與有效循環(huán) 無(wú)效狀態(tài)與無(wú)效循環(huán) 能自啟動(dòng) :在時(shí)序邏輯電路中,雖然存在無(wú)效狀態(tài),但他們沒(méi)有形成循環(huán),這樣的時(shí)序電路叫能自啟動(dòng)的時(shí)序電路。 不能自啟動(dòng) :若有無(wú)效狀態(tài)存在,它們之間又形成了循環(huán),這樣的時(shí)序電路被稱(chēng)之為不能自啟動(dòng)的時(shí)序電路。本例電路就不能自啟動(dòng)。 Y Q0 Q1 Q2 分析時(shí)序邏輯電路。 D D D amp。 CP C1 C1 C1 amp。 FF1 FF2 FF0 Q Q Q Q Q Q Q0 Q1 Q2 時(shí)鐘方程: CP0= CP2= CP, CP1= 將驅(qū)動(dòng)方程代入 JK觸發(fā)器特征方程 得觸發(fā)器狀態(tài)方程 DQ n ??1驅(qū)動(dòng)方程 nnn Q 0210 ?? nn 111 ??nnn Q 0112 ??0QnnD 020 ?nQD 11 ?nnD 012 ?,列狀態(tài)表 CP0 CP1 CP2 0 0 1 1 1 1 CP0 CP2 0 1 0 0 1 1 CP0 CP1 CP2 0 1 0 1 0 1 CP0 CP2 0 0 0 0 0 1 CP0 CP1 CP2 0 0 1 1 1 0 CP0 CP2 1 1 0 0 1 0 CP0 CP1 CP2 0 1 0 1 0 0 CP0 CP2 1 0 0 0 0 0 時(shí)鐘條件 Q0n+1 Q1n+1 Q2n+1 Q0n Q1n Q2n 備注 次態(tài) 現(xiàn)態(tài) 000 001 010 011 100 101 110 111 CP Q0 Q1 Q2 寄存器 輸入 0 1 0 1 1 1 0 0 輸出 CP Q D FF3 D3 Q3 Q Q D FF3 D2 Q2 Q Q D FF3 D1 Q1 Q Q D FF3 D0 Q0 Q CP Q2 Q1 Q3 Q0 D C1 FF0 Q Q D C1 FF0 Q Q D C1 FF0 Q Q D C1 FF0 Q Q 并行輸出 串行輸入 串行輸出 1 0 0 0 0 1 1 0 1 0 0 0 1 1 0 0 0 1 1 0 1 0 1 1 控制寄存器的功能 CP S0 S1 Q0 Q1 Q2 Q3 D0 D1 D2 D3 DIL DIR R 異步清零端 右移數(shù)據(jù)輸入端 左移數(shù)據(jù)輸入端 74LS194功能表 R CP S1 S0 功 能 0
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