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使用pld應(yīng)對產(chǎn)品上市時(shí)間和設(shè)計(jì)靈活性的限制(存儲(chǔ)版)

2025-02-15 10:47上一頁面

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【正文】 總線寬度,所需I/O和邏輯的比值是多少? 3. 該應(yīng)用的最佳密度和封裝是什么? 4. 輸出所需的電壓容差是多少? 5. 所需的時(shí)序裕度是多少? 6. 所選的器件是否現(xiàn)場可編程的,以及開發(fā)工具是否容易使用? 7. 有哪些安全性的要求? 不同CPLD供應(yīng)商有不同的規(guī)范和要求,因此選擇合適的器件取決于哪些參數(shù)對設(shè)計(jì)是關(guān)鍵的。上電之后能迅速地獲取邏輯功能的非易失器件對這些應(yīng)用是理想的。具多種密度和多樣嵌入功能特色的PLD能為設(shè)計(jì)提供快速開發(fā)周期。相對傳統(tǒng)CPLD來說,MachXO器件兼有FPGA和CPLD的非易失、低成本、瞬時(shí)上電的高性能邏輯解決方案的優(yōu)點(diǎn)。但是系統(tǒng)設(shè)計(jì)者可以在系統(tǒng)的某些工作周期中關(guān)閉器件以降低功耗。 對于功耗敏感型應(yīng)用,Lattice半導(dǎo)體公司的ispMACH4000Z(Z表示零功耗)CPLD能提供相當(dāng)好的低功耗解決方案。因此,問題就變成到底是用ASIC的投資回報(bào)好還是用PLD的投資回報(bào)好。
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