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s3c2440pll設(shè)置詳解總結(jié)版-wenkub

2023-04-07 00:34:17 本頁面

　

【正文】 USB模塊（48MHz）。但實(shí)際上，F(xiàn)CLK可以高于Fin，為了提高系統(tǒng)時(shí)鐘，需要用軟件來啟用PLL。這就需要設(shè)置CLKDIVN，MPLLCON，UPLLCON這3個(gè)寄存器。時(shí)鐘控制邏輯可以不使用PLL來減慢時(shí)鐘，并且可以由軟件連接或斷開各外設(shè)模塊的時(shí)鐘，以降低功耗。其中UPLLCON寄存器用于產(chǎn)生48MHz或96MHz，提供USB時(shí)鐘（UCLK），其輸入輸出頻率間的關(guān)系為UCLK=UPLL=(m * Fin) / (p * 2^s)其中m=(MDIV+8), p=(PDIV+2), s=SDIV。輸出48MHz和96MHz是UPLLCON使用的。即若主頻FLCK是400MHz，如果按

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