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eda技術(shù)實(shí)用教程第3章-wenkub

2023-05-21 13:05:44 本頁(yè)面
 

【正文】 l y z e r( 時(shí) 序 分 析 器 )圖 19 Quartus II設(shè)計(jì)流程 IP核簡(jiǎn)介 KX康芯科技 IP (Intellectual Property) 軟 IP 固 IP 硬 IP 習(xí) 題 KX康芯科技 11 敘述 EDA的 FPGA/CPLD設(shè)計(jì)流程 。EDA 技術(shù)實(shí)用教程 第 2 章 EDA設(shè)計(jì)流程及其工具 設(shè)計(jì)流程 KX康芯科技 圖 21 應(yīng)用于 FPGA/CPLD的 EDA開發(fā)流程 設(shè)計(jì)流程 KX康芯科技 設(shè)計(jì)輸入 (原理圖/ HDL文本編輯 ) 1. 圖形輸入 狀態(tài)圖輸入 波形圖輸入 原理圖輸入 在 EDA軟件的圖形編輯界面上繪制能完成特定功能的電路原理圖 2. HDL文本輸入 將使用了某種硬件描述語(yǔ)言 (HDL)的電路設(shè)計(jì)文本, 如 VHDL或 Verilog的源程序,進(jìn)行編輯輸入。 設(shè)計(jì)流程 KX康芯科技
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