freepeople性欧美熟妇, 色戒完整版无删减158分钟hd, 无码精品国产vα在线观看DVD, 丰满少妇伦精品无码专区在线观看,艾栗栗与纹身男宾馆3p50分钟,国产AV片在线观看,黑人与美女高潮,18岁女RAPPERDISSSUBS,国产手机在机看影片

正文內(nèi)容

基于vhdl的數(shù)字電子鐘的設(shè)計(jì)(已修改)

2024-11-26 03:16 本頁(yè)面
 

【正文】 基于 VHDL 的數(shù)字 電子鐘設(shè)計(jì) 摘要: 在簡(jiǎn)要介紹了 EDA 技術(shù)特點(diǎn)的基礎(chǔ) 上 ,用 EDA 技術(shù)作為開(kāi)發(fā)手段,采用了頂層圖形設(shè)計(jì)思想,基于硬件描述語(yǔ)言,以可編程器件為核心 ,實(shí)現(xiàn)計(jì)時(shí) 24 小時(shí)的電子時(shí)鐘的設(shè)計(jì)。 關(guān)鍵字: EDA 電子時(shí)鐘 CPLD VHDL 引言: 現(xiàn)代電子技術(shù)的核心是 EDA(Electronic Design Automation)技術(shù)。 EDA技術(shù)就是依靠功能強(qiáng)大的電子計(jì)算機(jī),在 EDA 工具軟件平臺(tái)上,對(duì)硬件描述語(yǔ)言HDL( Hardware Description Language)為系統(tǒng)邏輯描述手段完成的設(shè)計(jì)文件,自動(dòng)地完成邏輯編譯、化簡(jiǎn)、分割、綜合、優(yōu)化、仿真,直到下載到可編程邏輯器件 CPLD/FPGA 或?qū)S眉呻娐?ASIC( Application Specific Integrated Circuit)芯片中,實(shí)現(xiàn)既定的電子電路設(shè)計(jì)功能。 EDA技術(shù)使得電子電路設(shè)計(jì)者的工作僅限于利用硬件描述語(yǔ)言和 EDA 軟件平臺(tái)來(lái)完成對(duì)系統(tǒng)硬件功能的實(shí)現(xiàn),極大地提高了設(shè)計(jì)效率,縮短了設(shè)計(jì)周期,節(jié)省了設(shè)計(jì)成本。 EDA是在 20世紀(jì) 90年代初從計(jì)算機(jī)輔助設(shè)計(jì)( CAD)、計(jì) 算機(jī)輔助制造( CAM)、計(jì)算機(jī)輔助測(cè)試( CAT)和計(jì)算機(jī)輔助工程( CAE)的概念發(fā)展而來(lái)的。一般把 EDA技術(shù)的發(fā)展分為 CAD、 CAE和 EDA這三個(gè)階段。 20世紀(jì) 90年代以來(lái),微電子工藝有了驚人的發(fā)展, 2020年工藝水平已經(jīng)達(dá)到了 60nm,目前正向 45nm邁進(jìn)。大容量的可編程邏輯器件陸續(xù)面世,對(duì)電子設(shè)計(jì)的工具提出了更高的要求,提供了廣闊的發(fā)展空間,促進(jìn)了 EDA技術(shù)的新成。特別重要的是,世界各 EDA公司致力推出兼容各種硬件實(shí)現(xiàn)方案和支持標(biāo)準(zhǔn)硬件描述語(yǔ)言的 EDA工具軟件,有效地將 EDA技術(shù)推向成熟。 一般情況下 EDA軟件我們使用 Quartus II或 Max+plux II,它們的設(shè)計(jì)流程為: 1) 編輯設(shè)計(jì)圖形文件 2) 編譯設(shè)計(jì)文件 3) 仿真設(shè)計(jì)文件 4) 編程下載設(shè)計(jì)文件 一 .設(shè)計(jì)要求 設(shè)計(jì)一個(gè)電子鐘,要求可以顯示時(shí)、分、秒,用戶可以設(shè)置時(shí)間 . 二 .實(shí)驗(yàn)?zāi)康? 1. 掌握多位計(jì)數(shù)器相連的設(shè)計(jì)方法。 2. 掌握十六進(jìn)制,二十四進(jìn)制,六十進(jìn)制計(jì)數(shù)器的設(shè)計(jì)方法。 3. 掌握 CPLD 技術(shù)的層次化設(shè)計(jì)方法。 4. 了解軟件的元件管理含義以及模塊元件之間的連接概念。 5. 掌握電子電路一般的設(shè)計(jì)方法,并了解電子產(chǎn)品的研制開(kāi)發(fā)過(guò)程,基本掌握電子 電路安裝和調(diào)試的方法。 6. 培養(yǎng)獨(dú)立分析問(wèn)題,解決問(wèn)題的能力。 三.硬件要求 1. 8 位 8段掃描共陰極數(shù)碼顯示管。 2. 三個(gè)按鍵開(kāi)關(guān)(清零,調(diào)小時(shí),調(diào)分鐘)。 四.設(shè)計(jì)原理 電子時(shí) 鐘是一個(gè)將 “ 時(shí) ”“ 分 ”“ 秒 ” 顯示于人的視覺(jué)器官的計(jì)時(shí)裝置。它的計(jì)時(shí)周期為 24小時(shí);顯示滿刻度為 23 時(shí) 59 分 59 秒,另外具備校時(shí)功能。因此,一個(gè)基本的數(shù)字鐘電路主要由 “ 時(shí) ”“ 分 ”“ 秒 ” 計(jì)數(shù)器校時(shí)電路組成。將標(biāo)準(zhǔn)秒信號(hào)送入 “ 秒計(jì)數(shù)器 ” , “ 秒計(jì)數(shù)器 ” 采用 60進(jìn)制計(jì)數(shù)器,每累加60 秒發(fā)送一個(gè) “ 分脈沖 ” 信號(hào),該信號(hào)將被送到 “ 時(shí)計(jì)數(shù)器 ” 。 “ 時(shí)計(jì)數(shù)器 ”采用 24 進(jìn)制計(jì)數(shù)器,可實(shí)現(xiàn)對(duì)一天 24 小時(shí)的累計(jì)。譯碼顯示電路“ 時(shí) ”“ 分 ”“ 秒 ” 計(jì)數(shù)器的輸出狀態(tài)六段顯示譯碼器譯碼。通過(guò)六位LED七段顯示器顯示出來(lái)。校時(shí)電路器是用來(lái)對(duì) “ 時(shí) ”“ 分 ”“ 秒 ” 顯示數(shù)字進(jìn)行校時(shí)調(diào)整的。 在同一CPLD芯片口集成如下電路模塊: 1.電子鐘計(jì)數(shù)采用層次化設(shè)計(jì),將設(shè)計(jì)任務(wù)分成若干個(gè)模塊。規(guī)定每一模塊的功能和各模塊之間的接口。 (1)second(秒) 60進(jìn)制BCD碼計(jì)數(shù) (2)minute(分) 60進(jìn)制BCD碼計(jì)數(shù) (3)hour (時(shí)) 24進(jìn)制BCD碼計(jì)數(shù) (4) clock top 頂層設(shè)計(jì) 同時(shí)整個(gè)計(jì)數(shù)器有清零,調(diào)時(shí),調(diào)分功能。 2.端口引腳名稱 輸入 clk,reset,setmin,sethour 輸出 second — daout,minute-daout, hour-daout 五.設(shè)計(jì)原理圖 cl kr e se tse t m i ne n m i nd a o u t [ 6 . . 0 ]cl kcl k 1r e se tse t h o u renhourd a o u t [ 6 . . 0 ]cl kr e se td a o u t [ 5 . . 0 ]s e co n d : u 1h o u r: u 3cl kre s e ts e t m i ns e t h o u rs e co n d _ d a o u t [ 6 . . 0 ]m i n u t e _ d a o u t [ 6 . . 0 ]h o u r_ d a o u t [ 5 . . 0 ]m i n u t e : u 2 輸入: CLK— 時(shí)鐘脈沖, RESET— 復(fù)位信
點(diǎn)擊復(fù)制文檔內(nèi)容
教學(xué)課件相關(guān)推薦
文庫(kù)吧 www.dybbs8.com
公安備案圖鄂ICP備17016276號(hào)-1