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正文內(nèi)容

[高等教育]電子秒表設(shè)計(jì)-閱讀頁

2025-02-02 14:38本頁面
  

【正文】 begin SCOUNT10 = 439。 CN = 139。 end else begin if (EN == 139。b1001) begin CN = 139。 SCOUNT10 = 439。 end else begin CN = 139。 SCOUNT10 = SCOUNT10 + 139。 end end end end end module(2)六進(jìn)制計(jì)數(shù)器的源程序()module CDU6 (CLK, CLR, EN, CN, COUNT6)。 //輸入時(shí)鐘信號CLK input CLR。 //輸入信號EN output CN。 output[3:0] COUNT6。 reg[3:0] SCOUNT6。 always (posedge CLK or posedge CLR or posedge EN) begin if (CLR == 139。b0000 。b0 。b1) begin if (SCOUNT6 == 439。b1 。b0000 。b0 。b1 。 input CLK。 //輸入清零信號CLR input EN。 //輸出信號[3:0]S_1MS wire[3:0] S_1MS。 //輸出信號[3:0]S_10MS wire[3:0] S_10MS。 //輸出信號[3:0]S_100MS wire[3:0] S_100MS。 //輸出信號[3:0]S_1S wire[3:0] S_1S。 //輸出信號[3:0]S_10S wire[3:0] S_10S。 //輸出信號[3:0]S_1MIN wire[3:0] S_1MIN。 //輸出信號[3:0]S_10MIN wire[3:0] S_10MIN。 //輸出信號[3:0]HOUR wire[3:0] HOUR。 wire B。 wire D。 wire F。 wire H。 CDU10 U2 ( A, CLR, EN, B, S_10MS )。 CDU10 U4 ( C, CLR, EN, D, S_1S )。 CDU10 U6 ( E, CLR, EN, F, S_1MIN )。 CDU10 U8 ( G, CLR, EN, H, HOUR )。 input CLK。 //輸入清零信號CLR input EN。 //輸入信號[3:0]S_1MS input[3:0] S_10MS。 //輸入信號[3:0]S_100MS input[3:0] S_1S。 //輸入信號[3:0]S_10S input[3:0] S_1MIN。 //輸入信號[3:0]S_10MIN input[3:0] HOUR。 //輸出信號[3:0]OUTBCD reg[3:0] OUTBCD。 //輸出信號[7:0] SEG reg[7:0] SEG。 always(posedge CLK) begin if (CLR == 139。b1111 。b1) begin COUNT = 439。 end else begin COUNT = COUNT + 139。 end end end always (CLK) begin if (CLK == 139。b0000 : begin OUTBCD = S_1MS 。b11111110 。b0001 : begin OUTBCD = S_10MS 。b11111101 。b0010 : begin OUTBCD = S_100MS 。b11111011 。b0011 : begin OUTBCD = S_1S 。b11110111 。b0100 : begin OUTBCD = S_10S 。b11101111 。b0101 : begin OUTBCD = S_1MIN 。b11011111 。b0110 : begin OUTBCD = S_10MIN 。b10111111 。b0111 : begin OUTBCD = HOUR 。b01111111 。b1000 : begin OUTBCD = S_1MS 。b11111110 。b1001 : begin OUTBCD = S_10MS 。b11111101 。b0000 。b00000000 。 input[3:0] BCD。 //輸出信號[6:0] LED wire[6:0] LED。b0000) ? 739。b0001) ? 739。b0010) ? 739。b0011) ? 739。b0100) ? 739。b0101) ? 739。b0110) ? 739。b0111) ? 739。b1000) ? 739。b1001) ? 739。b0000000 。 input SP。 //輸入清零信號CLR input CLK。 //輸出信號CO wire CO。 //輸出信號EN wire EN。 //輸出信號[6:0] LED wire[6:0] LED。 //輸出信號[3:0] OUTBCD wire[3:0] OUTBCD。 //輸出信號[7:0] SEG wire[7:0] SEG。 wire E。 wire[3:0] MS10_S。 wire[3:0] S1S_S。 wire[3:0] MIN1_S。 wire[3:0] H。 wire[3:0] MS10_S。 CTRL U0 ( CLR, CLK, SP, E )。 COUNT U2 ( C, CLR, E, MS1_S, MS10_S, MS100_S, S1S_S, S10_S, MIN1_S, MIN10_S, H )。 BCD7 U4 ( BCD_S, LED )。 assign EN = E 。end module 33
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