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廣工eda電子技術(shù)實(shí)訓(xùn)報(bào)告-在線瀏覽

2024-09-13 04:15本頁(yè)面
  

【正文】 r在每個(gè)周期都會(huì)遞減cook_timer,時(shí)間會(huì)在7段數(shù)碼管顯示出來(lái)。(二).微波爐時(shí)間控制系統(tǒng)規(guī)格頂層設(shè)計(jì)的輸入和輸出描述如下:reser 復(fù)位microwave timer的端口。set_cook用以設(shè)定加熱時(shí)間。當(dāng)start_cook跳變?yōu)楦唠娖降臅r(shí)候,加熱開始,此時(shí)加熱時(shí)間將會(huì)以每秒減1顯示。min_msb_led,min_lsb_led,sec_msb_led和sec_lab_led是7段數(shù)碼管的輸出,他們控制數(shù)碼管的顯示。 amp?!废赛c(diǎn)擊Filesetup,如果已經(jīng)修改好了,就按cancel。切記:副檔名格式不一樣的檔案,在DC讀取檔案時(shí),不可以一起讀??!相同格式的檔案如Verilog可以全部一起讀??!沒有個(gè)數(shù)限制。在以下窗口的work library輸入“COOK_TEMP”,在點(diǎn)OK。注意:第六步做完后,請(qǐng)?jiān)赿v 命令行里輸入“l(fā)ink”指令看看有沒有錯(cuò)。lib是否正確!(二).設(shè)定條件:set_operating_conditions –max WCCON –min BCCON小插曲:輸入命令的小技巧,直接在腳本了復(fù)制就行了,如下:①先找到腳本所在的文件②再選中要復(fù)制的命令::點(diǎn)擊Attributes Operating Environment Wire Load,選中G5K,點(diǎn)OK。 Fall設(shè)為1,Min Rise amp。:先選擇所有的輸出端口,然后點(diǎn)擊Attributes Operating Environment Output Delay,Relative To Clock設(shè)為clk,Max Rise amp。 ,再點(diǎn)OK。:把以上warning修改過來(lái),先選中top,在點(diǎn)擊Hierarchy Uniquify Hierarchy,再點(diǎn)OK。(或者在dv命令行里輸入:pile –bou –map_effort high –area_effort high)看一下,哪個(gè)設(shè)計(jì)被優(yōu)化了?》從Design最上層top開始一直到其最下層所有block全部都會(huì)被合成與最優(yōu)化。(五).生成報(bào)告和關(guān)鍵路徑選中top,再點(diǎn)擊:面積報(bào)告:Design Report Area,由圖知:設(shè)計(jì)的單元面積為1520um2.時(shí)間報(bào)告:Timing Report Timing約束報(bào)告:Design Report Constraints(click on verbose)看看是否所有約束都體現(xiàn)了?》沒有(面積約束沒有出現(xiàn))哪個(gè)是關(guān)鍵路徑?》Start Point:test End Point:timer/sec lsb next reg[0]/D:點(diǎn)擊“Create Design Schematic”按鈕,將會(huì)彈出頂層電路原理圖的視圖。標(biāo)準(zhǔn)報(bào)告:點(diǎn)擊“Design –Report Design Hierarchy”層次報(bào)告:點(diǎn)擊“Design Report Reference”(六).動(dòng)態(tài)功率優(yōu)化與報(bào)告,你可以先看看時(shí)間、面積、功率。 opo 模式:unix% dv topo:創(chuàng)建Milkway,以及讀入設(shè)計(jì)、設(shè)定約束、綜合:design_visiontoposource 面積報(bào)告:cell area=1448um2時(shí)間報(bào)告:timing=功率報(bào)告:Dynamic Power=,Leakage Power=.綜合的結(jié)果跟實(shí)驗(yàn)21和22有什么不同?》本實(shí)驗(yàn)做出來(lái)的數(shù)據(jù)表示,如果你是用Synopsys APR(ex:IC Compiler/Astro)軟體畫Layout,當(dāng)Layout完成后,!我們從實(shí)驗(yàn)21可知,使用不準(zhǔn)的WLM 來(lái)做設(shè)計(jì),實(shí)在太過悲觀,Net Delay計(jì)算過大,這回照成你在做設(shè)計(jì)時(shí),往往會(huì)誤以為自己做的結(jié)果太差,無(wú)法達(dá)到預(yù)期效能而重做或花時(shí)間再修改架構(gòu),而造成無(wú)謂的時(shí)間浪費(fèi)!另外,使用DCT Flow也會(huì)使Power分析出來(lái)的結(jié)果較為正確!相比之下,WLM所估的Power完全沒有參考依據(jù)。、時(shí)間檢查面積:Design Report Area,如圖,cell area=檢查時(shí)間:Timing Report Timing,如圖,CHIP Timing=,CORE Timing=注:如果CORE Timing 跟CHIP Timing相差比較大,表示CHIP Boundary Constraint需再加強(qiáng)。三.時(shí)許仿真(模擬):unix% cd synopsys/lab3/lab31/tbench/presim 到prelayout模擬:unix% ln –s ../../syn_dc/run/ .unix% ln –s ../../syn_dc/run/ .:initial $sdf_annotate(,chip)。函數(shù)是否能通過?unix% ncverilog –v ../ +access+rLab 32:CHIPlevel Synthesis一.前期工作:unix% cd SYNOPSYS/lab3/lab32unix% cd syn_dcunix% vi 在這個(gè)例程中有什么輸入輸出pad單元被使用?》Input Pad Cell:PDIDGZ,Output Pad Cell:PD008CDG在這個(gè)歷程中有什么輸入輸出pad單元名字?》Input Cell Name:ipad_clk,ipad_reset,ipad_si,ipad_se,ipad_x7~ipad_x10。方法:點(diǎn)擊File Read,點(diǎn)open。三.時(shí)許仿真:unix% cd SYNOPSYS/lab3/lab32/tbench/presim,:unix% ln –s ../../syn_dc/run/ .unix% ln –s ../../syn_dc/run/ .:initial $sdf_annotate(,chip)。函數(shù)是否通過?unix% vcs –R –v ../ –v ../ 第三階段:Multisim工具的使用與實(shí)驗(yàn)Multisim Lab1:?jiǎn)渭?jí)放大電路一、實(shí)驗(yàn)?zāi)康氖煜ultisim9軟件的使用方法。學(xué)習(xí)放大器靜態(tài)工作點(diǎn)、電壓放大倍數(shù)、輸入電阻、輸出電阻的仿真方法,了解共射極電路特性。(1). RL為無(wú)窮數(shù)據(jù)記錄:仿真數(shù)據(jù)(單位:mV)計(jì)算Vi有效值V0有效值A(chǔ)v波形:(2). kΩ和330Ω數(shù)據(jù)記錄:仿真數(shù)據(jù)(單位:mV)計(jì)算RLViV0Av330Ω波形圖:(3).V0變化(以RL=330Ω為例,滑動(dòng)變阻器調(diào)節(jié)前其波形圖見上右圖)VbVcVe畫出波形Rp增大(減小)(增大)(減小)Rp減小(增大)(減小)(減小)(1). 測(cè)量輸入電阻Ri仿真數(shù)據(jù)(單位:mV)計(jì)算信號(hào)發(fā)生器有效電壓值萬(wàn)用表的有效數(shù)據(jù)Ri(2). 測(cè)量輸出電阻R0仿真數(shù)據(jù)(單位:mV)計(jì)算VLV0R0 KΩ(1).電路圖:(2).去掉R7之前輸出波形(200mV/Div): 去掉R7之后輸出波形(100mV/Div): (3). 這是虛擬電阻(都帶有_VIRTUAL),因?yàn)橹挥刑摂M電阻才能更改其阻值!同樣,電容,電感,三極管等等元件,只有虛擬元件才能更改其參數(shù)。掌握放大器靜態(tài)工作點(diǎn)的仿真方法及其對(duì)放大器性能的影響。學(xué)習(xí)Multisim9參數(shù)掃描方法學(xué)會(huì)開關(guān)元件的使用二、虛禮實(shí)驗(yàn)儀器及器材雙蹤示波器信號(hào)發(fā)生器交流毫伏表數(shù)字萬(wàn)用表三、實(shí)驗(yàn)步驟(Re=)VbVcVeIe=Ve/ReVi(單位:V)VO(單位:V)Av=VO/ViVsViRi=Vi*Rs/(VsVi)VO(就是開關(guān)打開時(shí))VL(就是開關(guān)閉合時(shí))RO=(VOVL)*RL/VL:輸入(下面)輸出(上面)波形:2. 射極跟隨器的性能和特點(diǎn)(1).性能:可以起到隔離前后電路的作用;(2).特點(diǎn):它是一個(gè)電壓串聯(lián)負(fù)反饋放大電路,它具有輸入阻抗高,輸出阻抗低,輸出電壓能夠在較大范圍
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