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正文內(nèi)容

dsp原理及應(yīng)用概論-展示頁

2025-05-22 12:53本頁面
  

【正文】 具,如:軟件仿真器 Simulator、在線仿真器 Emulator、 C編譯器和集成開發(fā)環(huán)境 CCS等,給開發(fā)應(yīng)用帶來很大方便。 ? 主要器件有: TI公司的 TMS320C 50系列,Motorola公司的 DSP5600、 9600系列, ATamp。T公司推出 DSP32,是較早的具備較高性能的浮點 DSP芯片 23 ? 第二階段, DSP的成熟階段( 1990年前后) ? 硬件結(jié)構(gòu):更適合數(shù)字信號處理的要求,能進(jìn)行硬件乘法和單指令濾波處理,其單指令周期為 ns。 (8) 具有低開銷或無開銷循環(huán)及跳轉(zhuǎn)的硬件支持。 (4) 精度高, 16位的字長,動態(tài)范圍 96DB, 32位浮點數(shù), 動態(tài)范圍 1536DB。 系統(tǒng) n 信道 1 信道 2 信道 n 實時性要求不高的場合。 優(yōu)點:靈活、高速、便于嵌入式應(yīng)用 13 DSP系統(tǒng)的特點 1. 精度高,速度快 模擬網(wǎng)絡(luò)元件 ( R、 L、 C等) 精度 103 模擬網(wǎng)絡(luò)系統(tǒng) 難 數(shù)字系統(tǒng) 16位字長 DSP、 D/A 精度 105 14 ,穩(wěn)定性好 信號 放大器 A 信號 放大器 B 計算機(jī) A 計算機(jī) B A、 B結(jié)果可能不同 A、 B結(jié)果果相同 只要誤差不超過 0、 1判決電平 15 DSP系統(tǒng) 表面貼裝 ASIC芯片 DSP CPLD FPGA 開發(fā) 壓縮體積 降低成本 16 4. 接口方便 以現(xiàn)代數(shù)字技術(shù)為基礎(chǔ)的系統(tǒng)或設(shè)備都是兼容的,系統(tǒng)接口方便。 11 )1(. . .)1()()()(11010?????????????LnxhnxhnxhinxhnyLLii? 一個典型的數(shù)字信號處理算法 — FIR濾波器 乘與累加( MAC) 是數(shù)字信號處理中的典型計算 12 ? 數(shù)字信號處理系統(tǒng)中 微處理器的選擇 ? 通用微型計算機(jī)( PC機(jī)) ? 普通單片機(jī)(如 MCS5 96系列等) ? 專用集成電路( ASIC) ? DSP處理器 優(yōu)點:編程容易,便于實現(xiàn) 缺點:速度慢、成本高、體積大,難以進(jìn)行實時信號處理和嵌入式應(yīng)用 優(yōu)點:成本低廉 缺點:性能差、速度慢 優(yōu)點:速度高、大規(guī)模生產(chǎn)成本低; 缺點:開發(fā)成本高、通用性差。 自變量:時間、距離、溫度、壓力 對應(yīng)信號維數(shù) 信號的分類:模擬信號 時域離散信號 數(shù)字信號 9 DSP( Digital Signal Processing)也就是我們常說的數(shù)字信號處理,它是利用計算機(jī)或?qū)S锰幚碓O(shè)備,以數(shù)字形式對信號進(jìn)行采集,變換,濾波,估值,增強(qiáng),壓縮,識別等處理,以得到符合人們需要的信號形式。 硬件 /軟件同樣重要、不可偏廢 硬件是系統(tǒng)的基礎(chǔ) , 軟件是系統(tǒng)的靈魂 4 課堂授課時間分配 : (40學(xué)時 ) ? CH1 概述 — 4 ? CH2 TMS320VC33結(jié)構(gòu) — 6 ? CH3 存儲器和高速緩沖器 — 2 ? CH4 外圍 — 6 ? CH5 數(shù)據(jù)格式和浮點運(yùn)算 — 2 ? CH6 尋址方式 — 6 ? CH7 匯編語言指令 — 4 ? CH8 流水線操作 — 2 ? CH9 公共目標(biāo)文件 — 2 ? CH10 十六進(jìn)制轉(zhuǎn)換與引導(dǎo) — 2 ? CH11 硬件應(yīng)用 — 2 ? 復(fù)習(xí)答疑 — 2 5 第一章 DSP技術(shù)概述 基本內(nèi)容和要求: 1.了解數(shù)字信號處理技術(shù)和數(shù)字信號處理器的概念 2.理解可編程 DSP芯片的基本結(jié)構(gòu); 3.了解 DSP芯片與其他微處理器的優(yōu)缺點; 4.理解 DSP系統(tǒng)的基本組成及設(shè)計步驟; 5.掌握 DSP系統(tǒng)中的 DSP芯片的選擇原則; 6.掌握描述 DSP運(yùn)算速度的指標(biāo); 7. 了解 DSP技術(shù)新的發(fā)展動態(tài)、芯片型號及應(yīng)用領(lǐng)域。 未按時交作業(yè)者 :晚 4個小時,成績扣除 5%,晚 12個小時,扣除 30%,晚 24小時,成績扣除 60%,晚 48小時,成績?yōu)?0。 有事提前請假,點名后補(bǔ)假條無效; 作業(yè): 每人準(zhǔn)備一個筆記本,作業(yè)本 ,不能用單頁紙,學(xué)期末作業(yè)本就是一本復(fù)習(xí)提綱。1 DSP原理 及應(yīng)用 任志平 電子信息科學(xué)與技術(shù)教研室 Principle amp。 Application of DSP 2 本課程的要求 考勤: 嚴(yán)禁曠課、遲到,隨機(jī)點名,無故曠課達(dá) 30%,取消期末考資格;遲到、早退三次算一次曠課。 按時完成作業(yè) ,嚴(yán)禁抄襲,發(fā)現(xiàn)者不論是抄襲者還是被抄者,全部按未交作業(yè)處理。 總成績 =考試成績 *+作業(yè)實驗 *+考勤 * 3 有關(guān)本課程學(xué)習(xí)的幾點建議 本課程的前期基礎(chǔ)課程 數(shù)字電路、微機(jī)原理、單片機(jī)原理及應(yīng)用、數(shù)字信號處理 本課程是一門實踐性、應(yīng)用性很強(qiáng)的學(xué)科, 對 于課程的理解主要在于課下的功課。 6 第一章 DSP技術(shù)概述 DSP開發(fā) DSP系統(tǒng)概述 DSP芯片 7 DSP系統(tǒng)概述 DSP系統(tǒng) 模擬系統(tǒng) 數(shù)字信號 模擬信號 運(yùn)算過程 強(qiáng)調(diào)控制 實時處理 FPGA/CPLD DSP芯片 模擬器件 8 DSP的基本概念 信號:一個或多個自變量的函數(shù)。 DSP的含義 數(shù)字信號處理 (Digital Signal Processing) 數(shù)字信號處理的理論和算法 數(shù)字信號處理 器 (Digital Signal Processor) 實現(xiàn)數(shù)字信號處理算法的微處理器 芯片 10 DSP的基本概念 ? 一個典型的數(shù)字信號處理系統(tǒng) 抗混疊濾波A / D 微處理器 平滑濾波D / Ax ( t ) x ( n ) y ( n ) y ( t ) 微處理器是數(shù)字信號處理系統(tǒng)的核心部件, 通常采用DSP芯片 ,也可采用其它處理器芯片 A/D與 D/A轉(zhuǎn)換器建立起了數(shù)字世界與現(xiàn)實模擬世界之間的橋梁。 針對數(shù)字信號處理的要求而設(shè)計,是數(shù)字信號處理系統(tǒng)設(shè)計中采用的主流芯片。 DSP系統(tǒng) DSP CPLD FPGA 可編程 改變軟件 不同的功能 硬件更簡單 DSP系統(tǒng)開發(fā)周期大大縮短 17 DSP系統(tǒng) DSP CPLD
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