章觸發(fā)器及時(shí)序邏輯電路電子技術(shù)習(xí)題及解答沈陽工業(yè)大學(xué)(參考版)
2024-10-11 15:07本頁面
【正文】 A 3 B 10 C 100 A A 35 n位二進(jìn)制加法計(jì)數(shù)器有（ ）個(gè)狀態(tài)，最大計(jì)數(shù)值是（ ） A 2 B 2 C 2 1 n1 n n B C 36 將兩片 CC40192級聯(lián)后用借位輸出置數(shù)法構(gòu)成 M（ M 100) 進(jìn)制減法計(jì)數(shù)器，預(yù)制數(shù)端的數(shù)據(jù) N應(yīng)是（ ） A M B 100M C 100+M A 37 將兩片 CC40193級聯(lián)后用借位輸出置數(shù)法構(gòu)成 M進(jìn)制減法計(jì)數(shù)器， M的取值范圍是（ ） A 0 M 100 B 2 M 2 C 2 M 2 1 8 8 B 38 將兩片 CC40193級聯(lián)后用借位輸出置數(shù)法構(gòu)成 M進(jìn)制減法計(jì)數(shù)器，預(yù)制數(shù)端的數(shù)據(jù)應(yīng)是（ ） A M B 2 M C 2 +M 8 8 A 39 計(jì)數(shù)器脈沖分配器的一般組成是（ ） A 計(jì)數(shù)器 B 2 M C 計(jì)數(shù)器和譯碼器 C 40 為獲得 100個(gè)節(jié)拍脈沖，若采用計(jì)數(shù)式脈沖分配器，至少需要（ ）位二進(jìn)制計(jì)數(shù)器。 ＡＭ ＢＭ＋Ｎ ＣＭ＋Ｎ－１ Ｂ 31 將兩片同步４位二進(jìn)制加法計(jì)數(shù)器芯片用進(jìn)位輸出置數(shù)法構(gòu)成任意進(jìn)制計(jì)數(shù)器，其最大計(jì)數(shù)值是（ ） Ａ２ －１ Ｂ２ －１ Ｃ２ ４ ８ ８ Ｂ 32 將兩片同步 4位二進(jìn)制加法計(jì)數(shù)器級聯(lián)后，用進(jìn)為輸出置數(shù)法構(gòu)成 M進(jìn)制計(jì)數(shù)器 ,預(yù)制數(shù)端的數(shù)據(jù) N應(yīng)是（ ） A 256M B 2 N C MN 8 A 33 欲構(gòu)成能記最大十進(jìn)制為 999的計(jì)數(shù)器，至少需要（ ）個(gè)雙穩(wěn)態(tài)觸發(fā)器。 ＡＭ ＢＭ＋Ｎ ＣＭ＋Ｎ－１ Ｃ 29 對異步預(yù)置數(shù)計(jì)數(shù)器，用狀態(tài)譯碼計(jì)數(shù)器構(gòu)成Ｍ進(jìn)制加法計(jì)數(shù)器，若預(yù)制數(shù)據(jù)為０，則應(yīng)將（ ）所對應(yīng)的狀態(tài)譯碼后驅(qū)動預(yù)制數(shù)控制端。 A M B M1 C M+1 A 27 用同步狀態(tài)譯碼預(yù)制數(shù)法構(gòu)成 M進(jìn)制加法計(jì)數(shù)器，若預(yù)制數(shù)據(jù)為 0，則應(yīng)將（ ）所對應(yīng)的狀態(tài)譯碼后驅(qū)動預(yù)制數(shù)控制端。 A CC40192 B CC40193 C T1160 D T1161 CD 20 不需 CP控制的直接實(shí)現(xiàn)預(yù)制數(shù)功能的計(jì)數(shù)器稱為異步預(yù)制數(shù)計(jì)數(shù)器。 A 復(fù)位法 B 預(yù)置數(shù)法 C 進(jìn)（借）位輸出端 A 19 在 CP的控制下實(shí)現(xiàn)預(yù)置數(shù)功能的計(jì)數(shù)器稱為同步預(yù)置數(shù)計(jì)數(shù)器。 A 能 B 不能 C 不一定能 A 17 利用中規(guī)模集成計(jì)數(shù)器構(gòu)成任意進(jìn)制計(jì)數(shù)器的方法有（ ）。 A 加法，減法及加減可逆 B 同步和異步 C 二，十和 M進(jìn)制 B 13 按計(jì)數(shù)器狀態(tài)變化的規(guī)律分類，計(jì)數(shù)器可分為（ ）計(jì)數(shù)器 A 加法，減法及加減可逆 B 同步和異步 C 二，十和 M進(jìn)制 A 14 按計(jì)數(shù)器的進(jìn)位制（或循環(huán)模數(shù)）分類，計(jì)數(shù)器可分為（ ）計(jì)數(shù)器 A 加法，減法及加減可逆 B同步和異步 C 二，十和 M進(jìn)制 C 15 M進(jìn)制計(jì)數(shù)器狀態(tài)轉(zhuǎn)換的特點(diǎn)是設(shè)初態(tài)后，每來（ ）個(gè)CP時(shí)，計(jì)數(shù)器又重回初態(tài)。 A 左移位寄存器 B 右移位寄存器 C 左，右移位和雙向移位寄存器 C 7 數(shù)碼可以并行輸入，并行輸出的寄存器有（ ）。 A 存數(shù)和取數(shù) B 清零和置數(shù) C 兩者皆有 C 5 按數(shù)碼的存取方式，寄存器可分為（ ）。 A 僅與該時(shí)刻輸入信號的狀態(tài)有關(guān) B 僅與時(shí)序電路的原狀態(tài)有關(guān) C 與 A， B皆有關(guān) C 3 寄存器在電路組成上的特點(diǎn)是（ ）。 Q1 Q1 F1 J2 C2 K2 Q2 Q2 F2 D CP a) D1 C1 一 b) 圖 139 6 1 2 3 4 5 CP 7 D 6 1 2 3 4 5 CP 7 D Q1 Q2 圖 1310 第十四章 時(shí)序邏輯電路 1 時(shí)序電路可以由（ ）組成。 =1 J1 C1 K1 Q1 Q1 F1 J2 C2 K2 Q2 Q2 F2 A CP a) “1” 6 1 2 3 4 5 CP A Q1 Q2 圖 138 6 1 2 3 4 5 CP
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