畢業(yè)設計-四路智力競賽搶答器的設計(參考版)
2025-07-02 14:14本頁面
【正文】 北京希望電子出版社 2007[5]夏路易《全國大學生電子設計大賽培訓系列教程》 高等教育出版社2007[3]彭介華《電子技術試驗》華中科技大學出版社參考文獻[1]吳建國不要一味地去追求結果，應該注重在整個過程中的學習。在這次畢業(yè)設計中也使我們的同學關系更進一步了，同學之間互相幫助，有什么不懂的大家在一起商量，聽聽不同的看法便于我們更好的理解知識，所以在這里非常感謝幫助過我的同學。并非幾個簡單的“或”,“與”，“非” 門能解決問題的。這是一個很難的數字電路設計，以前以為只學好書上知識就可以了，但在這次設計中很多并非教材上能找到的芯片。比如，計數跳變時，個位和十位跳變不同時，出現(xiàn)60跳變后成50的現(xiàn)象，后來查資料才知道這是反饋延時產生的。主要使用了74LS148，74LS248,74LS74等一些集成芯片，以及七段數碼顯示管，555定時電路，蜂鳴器，發(fā)光二極管。當計時器變?yōu)?0時，產生低電平，經過1個“與非”門，和2個“非”門，也變成高電平時得BUZZER鳴響。提示選手答題時間已到。: 74LS02邏輯表輸 入輸 出ABY110010100001： 搶答及即時鳴響電路圖此部分電路完成鳴響功能。3腳作為輸入，1腳作為輸出，這三個腳構成一個或非門。以一個或非門為例來講。74LS02是兩個腳作為輸入一個腳作為輸出。：圖2 .10 74LS04非門反相器符號: 74LS04邏輯表輸 入輸 出1001 74LS02與非門： 74LS02與非門引腳圖74LS02在數字電路課程中為或非門, 作用是二個輸入的或運算,運算后反相輸出。另外的12,34,56,89,1011,1213分別是六個反相器。 搶答及限時鳴響電路 74LS04非門輸入高電平1（5v），輸出低電平0（0v）。另外，LED1代表的信號顯示燈也會發(fā)光。：表 74LS192功能表輸 入輸 出MRP3P2P1P0Q3Q2Q1Q01000000dcbadcba011加計數011減計數： 8421BCD碼遞減計數器電路圖當選手按下?lián)尨鹌靼粹o時，電路開始工作。進行減計數：當Q3Q2Q1Q0=0000，且CPd=0時，BO非給出一錯位信號。 （4）保持。當CR=0,LD非=0時D1D2D3D4被置數,不受CP控制。 （2）異步置數控制。74LS192的輸入端異步清零信號CR，高電平有效。這也就確定了計數器以1秒1次的頻率計數。： 脈沖發(fā)射器電路圖此部分電路主要是為計時電路提供所需脈沖，一般情況下，脈沖周期為1秒，選手按下強大按鈕時，也就啟動了次部分電路的工作。A1和A2的輸出端控制RS觸發(fā)器狀態(tài)和放電管開關狀態(tài)。高電平觸發(fā)信號加在C1的反相輸入端，與同相輸入端的參考電壓比較后，其結果作為基本RS觸發(fā)器R端的輸入信號；低電平觸發(fā)信號加在C2的同相輸入端，與反相輸入端的參考電壓比較后，其結果作為基本RS觸發(fā)器S端的輸入信號。電阻分壓器為比較器CC2提供參考電壓，比較器C1的參考電壓為2/3Vcc，加在同相輸入端，比較器C2的參考電壓為1/3Vcc，加在反相輸入端。該端與放電管集電極相連，用做定時器時電容的放電。若此端外接電壓，則可改變內部兩個比較器的基準電壓，當該端不用時，以防引入干擾。當R端接低電平，則時基電路不工作，此時不論TR、TH處于何電平，時基電路輸出為“0”，該端不用時應接高電平。6腳：TH高觸發(fā)端。3腳：OUT（或Vo）輸出端。8腳：VCC(或VDD)外接電源VCC，～16V，CMOS型時基電路VCC的范圍為3～18V。T2=R2Cln2。則其振蕩周期與充放電時間有關，也就是與外接元件有關，不受電源電壓變化影響。用555集成電路組成多諧振蕩電路為系統(tǒng)提供時鐘秒脈沖。一般用雙極性工藝制作的稱為555，用CMOS工藝制作的稱為 7555，除單定時器外，還有對應的雙定時器 556/7556。注意，選手控制信號從74LS148N的DDDD6端輸入，并且D3對應選手4號，D4對應選手3號，D5對應選手2號，D6對應選手1號。該電路由優(yōu)先編碼器74LS148N和七段譯碼器/驅動74ls248N組成。例如：當第三位選手率先按下?lián)尨鹌鲿r，LED顯示“3”。本設計將/RBI、/LT、/RBO都置高電平。當/LT＝1且/RBO＝0時，/RBO＝0；其它情況下/RBO＝1[3]。當/RBO作為輸入使用，且/RBO＝0時，數碼管七段全滅，與譯碼輸入無關。利用此功能可以實現(xiàn)對無意義位的零進行消隱。因此，/LT=0可用來檢查74LS248和顯示器的好壞。（3) 試燈輸入端/LT： 低電
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