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2025-06-27 17:44本頁面
【正文】 b1。 end else begin Y1=139。b1。 count=count139。b1。 endendendmodule控制器模塊module light_ctrl(clk_1,rst,Y1,count,light1,light2,)。input clk_1,rst,Y1。input[5:0] count。output[1:0]light1,light2。reg[1:0]light1,light2。reg[2:0]state。parameter s1=339。b000, s2=339。b001, s3=339。b010, s4=339。b011, s5=339。b100。always@(posedge clk_1 or negedge rst)begin if(!rst) state=s5。 else begin case(state) s1:if(Y1) begin light1=239。b01。 light2=239。b00。 state=s2。 end else state=s1。 s2:if(! count) begin light1=239。b00。 light2=239。b10。 state=s3。 end else state=s2。 s3:if(Y1) begin light1=239。b00。 light2=239。b01。 state=s4。 end else state=s3。 s4:if(! count) begin light1=239。b10。 light2=239。b00。 state=s1。 end else state=s4。 s5:if (rst) begin light1=239。b10。 light2=239。b00。 state=s1。 end else begin light1=239。b00。 light2=239。b00。 state=s5。 end default state=s1。 endcase endendendmodule顯示譯碼器模塊module display_decode(count,dis_drv1,dis_drv2)。input[5:0]count。output[6:0]dis_drv1,dis_drv2。integer data。integer quo。integer p。reg[2:0]dh。reg[3:0]dl。wire[6:0]dis_drv1,dis_drv2。always@(count)begin data=count[5]*32+count[4]*16+count[3]*8+count[2]*4+count[1]*2+count[0]。 quo=data/439。d10。 p=data%439。d10。 begin case(quo) 339。d6:dh=339。b110。 339。d5:dh=339。b101。 339。d4:dh=339。b100。 339。d3:dh=339。b011。 339。d2:dh=339。b010。 339。d1:dh=339。b001。 339。d0:dh=339。b000。 default:dh=339。bxxx。 endcase end begin case(p) 439。d9:dl=439。b1001。 439。d8:dl=439。b1000。 439。d7:dl=439。b0111。 439。d6:dl=439。b0110。 439。d5:dl=439。b0101。 439。d4:dl=439。b0100。 439。d3:dl=439。b0011。 439。d2:dl=439。b0010。 439。d1:dl=439。b0001。 439。d0:dl=439。b0000。 default:dl=439。bxxxx。 endcase endendassign dis_drv1={dh,dl}。assign dis_drv2={dh,dl}。endmodule頂層連接模塊module top(clk,rst,dis_drv1,dis_drv2,light1,light2)。input clk。input rst。output[1:0] light1,light2。output[6:0] dis_drv1,dis_drv2。wire clk_1。clk_div clk_div_inst(.clk(clk),.clk_1(clk_1))。wire[5:0] count。wire Y1。time_t time_t_inst(.clk_1(clk_1),.rst(rst),.count(count),.Y1(Y1),)。wire[1:0] light1。wire[1:0] light2。light_ctrl light_ctrl_inst(.clk_1(clk_1),.rst(rst),.Y1(Y1),.count(count),.light1(light1),.light2(light2),)。wire[6:0] dis_drv1,dis_drv2。display_decode display_decode_inst(.count(count),.dis_drv1(dis_drv1),.dis_drv2(dis_drv2),)。Endmodule22
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