[工學]第8章典型時序邏輯電路-資料下載頁
2025-02-17 01:11本頁面
【正文】 競爭?；蛘咴O計直接產(chǎn)生順序脈沖的計數(shù)器，不用譯碼器。 （ 2）選擇具有控制端的譯碼器，當計數(shù)狀態(tài)穩(wěn)定后才允許譯碼輸出。 （ 3）順序脈沖發(fā)生器輸出端并聯(lián)小電容。此法簡單，但電容使信號的邊沿陡度變差。 Y0 Y1 Y2 CP 寄存器 寄存器： 存儲二進制代碼的時序電路，是數(shù)字系統(tǒng)中廣泛使用的一種邏輯部件。 寄存器的主要電路元件是 觸發(fā)器 ，一個觸發(fā)器只能存儲 1位二進制代碼， 存儲 n位二進制代碼需要 n個觸發(fā)器。 n 位二進制代碼存入寄存器的方式有 并行輸入 和 串行輸入 。 在并行輸入中， n位二進制代碼 通過 n條信號線同時存入寄存器。 串行輸入則是 通過一條信號線分時將 n位二進制代碼存入寄存器。串行輸入寄存器也稱為移位寄存器。 與輸入方式對應， 輸出也有并行方式和串行方式 。 寄存器 并行輸入寄存器 3,2,1,01 ??? iDQ iniQ 74LS175的電路原理圖。 R=0(低電平 )時， 4個 D觸發(fā)器全部被清零。 在時鐘 CP的上升沿，將輸入 4位二進制代碼 D3D2D1D0（稱為數(shù)據(jù)輸入端）分別存入 4個 D觸發(fā)器中， Q端并行輸出數(shù)據(jù)（原碼）。 端并行輸出數(shù)據(jù)（反碼）。 寄存器 移位輸入寄存器 高位觸發(fā)器的 Q端與相鄰低位觸發(fā)器的 D端相連，最高位觸發(fā)器的 D端作右移輸入 DSR，最低位觸發(fā)器的 Q端作輸出 DOR。 2,1,0 : 1113 ??? ??? iDQ niniSRn狀態(tài)方程nOR QD 0 : ?輸出方程 圖 右移移位寄存器原理 （ 教材 有錯 ） CP D SR DOR Q 3 Q 2 Q1 Q 0 1D Q C1 F F 3 Q 1D Q C1 F F 2 Q 1D Q C1 F F 1 Q 1D Q C1 F F 0 Q 2,1,0 : 1113 ??? ??? iDQ niniSRn狀態(tài)方程nOR QD 0 : ?輸出方程時序圖： 設寄存器初態(tài)為 0，串行輸入1101，低位在前。 圖 右移移位寄存器原理 （ 教材 有錯 ） CP D SR DOR Q 3 Q 2 Q1 Q 0 1D Q C1 F F 3 Q 1D Q C1 F F 2 Q 1D Q C1 F F 1 Q 1D Q C1 F F 0 Q 2,1,0 : 1113 ??? ??? iDQ niniSRn狀態(tài)方程nOR QD 0 : ?輸出方程 如果將低位 D觸發(fā)器的 Q端與相鄰高位的 D端相連，最低位觸發(fā)器的 D端作左移輸入 DSL，最高位觸發(fā)器的 Q端作輸出 DOL，可組成左移寄存器。 nOL QD 3?輸出方程：3,2,11110 ??? ??? iDQ niniSLn狀態(tài)方程： 寄存器 移位輸入寄存器 (略 ) 集成 4位雙向移位寄存器 74194。 功能：異步清零功能和 4種工作模式。 （ 1）清零功能 R=0， 4個帶異步清零的同步 RS觸發(fā)器被異步清零。 （ 2）４種工作模式 每個同步 RS觸發(fā)器和它的輸入與或非門組成一個工作單元，４個單元的工作模式相同。 010121322 : MQMMDMQRS nn ????驅動方程0101213222212 : MQMMDMQRQRSQ nnnn ???????狀態(tài)方程012 :MMCPCP ???時鐘方程（ 2）４種工作模式 每個同步 RS觸發(fā)器和它的輸入與或非門組成一個工作單元，４個單元的工作模式相同。 010121322 : MQMMDMQRS nn ????驅動方程0101213222212 : MQMMDMQRQRSQ nnnn ???????狀態(tài)方程012 : MMCPCP ???時鐘方程模式０： M1=M0=0， CP2=0，寄存器保持不變。 模式１： M1=0， M0=１， CP2=CP。由狀態(tài)方程得 nnnn QMQMMDM 3010121312 ????? 右移 模式 2： M1=1， M0=0， CP2=CP。由狀態(tài)方程得 nnnn QMQMMDM 1010121312 ????? 左移 模式 3： M1=1， M0=１， CP2=CP。由狀態(tài)方程得 2022121312 DMQMMDM nnn ?????并行輸入 74194的功能表 清零 輸入 時鐘 工作 模式 串行 輸入 并行 輸入 并行 輸出 說明 R CP M1 M0 DSR DSL D3 D2 D1 D0 Q3 Q2 Q1 Q0 ０ ╳ ╳ ╳ ╳ ╳ ╳ ╳ ╳ ╳ ０ ０ ０ ０ 清零 １ ╳ ０ ０ ╳ ╳ ╳ ╳ ╳ ╳ Q3 Q2 Q1 Q0 保持 １ ↑ ０ １ DSR ╳ ╳ ╳ ╳ ╳ DSR Q3 Q2 Q1 右移 １ ↑ １ ０ ╳ DSL ╳ ╳ ╳ ╳ Q2 Q1 Q0 DSL 左移 １ ↑ １ １ ╳ ╳ D3 D2 D1 D0 D3 D2 D1 D0 并行 輸入 右移： Q0作輸出。左移： Q3作輸出。
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