【文章內(nèi)容簡(jiǎn)介】 似。二：低功耗設(shè)計(jì)現(xiàn)象一：我們這系統(tǒng)是220V供電，就不用在乎功耗問(wèn)題了點(diǎn)評(píng)：低功耗設(shè)計(jì)并不僅僅是為了省電，更多的好處在于降低了電源模塊及散熱系統(tǒng)的成本、由于電流的減小也減少了電磁輻射和熱噪聲的干擾。隨著設(shè)備溫度的降低，器件壽命則相應(yīng)延長(zhǎng)（半導(dǎo)體器件的工作溫度每提高10度，壽命則縮短一半）現(xiàn)象二：這些總線信號(hào)都用電阻拉一下，感覺(jué)放心些點(diǎn) 評(píng)：信號(hào)需要上下拉的原因很多，但也不是個(gè)個(gè)都要拉。上下拉電阻拉一個(gè)單純的輸入信號(hào)，電流也就幾十微安以下，但拉一個(gè)被驅(qū)動(dòng)了的信號(hào)，其電流將達(dá)毫安 級(jí)，現(xiàn)在的系統(tǒng)常常是地址數(shù)據(jù)各32位，可能還有244/245隔離后的總線及其它信號(hào)，都上拉的話，幾瓦的功耗就耗在這些電阻上了（不要用8毛錢(qián)一度電 的觀念來(lái)對(duì)待這幾瓦的功耗）?，F(xiàn)象三：CPU和FPGA的這些不用的I/O口怎么處理呢？先讓它空著吧，以后再說(shuō)點(diǎn)評(píng)：不用的I/O口如果懸空的話，受外界的一點(diǎn)點(diǎn)干擾就可能成為反復(fù)振蕩的輸入信號(hào)了，而MOS器件的功耗基本取決于門(mén)電路的翻轉(zhuǎn)次數(shù)。如果把它上拉的話，每個(gè)引腳也會(huì)有微安級(jí)的電流，所以最好的辦法是設(shè)成輸出（當(dāng)然外面不能接其它有驅(qū)動(dòng)的信號(hào)）現(xiàn)象四：這款FPGA還剩這么多門(mén)用不完，可盡情發(fā)揮吧點(diǎn)評(píng)：FGPA的功耗與被使用的觸發(fā)器數(shù)量及其翻轉(zhuǎn)次數(shù)成正比，所以同一型號(hào)的FPGA在不同電路不同時(shí)刻的功耗可能相差100倍。盡量減少高速翻轉(zhuǎn)的觸發(fā)器數(shù)量是降低FPGA功耗的根本方法?，F(xiàn)象五：這些小芯片的功耗都很低，不用考慮 點(diǎn) 評(píng)：對(duì)于內(nèi)部不太復(fù)雜的芯片功耗是很難確定的，它主要由引腳上的電流確定，一個(gè)ABT16244，沒(méi)有負(fù)載的話耗電大概不到1毫安，但它的指標(biāo)是每個(gè)腳可 驅(qū)動(dòng)60毫安的負(fù)載（如匹配幾十歐姆的電阻），即滿負(fù)荷的功耗最大可達(dá)60*16=960mA，當(dāng)然只是電源電流這么大，熱量都落到負(fù)載身上了?，F(xiàn)象六：存儲(chǔ)器有這么多控制信號(hào)，我這塊板子只需要用OE和WE信號(hào)就可以了，片選就接地吧，這樣讀操作時(shí)數(shù)據(jù)出來(lái)得快多了。點(diǎn)評(píng)：大部分存儲(chǔ)器的功耗在片選有效時(shí)（不論OE和WE如何）將比片選無(wú)效時(shí)大100倍以上，所以應(yīng)盡可能使用CS來(lái)控制芯片，并且在滿足其它要求的情況下盡可能縮短片選脈沖的寬度?，F(xiàn)象七：這些信號(hào)怎么都有過(guò)沖??？只要匹配得好，就可消除了點(diǎn) 評(píng)：除了少數(shù)特定信號(hào)外（如100BASET、CML），都是有過(guò)沖的，只要不是很大，并不一定都需要匹配，即使匹配也并非要匹配得最好。象TTL的輸 出阻抗不到50歐姆，有的甚至20歐姆，如果也用這么大的匹配電阻的話，那電流就非常大了，功耗是無(wú)法接受的，另外信號(hào)幅度也將小得不能用，再說(shuō)一般信號(hào) 在輸出高電平和輸出低電平時(shí)的輸出阻抗并不相同，也沒(méi)辦法做到完全匹配。所以對(duì)TTL、LVDS、422等信號(hào)的匹配只要做到過(guò)沖可以接受即可?，F(xiàn)象八：降低功耗都是硬件人員的事，與軟件沒(méi)關(guān)系點(diǎn) 評(píng)：硬件只是搭個(gè)舞臺(tái)，唱戲的卻是軟件，總線上幾乎每一個(gè)芯片的訪問(wèn)、每一個(gè)信號(hào)的翻轉(zhuǎn)差不多都由軟件控制的，如果軟件能減少外存的訪問(wèn)次數(shù)（多使用寄存 器變量、多使用內(nèi)部CACHE等）、及時(shí)響應(yīng)中斷（中斷往往是低電平有效并帶有上拉電阻）及其它爭(zhēng)對(duì)具體單板的特定措施都將對(duì)降低功耗作出很大的獻(xiàn)。三：系統(tǒng)效率現(xiàn)象一：這主頻100M的CPU只能處理70%，換200M主頻的就沒(méi)事了點(diǎn)評(píng)：系統(tǒng)的處理能力牽涉到多種多樣的因素，在通信業(yè)務(wù)中其瓶頸一般都在存儲(chǔ)器上，CPU再快，外部訪問(wèn)快不起來(lái)也是徒勞?，F(xiàn)象二：CPU用大一點(diǎn)的CACHE，就應(yīng)該快了點(diǎn) 評(píng)：CACHE的增大，并不一定就導(dǎo)致系統(tǒng)性能的提高，在某些情況下關(guān)閉CACHE反而比使用CACHE還快。原因是搬到CACHE中的數(shù)據(jù)必須得到多次 重復(fù)使用才會(huì)提高系統(tǒng)效率。所以在通信系統(tǒng)中一般只打開(kāi)指令CACHE，數(shù)據(jù)CACHE即使打開(kāi)也只局限在部分存儲(chǔ)空間，如堆棧部分。同時(shí)也要求程序設(shè)計(jì) 要兼顧C(jī)ACHE的容量及塊大小，這涉及到關(guān)鍵代碼循環(huán)體的長(zhǎng)度及跳轉(zhuǎn)范圍，如果一個(gè)循環(huán)剛好比CACHE大那么一點(diǎn)點(diǎn)，又在反復(fù)循環(huán)的話，那就慘了?，F(xiàn)象三：這么多任務(wù)到底是用中斷還是用查詢呢？還是中斷快些吧點(diǎn) 評(píng)：中斷的實(shí)時(shí)性強(qiáng)，但不一定快。如果中斷任務(wù)特別多的話，這個(gè)沒(méi)退出來(lái)，后面又接踵而至，一會(huì)兒系統(tǒng)就將崩潰了。如果任務(wù)數(shù)量多但很頻繁的話，CPU的 很大精力都用在進(jìn)出中斷的開(kāi)銷(xiāo)上，系統(tǒng)效率極為低下，如果改用查詢方式反而可極大提高效率，但查詢有時(shí)不能滿足實(shí)時(shí)性要求，所以最好的辦法是在中斷中查 詢，即進(jìn)一次中斷就把積累的所有任務(wù)都處理完再退出?，F(xiàn)象四：存儲(chǔ)器接口的時(shí)序都是廠家默認(rèn)的配置，不用修改的點(diǎn)評(píng)：BSP對(duì)存儲(chǔ) 器接口設(shè)置的默認(rèn)值都是按最保守的參數(shù)設(shè)置的，在實(shí)際應(yīng)用中應(yīng)結(jié)合總線工作頻率和等待周期等參數(shù)進(jìn)行合理調(diào)配。有時(shí)把頻率降低反而可提高效率，如RAM的 存取周期是70ns，總線頻率為40M時(shí)，設(shè)3個(gè)周期的存取時(shí)間，即75ns即可；若總線頻率為50M時(shí)，必須設(shè)為4個(gè)周期，實(shí)際存取時(shí)間卻放慢到了 80ns?，F(xiàn)象五：一個(gè)CPU處理不過(guò)來(lái)，就用兩個(gè)分布處理，處理能力可提高一倍 點(diǎn)評(píng)：對(duì)于搬磚頭來(lái)說(shuō)，兩個(gè)人應(yīng)該比一個(gè)人的效率高一倍；對(duì)于作畫(huà)來(lái)說(shuō)，多一個(gè)人只能幫倒忙。使用幾個(gè)CPU需對(duì)業(yè)務(wù)有較多的了解后才能確定，盡量減少兩個(gè)CPU間協(xié)調(diào)的代價(jià)，使1+1盡可能接近2，千萬(wàn)別小于1。現(xiàn)象六：這個(gè)CPU帶有DMA模塊，用它來(lái)搬數(shù)據(jù)肯定快點(diǎn) 評(píng)：真正的DMA是由硬件搶占總線后同時(shí)啟動(dòng)兩端設(shè)備，在一個(gè)周期內(nèi)這邊讀，那邊些。但很多嵌入CPU內(nèi)的DMA只是模擬而已，啟動(dòng)每一次DMA之前要做 不少準(zhǔn)備工作（設(shè)起始地址和長(zhǎng)度等），在傳輸時(shí)往往是先讀到芯片內(nèi)暫存，然后再寫(xiě)出去，即搬一次數(shù)據(jù)需兩個(gè)時(shí)鐘周期，比軟件來(lái)搬要快一些（不需要取指令，沒(méi)有循環(huán)跳轉(zhuǎn)等額外工作），但如果一次只搬幾個(gè)字節(jié)，還要做一堆準(zhǔn)備工作，一般還涉及函數(shù)調(diào)用，效率并不高。所以這種DMA只對(duì)大數(shù)據(jù)塊才適用。四：信號(hào)完整性現(xiàn)象一：這些信號(hào)都經(jīng)過(guò)仿真了，絕對(duì)沒(méi)問(wèn)題 點(diǎn) 評(píng)：仿真模型不可能與實(shí)物一模一樣，連不同批次加工的實(shí)物都有差別，就更別說(shuō)模型了。再說(shuō)實(shí)際情況千差萬(wàn)別，仿真也不可能窮舉所有可能，尤其是串?dāng)_。曾經(jīng) 有一教訓(xùn)是某單板只有特定長(zhǎng)度的包極易丟包，最后的原因是長(zhǎng)度域的值是0xFF，當(dāng)這個(gè)數(shù)據(jù)出現(xiàn)在總線上時(shí)，干擾了相鄰的WE信號(hào)，導(dǎo)致寫(xiě)不進(jìn)RAM。其 它數(shù)據(jù)也會(huì)對(duì)WE產(chǎn)生干擾，但干擾在可接受的范圍內(nèi)，可是當(dāng)8位總線同時(shí)由0邊1時(shí)，附近的信號(hào)就招架不住了。結(jié)論是仿真結(jié)果僅供參考，還應(yīng)留有足夠的余 量?，F(xiàn)象二：100M的數(shù)據(jù)總線應(yīng)該算高頻信號(hào)，至于這個(gè)時(shí)鐘信號(hào)頻率才8K，問(wèn)題不大點(diǎn)評(píng)：數(shù)據(jù)總線的值一般是由控制信號(hào)或時(shí)鐘 信號(hào)的某個(gè)邊沿來(lái)采樣的，只要爭(zhēng)對(duì)這個(gè)邊沿保持足夠的建立時(shí)間和保持時(shí)間即可，此范圍之外有干擾也罷過(guò)沖也罷都不會(huì)有多大影響（當(dāng)然過(guò)沖最好不要超過(guò)芯片 所能承受的最大電壓值），但時(shí)鐘信號(hào)不管頻率多低（其實(shí)頻譜范圍是很寬的），它的邊沿才是關(guān)鍵的，必須保證其單調(diào)性，并且跳變時(shí)間需在一定范圍內(nèi)?，F(xiàn)象三：既然是數(shù)字信號(hào)，邊沿當(dāng)然是越陡越好