基于arm7的最小系統(tǒng)設(shè)計報告(編輯修改稿)
2024-12-18 15:37 本頁面
【文章內(nèi)容簡介】 兩個中斷請求輸入信號。 nFIQ 為快速中斷請求， nIRQ 為一般中斷請求。 8) 初始化 nRESET 信號用來復(fù)位、啟動處理器，處理器從地址 0x00000000 開始執(zhí)行程序。 9) Debug 接口 ARM7TDMI 實現(xiàn)了典型的 ARM 調(diào)試結(jié)構(gòu)。 EmbeddedICE 模塊包含斷點和觀察點寄存器，使運行的代碼能夠停下來以便調(diào)試。當(dāng)遇到斷點或觀察點時，處理器停下來并進入調(diào)試狀態(tài)。一旦進入調(diào)試狀態(tài)，就可使用掃描鏈 1強制指令進入指令流水線，檢查處理器的寄存器。對所有寄存器的數(shù)據(jù)進行存儲，將它們的值送到數(shù)據(jù)總線，在數(shù)據(jù)總線上再用掃描鏈 1采樣并移出。訪問特權(quán)模式寄存器需要強制加入指令來改變模式（注意，在調(diào)試狀態(tài)，阻止從用戶狀態(tài)轉(zhuǎn)換到特權(quán)模式的障礙已不存在）。 若需檢查系統(tǒng)狀態(tài)，可讓 ARM 以系統(tǒng)速度訪問存儲器，然后立即 切換回調(diào)試狀態(tài)。調(diào)試接口可擴展集成的 EmbeddedICE 宏單元所提供的功能，它使外部硬件能夠支持調(diào)試（通過 DBGEN），并發(fā)出異步的調(diào)試請求（在 DBGRQ 端口）或與指令同步的請求（在 BREAKPT 端口）。外部硬件通過 DBGACK 得知處理器核何時處于調(diào)試模式。內(nèi)部調(diào)試請求信號在 DBGRQI 輸出。 外部事件可通過 EXTERN0 和 EXTERN1 來觸發(fā)觀察點，而 EmbeddedICE 觀察點的匹配則由 RANGEOUT0 和 RANGEOUT1 端口的信號表示。 如果通信發(fā)送緩沖器是空的，則在 COMMTX 端口發(fā)出信號；如果 接收緩沖器是空的，則在 COMMRX 端口發(fā)出信號。 處理器在 nEXEC 端口指示當(dāng)前在執(zhí)行級的指令是否被執(zhí)行。如果指令沒有被執(zhí)行，則表示它的條件碼測試失敗了。 10) 電源 ARM7TDMI 核應(yīng)在正常 5V 或 3V 電源電壓下工作，這主要依賴于制作工藝和在核中使用的電路設(shè)計形式。 11) JTAG 接口 JTAG 控制信號符合標(biāo)準(zhǔn)的規(guī)定，這些控制信號通過專用引腳連到片外測試控制器。 12) TAP 信息 這些信號用來支持對 JTAG 系統(tǒng)增加更多的掃描鏈。 TAPSM[3:0]指示 TAP 控制器所處的狀態(tài)， IR[3:0]給出 TAP 指令寄存器的內(nèi)容， SCREG[3:0]是 TAP 控制基于 ARM7的 S3C44B0最小系統(tǒng)設(shè)計 摘要 器當(dāng)前所選擇的掃描寄存器的地址， TCK1 和 TCK2 形成一對非重疊時鐘來控制擴展掃描鏈， nTDOEN 指示何時在 TD0 有串行數(shù)據(jù)輸出。 S3C44B0 概述 S3C44B0 概述 S3C44B0X 微處理器是三星公司生產(chǎn)的基于 ARM7TDMI 核的微處理器，采用 CMOS 工藝制造，并在 ARM7TDMI 核基本功能的基礎(chǔ)上集成了豐富的外圍功能模塊，便于低成本設(shè)計嵌入式應(yīng)用系統(tǒng)。片上集成的主要功能如下： ? 在 ARM7TDMI 基礎(chǔ)上增加 8 KB 的 cache。 ? 外部擴充 存儲器控制器（ FP/EDO/SDRAM 控制，片選邏輯）。 ? LCD 控制器（最大支持 256色的 DSTN），并帶有 1個 LCD 專用 DMA 通道。 ? 2個通用 DMA通道 /2 個帶外部請求引腳的 DMA通道。 ? 2個帶有握手協(xié)議的 UART 和 1個 SIO。 ? 1個多主的 I178。C總線控制器。 ? 1個 IIS總線控制器。 ? 5個 PWM定時器及 1個內(nèi)部定時器。 ? 看門狗定時器。 ? 71個通用可編程 I/O 口， 8 個外部中斷源。 ? 功耗控制模式是正常、低、休眠和停止。 ? 8路 10位 ADC。 ? 具有日歷功能的 RTC（實時時鐘）。 ? PLL 時鐘發(fā)生器。 S3C44B0X 引腳如圖 所示。 基于 ARM7的 S3C44B0最小系統(tǒng)設(shè)計 摘要 D A T A 1 3 D A T A 1 2 D A T A 1 1 D A T A 1 0 V D D I O V SS I O D A T A 9 D A T A 8 D A T A 7 D A T A 6 D A T A 5 D A T A 4 D A T A 3 D A T A 2 D A T A 1 D A T A 0 A D D R2 3 G P A 9 V D D V SS A D D R2 3 G P A 8 A D D R2 2 G P A 7 A D D R2 1 G P A 6 A D D R2 0 G P A 5 A D D R1 9 G P A 4 A D D R1 8 G P A 3 A D D R1 7 G P A 2 A D D R1 6 G P A 1 A D D R1 5 A D D R1 4 A D D R1 3 A D D R1 2 V SS I O A D D R1 1 A D D R1 0 A D D R9 A D D R8 A D D R7 A D D R6 A D D R5 A D D R4 121 122 124 125 126 127 128 129 130 131 132 133 134 135 136 137 138 139 140 141 142 143 144 145 146 147 148 149 150 151 152 153 154 155 156 157 158 159 160 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 80 79 78 77 76 75 74 73 72 71 70 69 68 67 66 65 64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49 48 47 46 45 44 43 42 41 81 82 83 84 85 86 87 88 89 90 91 92 93 94 95 96 97 98 99 100 101 102 103 104 105 106 107 108 109 110 111 112 113 114 115 116 117 118 119 120 EXINT6MSDOGPG6 EXINT5MSDOGPG5 EXINT4MSDOGPG4 EXINT3MSDOGPG3 EXINT2MSDOGPG2 VSS VDD EXINT1ND5GPG1 EXINT0ND5GPG0 NXDACKOnXBACKGPF3 nXDRCKOnXBACKGPF4 nWAITGPF2 SCLKGPB1 SCKEGPB0 nGCS7mSCS1mRAS1 nGCS6mSCS0mRAS0 nGCS5GPB10 nGCS4GPB9 VSS VDD nGCS3GPB8 nGCS2GPB7 nGCS1GPB6 nGCS0 nWE nOE nBE3nWBE3DQM3GPB5 nBE2nWBE2DQM2GPB4 nBE1nWBE1DQM1 nBE0nWBE0DQM0 VSSIO VDDIO nCAS3nSRASGPB3 nCAS2nSCASGPB2 nCAS1 nCAS0 ADDRGGPA0 ADDR1 ADDR2 ADDR3 AN5 AN4 AN3 A N2 AN1 AN0 V SSA D C V SS I D T O U T 4 / V D 7 G PE 7 T O U T 3 / V D
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