數(shù)字電路第五版(康華光)課后答案(編輯修改稿)
2024-07-25 14:43 本頁面
【文章內(nèi)容簡介】 若 T1 管導(dǎo)通，則 VB1=+=。而若 VB1 時，將使 T1 的集電結(jié)正偏，T2，T3 處于飽和狀態(tài)，這時VB1 被鉗位在 ，即 T1 的發(fā)射結(jié)不可能處于導(dǎo)通狀態(tài)，而是處于反偏截止。由（1）（2），當(dāng) VB1≥，與非門輸出為低電平。 （4） 與非門輸入端接 10kΩ的電阻到地時，教材圖 的與非門輸入端相當(dāng)于解 圖所示。這時輸入電壓為 VI=(VccVBE)=10（）／（10+4）=。若 T1 導(dǎo)通，則 VBI=+ VBE=+= V。但 VBI 是個不可能大于 的。當(dāng) VBI= 時，將使 T1 管的集電結(jié)正偏，T2，T3 處于飽和，使 VBI 被鉗位在 ，因此，當(dāng) RI=10kΩ時，T1 將處于截止?fàn)顟B(tài)，由（ 1 ）這時相當(dāng)于輸入端輸入高電平。 設(shè)有一個 74LS04 反相器驅(qū)動兩個 74ALS04 反相器和四個 74LS04 反相器。（1）問驅(qū)動門是否超載？（2）若超載，試提出一改進方案；若未超載，問還可增加幾個 74LS04 門？ 解：（1）根據(jù)題意，74LS04 為驅(qū)動門，同時它有時負載門，負載門中還有 74LS04。 從主教材附錄 A 查出 74LS04 和 74ALS04 的參數(shù)如下（不考慮符號） 74LS04：IOL(max) =8mA, IOH (max) =。 IIH(max) =. 4 個 74LS04 的輸入電流為：4 IIL(max) =4 =, 4 IIH(max) =4 = 2 個 74ALS04 的輸入電流為：2 IIL(max) =2 =, 2 IIH(max) =2 =。 ① 拉電流負載情況下如圖題解 （a）所示，74LS04 總的拉電流為兩部分，即 4 個74ALS04 的高電平輸入電流的最大值 4 IIH(max) = 電流之和為+= 74LS04 能提供 的拉電流，并不超載。 ② 灌電流負載情況如圖題解 （b）所示，驅(qū)動門的總灌電流為 +=. 而 74LS04 能提供 8mA 的灌電流，也未超載。 （2）從上面分析計算可知，74LS04 所驅(qū)動的兩類負載無論書灌電流還是拉電流均未超 圖題 所示為集電極門 74LS03 驅(qū)動 5 個 CMOS 邏輯門，已知 OC 門輸管截止時的漏電流=；負載門的參數(shù)為：=4V,=1V,==1A 試計算上拉電阻的值。 從主教材附錄 A 查得 74LS03 的參數(shù)為：VOH(min) =，VOL(max) =，IOL(max) =（）形式（）可以計算出上拉電阻的值。灌電流情況如圖題解 （a）所示，74LS03 輸 出 為 低 電 平 ， IIL total( ) =5 IIL =5 =, 有 Rp(min) = VDD ?VOL(max) = (5?4)V ≈ IOL(max) ?IIL total( ) (8?)mA拉電流情況如圖題解 （b）所示，74LS03 輸出為高電平， IIH total( ) =5 IIH =5 = 由于VOH(min) VIH(min) 為了保證負載門的輸入高電平，取VOH(min) =4V 有 RP(max) = VDD ?VoH(min) = (5?4)V = IOL total( ) +IIH total( ) (?)mA綜上所述，RP 的取值范圍為 ～ 設(shè)計一發(fā)光二極管(LED)驅(qū)動電路,設(shè) LED 的參數(shù)為VF =, ID =。若VCC =5V,當(dāng) LED 發(fā)亮?xí)r,電路的輸出為低電平,選出集成門電路的型號,并畫出電路圖. 解:設(shè)驅(qū)動電路如圖題解 所示,選用 74LSO4 作為驅(qū)動器件,它的輸出低電平電流mA, =8V,=電路中的限流電阻 )max(OLImax)(OLVR=(max)OLFCCDVVVI??=)(5vmA??≈444Ω 第四章 組合邏輯 習(xí)題解答 4．1．2 組合邏輯電路及輸入波形（），試寫出輸出端的邏輯表達式并畫出輸出波形。 解：由邏輯電路寫出邏輯表達式 L = AB+ AB = A B 首先將輸入波形分段，然后逐段畫出輸出波形。 ，輸出為1，不同時，輸出為0，得到輸出波形。 如圖所示 4．2．1 試用2輸入與非門設(shè)計一個3輸入的組合邏輯電路。當(dāng)輸入的二進制碼小于3時，輸出為0；輸入大于等于3時，輸出為1。 解： 根據(jù)組合邏輯的設(shè)計過程，首先要確定輸入輸出變量，列出真值表。由卡諾圖化簡得到最簡與或式，然后根據(jù)要求對表達式進行變換，畫出邏輯圖 1） ，根據(jù)題意列真值表 A B C L 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 1 1 0 0 1 1 0 1 1 1 1 0 1 1 1 1 1 2） 由卡諾圖化簡，經(jīng)過變換得到邏輯表達式 *LABCABC=+= 3） 用2輸入與非門實現(xiàn)上述邏輯表達式 4．2．7 某足球評委會由一位教練和三位球迷組成，對裁判員的判罰進行表決。當(dāng)滿足以下條件時表示同意；有三人或三人以上同意，或者有兩人同意，但其中一人是叫教練。試用2輸入與非門設(shè)計該表決電路。 解： 1），并且這些輸入變量為1時表示同意，為0時表示不同意，輸出L表示表決結(jié)果。L為1時表示同意判罰，為0時表示不同意。由此列出真值表 輸入 輸出 A B C D L 0 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 1 1 0 0 1 0 0 0 0 1 0 1 0 0 1 1 0 0 0 1 1 1 1 1 0 0 0 0 1 0 0 1 1 1 0 1 0 1 1 0 1 1 1 1 1 0 0 1 1 1 0 1 1 1 1 1 0 1 1 1 1 1 1 2）由真值表畫卡諾圖 由卡諾圖化簡得L=AB+AC+AD+BCD 由于規(guī)定只能用2輸入與非門，將上
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