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正文內(nèi)容

pcm通信系統(tǒng)設(shè)計說明書(編輯修改稿)

2025-06-09 22:34 本頁面
 

【文章內(nèi)容簡介】 同步信號和位同步信號把四路數(shù)據(jù)分開,然后通過移位寄存器構(gòu)成的并/串轉(zhuǎn)換電路輸出串行的數(shù)據(jù)。 3 電路設(shè)計在本實(shí)驗(yàn)中我們選擇TP3067進(jìn)行A律變換,信息幀為無信令幀,它的發(fā)送時序與接收時序直接受FSx和FSR控制。系統(tǒng)上電:當(dāng)開始上電瞬間,加壓復(fù)位電路啟動COMBO并使它處于掉電狀態(tài),所有非主要電路都失效,而Dx、VFRO、VPO、VPO+均處于高阻抗?fàn)顟B(tài)。為了使器件上電,一個邏輯低電平或時鐘脈沖必須作用在MCLKR/PDN引腳上,并且FSx和FSR脈沖必須存在。于是有兩種掉電控制模式可以利用。在第一種中MCLKR/PDN引腳電位被拉高。在另一種模式中使FSx和FSr二者的輸入均連續(xù)保持低電平,在最后一個FSx或FSr脈沖之后相隔2ms左右,器件將進(jìn)入掉電狀態(tài),一旦第一個FSx和FSr脈沖出現(xiàn),上電就會發(fā)生。三態(tài)數(shù)據(jù)輸出將停留在高阻抗?fàn)顟B(tài)中,一直到第二個FSx脈沖出現(xiàn)。 系統(tǒng)時序:幀同步工作:COMBO既可以用短幀,也可以用長幀同步脈沖。在加電開始時,器件采用短幀模式,在這種模式中,F(xiàn)Sx和FSr這兩個幀同步脈沖的長度均為一個位時鐘周期。在BCLKx的下降沿當(dāng)FSx為高時,BCLKx的下一個上升沿可啟動輸出符號位的三態(tài)輸出Dx的緩沖器,緊隨其后的7個上升沿以時鐘送出剩余的7個位,而下一個下降沿則阻止Dx輸出。在BCLKR的下降沿當(dāng)FSr為高時(BCLKx在同步模式),其下一個下降沿將鎖住符號位,跟隨其后的7個下降沿鎖住剩余的7個保留位。長幀同步工作:為了應(yīng)用長幀模式,F(xiàn)Sx和FSr這兩個幀同步脈沖的長度應(yīng)等于或大于位時鐘周期的三倍。在64KHz工作狀態(tài)中,幀同步脈沖至少要在160ns內(nèi)保持低電位。隨著FSx或BCLKx的上升沿(無論哪一個先到)來到,Dx三態(tài)輸出緩沖器啟動,于是被時鐘移出的第一比特為符號位,以后到來的BCLKx的7個上升沿以時鐘移出剩余的7位碼。隨著第8個上升沿或FSx變低(無論哪一個后發(fā)生),Dx輸出由BCLKx的下降沿來阻塞,在以后8個BCLKR的下降沿(BCLKR),接收幀同步脈沖FSR的上升沿將鎖住DR的PCM數(shù)據(jù)。編譯碼器的工作是由時序電路控制的。在編碼電路中,進(jìn)行取樣、量化、編碼,譯碼電路經(jīng)過譯碼低通、放大后輸出模擬信號,這個時序號是由A/D控制電路來決定的,而在其它時隙時編碼器是沒有輸出的。同樣在一個PCM幀里,它的譯碼電路也只能在一個由它自己的時序里,從外部接收8位PCM碼。單路編譯碼器的發(fā)送時序和接收時序可由外部電路來控制。只要向A/D控制電路或D/A控制電路發(fā)某種命令即可控制單路編譯碼器的發(fā)送時序和接收時序號,從而也可以達(dá)到總線交換的目的。不同的單路編譯碼器對其發(fā)送時序和接收時序的控制方式都有所不同,有些編譯碼器有二種方式,一種是編程法,即給它內(nèi)部的控制電路輸進(jìn)一個控制字,分配其時隙;另一種是直接控制,這時它有兩個控制端,我們定義為FSx和FSR,它們是周期性的,并且它的周期和多路PCM的幀周期相同,為125μs,這樣,每來一個FSx,編譯碼器就輸出一個PCM碼字,每來一個FSR,編譯碼器就從外部輸入一個PCM碼字。編譯碼器一般都有一個PDN降功耗控制端,PDN=l時,編譯碼能正常工作,PDN=0時,編譯碼器處于低功耗狀態(tài),這時編譯碼器其它功能都不起作用,我們在設(shè)計時,可以接MUC等控制芯片以實(shí)現(xiàn)對編譯碼器的降功耗控制??紤]到系統(tǒng)時鐘頻率較高,本系統(tǒng)利用VHDL設(shè)計pcm編碼芯片的控制,生成時鐘信號,發(fā)送時添加幀同步碼,. ,再經(jīng)分頻分相后得到8KHz的幀同步時鐘.幀同步碼的添加是在時鐘信號控制下輸出幀同步碼的時隙中對預(yù)置幀同步編碼逐位輸出實(shí)現(xiàn)的. 幀同步信號的提取是用在時鐘信號控制下信號通過移位寄存器構(gòu)成的并/串轉(zhuǎn)換電路的輸出信號與與置信號比較而實(shí)現(xiàn)的,幀同步信號的頻率為位同步信號的256分之一。撥碼開關(guān)SW1, SW1可分別設(shè)
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