采用高速16位adc及無(wú)線基站設(shè)計(jì)挑戰(zhàn)(編輯修改稿)
2025-02-09 19:46 本頁(yè)面
【文章內(nèi)容簡(jiǎn)介】 濾波器提供了四階高頻衰減以實(shí)現(xiàn)40 dB二級(jí)諧波（H2）衰減， dB。LC T匹配提供了阻抗轉(zhuǎn)換功能，可以實(shí)現(xiàn)較小的通帶衰減，并保持DVGA輸入源電阻和負(fù)載電阻之間的阻抗匹配。 這種結(jié)構(gòu)只需要將電容元件和多數(shù)串聯(lián)電感進(jìn)行并聯(lián)，因此對(duì)于PCB寄生干擾極不敏感，并且能夠真正付諸實(shí)踐。通過(guò)在濾波器LC庫(kù)中對(duì)于電容的經(jīng)驗(yàn)性選擇，可以緩解ADC的充電反沖，而濾波器LC庫(kù)則同時(shí)具備差分和普通模式兩種排列分布。在本設(shè)計(jì)方案中，通過(guò)源電阻阻值的降低，通帶衰減由5 dB縮小至0 dB。衰減性能改進(jìn)的同時(shí)無(wú)法實(shí)現(xiàn)完美的阻抗匹配，但卻使DVGA能夠得到較小輸出幅度的ADC全范圍參考值。 圖2 DVGA和ADC之間的帶通濾波器接口對(duì)于較大的輸入信號(hào)而言，ADC輸入時(shí)鐘的質(zhì)量對(duì)于限制系統(tǒng)實(shí)現(xiàn)信噪比SNR十分關(guān)鍵。時(shí)鐘的邊緣抖動(dòng)會(huì)影響ADC的定期采樣時(shí)間，并增加信號(hào)噪聲。公式（1）給出了在出現(xiàn)抖動(dòng)的情況下可以實(shí)現(xiàn)的最大信噪比，fin是輸入信號(hào)頻率，sJ是rms抖動(dòng)，a是以最大電平基準(zhǔn)分貝dBFS為測(cè)量單位的輸入信號(hào)幅度，這樣即使較小的信號(hào)幅度也能出現(xiàn)較大的負(fù)值。該公式有三個(gè)要點(diǎn)：一是相比更高的頻率，抖動(dòng)更能降低信噪比SNR；二是信號(hào)越大，抖動(dòng)對(duì)于信噪比SNR的限制影響越明顯；三是可以通過(guò)降低整體抖動(dòng)來(lái)提供信噪比SNR。
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