第二章、mcs-51單片機硬件結構(編輯修改稿)
2025-11-16 21:49 本頁面
【文章內容簡介】 讀 ROM新的地址； P0. 0 P1. 0 P2. 0 P3. 0 ?4個 8位并行 I/O口： P0， P1， P2， P3； ?均可作為雙向 I/O端口使用。 (1)特點： P0： 訪問片外擴展存儲器時， 復用為低 8位地址線和數(shù)據線 ※ 用作輸入時，均須先寫入 “ 1” ； 用作輸出時， P0口應外接上拉電阻。 P2： 高 8位地址線。 P1： 雙向 I/O端口 P3： 第二功能 1 2 3 4 5 6 7 8 9 10111213141516171819 20 40 39 38 37 36 35 34 33 32 3130292827262524242221 8031 8051 8751 89C51 并行輸入 /輸出電路結構 ※ P0口的 負載能力 為 8個 LSTTL門電路； P1～ P3口的負載能力為 4個 LSTTL門電路。 單片機的引腳（ P0口） —: 雙向 I/O （內置場效應管上拉） 尋址外部程序存儲器時分時作為雙向 8位數(shù)據口和輸出低 8位地址復用口；不接外部程序存儲器時可作為 8位準雙向 I/O口使用。 （ P23) 2 1 D Q CK /Q 讀引腳 讀鎖存器 寫鎖存器 內部總線 地址 /數(shù)據 控制 引腳 3 4 Vcc V1 V2 2 1 D Q CK /Q 讀引腳 =1 讀鎖存器 寫鎖存器 內部總線 地址 /數(shù)據 控制 引腳 3 4 0 0 1 0 0 截止 截止 =0 Vcc P0用作通用 I/O時，控制 =0 ： （ 1）此腳作輸入口（事先必須對它寫“ 1”） V2 V1 2 1 D Q CK /Q 讀引腳 讀鎖存器 寫鎖存器 內部總線 地址 /數(shù)據 控制 引腳 3 4 0 0 1 0 0 截止 截止 =0 Vcc P0用作通用 I/O時，控制 =0 ： （ 2）此腳作輸出口時， 當 P0口用作輸出口時，因 輸出級處于開漏狀態(tài)，必須外接上拉電阻。 當“寫鎖存器”信號加在鎖存器的時鐘端 CLK上，此時 D觸發(fā)器將“內部總線”上的信號反相后輸出到 Q端，若 D端信號為 0， Q=1， v2導通， P0． x引腳輸出“ 0”；若 D端信號為 1， Q=0， v2截止，雖然 V1截止，因 P0． x引腳已外接上拉電阻， P0． x引腳輸出“ 1”。 V2 V1 2 1 D Q CK /Q 讀引腳 =0 讀鎖存器 寫鎖存器 內部總線 地址 /數(shù)據 控制 =1 引腳 3 4 1 0 1 1 =0 導通 截止 =0 Vcc P0口用作地址 /數(shù)據復用口，控制 =1 （ 1）作地址 /數(shù)據輸出：輸出地址 /數(shù)據 =0 時 V1 V2 2 1 D Q CK /Q 讀引腳 =0 讀鎖存器 寫鎖存器 內部總線 地址 /數(shù)據 控制 =1 引腳 3 4 1 1 0 0 =1 截止 導通 =1 Vcc P0口用作地址 /數(shù)據復用口，控制 =1 （ 2）作地址 /數(shù)據輸出：輸出地址 /數(shù)據 =1 時 V1 V2 2 1 D Q CK /Q 讀引腳 =1 讀鎖存器 寫鎖存器 內部總線 地址 /數(shù)據 控制 =0 引腳 3 4 Vcc P0口用作地址 /數(shù)據復用口 （ 3）作 /數(shù)據輸入： 與 P0用作通用 I/O時輸入時情況相同， CPU使V V2均截止，從 引腳上輸入的外部數(shù)據經緩沖器 U2進入內部數(shù)據總線。 V1 V2 注意讀端口與讀鎖存器的區(qū)別， P1,P2,P3結構上的區(qū)別（電阻） 1 1 1 1 1 1 1 1 00000000ALE WR RD P1. 0 P1. 1 P1. 2 P1. 3 P1. 4 P1. 5 P1. 6 P1. 7 指令 1： MOV P1,00H 指令 2： MOV P1,0FFH 指令 3： MOV P1,0AAH 輸出舉例 指令 4： CLR 指令 5： SETB +5V 下一頁 1)時鐘振蕩電路 8051單片機的基本組成時鐘電路與復位電路 80C51單片機內有一高增益反相放大器，按圖 28a連接即可構成自激振蕩電路，振蕩頻率取決于石英晶體的振蕩頻率 . 參見 P26圖 29 時鐘周期和機器周期 ⑴ 時鐘周期（振蕩周期） 80C51振蕩器產生的時鐘脈沖頻率的倒數(shù)，是最基本最小的定時信號。 ⑵ 狀態(tài)周期 它是將時鐘脈沖二分頻后的脈沖信號。狀態(tài)周期是時鐘周期的兩倍。狀態(tài)周期 又稱 S周期。在 S周期內有兩個時鐘周期，即分為兩拍，分別稱為 P1和 P2 P1 P2 S1 P2 振蕩周期 狀態(tài)周期 機器周期 機器周期 指令周期 XTAL2 (OSC) S2 S3 S4 S5 S6 S1 S2 S4 S5 S3 S6 P1 P1 P1 P1 P1
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