基于vhdl電子日歷的設(shè)計(jì)(完整版)
【正文】 各模塊程序，進(jìn)一步了解和掌握各個(gè)程序語(yǔ)言，知道編程中的注意事項(xiàng)，提高編程的熟練程度。 關(guān)鍵詞：EDA、電子日歷、VHDL、QuartusII目錄第一章 緒論 1 EDA技術(shù) 1 QuartusII的使用 1 模塊化設(shè)計(jì) 1 分析、解決問(wèn)題 1第二章 總體設(shè)計(jì) 2 2 2 3第三章 設(shè)計(jì)原理 4 4 4 5第四章 設(shè)計(jì)結(jié)果 6 6 6 7 8 9 10 12 14 17 17 18第五章 參考文獻(xiàn) 19第一章 緒論 EDA技術(shù)EDA（Electronic Design Automation），即電子設(shè)計(jì)自動(dòng)化，是指利用計(jì)算機(jī)完成電子系統(tǒng)的設(shè)計(jì)。 系統(tǒng)目標(biāo)芯片采用EP1K30TC1443，由時(shí)鐘模塊、控制模塊、計(jì)時(shí)模塊、數(shù)據(jù)譯碼模塊、顯示模塊組成。 QuartusII的使用 通過(guò)實(shí)驗(yàn)，熟悉并掌握QuartusII軟件的使用，熟悉該軟件工具的環(huán)境。3）用層次化設(shè)計(jì)方法設(shè)計(jì)該電路，編寫(xiě)各個(gè)功能模塊的程序。5）書(shū)寫(xiě)實(shí)驗(yàn)報(bào)告應(yīng)結(jié)構(gòu)合理，層次分明。低位計(jì)滿(mǎn)歸零并且向高位進(jìn)1。 COUT:OUT STD_LOGIC)。039。 ELSE COUT=39。仿真結(jié)果：圖41 60進(jìn)制計(jì)數(shù)器仿真圖如上圖所示當(dāng)2計(jì)滿(mǎn)60時(shí)，2都?xì)w零同時(shí)有一個(gè)進(jìn)位輸出脈沖，完成了六十進(jìn)制計(jì)數(shù)器的功能，設(shè)計(jì)正確。END CNT24。)。039。星期模塊為“7進(jìn)制”的計(jì)數(shù)器源程序：LIBRARY IEEE。BEGIN PROCESS(CLK) BEGIN IF CLK39。 W=Q11。USE 。EVENT AND CLK=39。 IF CQ4=3 AND CQ3=0 THEN CQ4=0000。CQ1=CQ3。 cq1,cq2 :OUT STD_LOGIC_VECTOR(3 DOWNTO 0))。cq3=0000。END IF。USE 。EVENT AND CLK=39。 IF Q2=9 AND Q1=9 THEN Q2=0000。END PROCESS。 Y3,Y4:OUT STD_LOGIC_VECTOR(3 DOWNTO 0)。 IF Q11=9 THEN Q11=(OTHERS=39。139。END。 WI,DI,MI,YLI,YHI:IN STD_LOGIC。 IF A=5 THEN A=0000。 模式0正常計(jì)時(shí) WHEN 0001=WO=K2。039。YHO=39。039。039。MO=39。END。ARCHITECTURE ONE OF CONTROL ISBEGINQ10=Y1H。Q2=WH。第五章 參考文獻(xiàn)[1] 潘松 黃繼業(yè) EDA技術(shù)實(shí)用教程—VHDL版（第四版）北京：科學(xué)出版社，2010[2] 王金明， ：電子工業(yè)出版社，2002 [3] 潘松 等 EDA技術(shù)與Verilog HDL北京：清華大學(xué)出版社，[4] 江國(guó)強(qiáng)編著. EDA技術(shù)與實(shí)用(第三版). 北京：電子工業(yè)出版社，2011.[5] 曹昕燕，：清華大學(xué)出版社,[6] ：高等教育出版社，2003.[7] Mark Zwolinski. Digital System Design with ：電子工業(yè)出版社，2008[8] Alan B. Marcovitz Introduction to logic ：電子工業(yè)出版社，200323。 END。Q8=YH。源程序：LIBRARY IEEE。YLO=39。YHO=39。039。 選通日模塊，調(diào)日 WHEN 0011=WO=39。039。039。 END IF。END JIAODUI。 如原理圖的說(shuō)明部分所述，校時(shí)模塊進(jìn)行工作模式的選擇，輸入端設(shè)有控制按鍵K1，K2。039。)。END YEAR。Y2=Q2。COUT=39。 THEN Q1=Q1+1。ENTITY YEAR IS PORT(CL
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