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畢業(yè)設(shè)計-基于fpga的lcd驅(qū)動顯示電路的設(shè)計與實現(xiàn)-文庫吧在線文庫

2025-01-16 19:32上一頁面

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【正文】 3S15004FG676C),采用 90nm 技術(shù)的當前先進處理能力,使設(shè)計者更加充分了解學(xué)習(xí)。使FPGA 在系統(tǒng)級應(yīng)用上與傳統(tǒng)的計算機技術(shù)結(jié)合,實現(xiàn)了一種全新的設(shè)計流程。d7999999) //7999999 次分頻 begin num=num+1。 //液晶顯示的初始化階段 if(datat==0) begin data=439。 datat=0。 state=set_ddramaddup。b1100。b1。 state=write_dataup4_2。經(jīng)過調(diào)試,系統(tǒng)功能成立,系統(tǒng)運行正常。其次,最初對系統(tǒng)沒有一個完整的概貌,考慮 的 不是很全面,所以系統(tǒng)功能 開發(fā) 時,碰到不少困難。在這四年的學(xué)期中結(jié)識的各位生活和學(xué)習(xí)上的摯友讓我得到了人生最大的一筆財富。 東北大學(xué)東軟信息學(xué)院畢業(yè)設(shè)計(論文) 參考文獻 25 參考文獻 [1] 楊恒 . FPGA/CPLD 最新實用技術(shù)指南 [M], 北京 : 清華大學(xué)出版社 , 2021. [2] 劉皖 . FPGA 設(shè)計與應(yīng)用 [M], 北京 : 清華大學(xué)出版社 , 2021. [3] 潘松 . EDA 技術(shù)實用教程 [M], 北京 : 科學(xué)出版社 , 2021. [4] 朱正偉 . 數(shù)字電路邏輯設(shè)計 [M], 北京 : 清華大學(xué)出版社 , 2021. [5] 李維 . 液晶顯示應(yīng)用技術(shù) [M], 北京 : 電 子工業(yè)出版社 , 2021. [6] [英 ]渥倫斯基 . VHDL 數(shù)字系統(tǒng)設(shè)計 [M], 北京 : 電子工業(yè)出版社 , 2021. [7] 郭振東 , 常昌云 , 吳金等 . STNLCD 顯示驅(qū)動技術(shù) [J], 電子器件 , 2021(4): 338345. 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Completion detecting carry select addition[ J] ,Proceedings Comp. Digit. Tech,2021,2:91- 98. 東北大學(xué)東軟信息學(xué)院畢業(yè)設(shè)計(論文) 參考文獻 26 [18] 李哲英 .數(shù)字集成電路設(shè)計 [M],北京 :機械工業(yè)出版社 ,2021. [19] 童詩白 .模擬電子技術(shù)基礎(chǔ) [M],北京 :高等教育出版社 ,2021. [20] 張春 ,麥宋平 ,趙益新 .System Verilog 驗證 [M],北京 :科學(xué)出版社 ,2021. 東北大學(xué)東軟信息學(xué)院畢業(yè)設(shè)計(論文) 致謝 27 致 謝 在此論文撰寫過程中,要特別感謝我的導(dǎo)師 田勇講師 的指導(dǎo)與督促,同時感謝 他 的諒解與包容。 顯示在液晶顯示器上的內(nèi)容可以左右移動 。 本課題使用 Xilinx ISE 對系統(tǒng)進行了波形圖,電路等幾 個方面的測試。 datat=0。 state=write_dataup4_2。 end 東北大學(xué)東軟信息學(xué)院畢業(yè)設(shè)計(論文) 第 5章 系統(tǒng)實現(xiàn) 21 end set_ddramaddup: begin lcd_rs=0。 data= myramup[datat][7:4]。b1000。 lcd_rs=139。其中一個輸入端是clk 表示的是時鐘發(fā)生信號;另一個輸入端是 reset,表示的是復(fù)位信號; data[3:0]是一個東北大學(xué)東軟信息學(xué)院畢業(yè)設(shè)計(論文) 第 5章 系統(tǒng)實現(xiàn) 18 輸出端,表示的是輸出一個四位字節(jié)的數(shù)據(jù)。開發(fā)板框圖如圖 所示。在執(zhí)行完 S4 狀態(tài)的每條語句后跳轉(zhuǎn)到 S5 狀態(tài)。要顯示字符時要先輸入顯示字符地址,也就是告訴模塊在哪里顯示字符, 圖 是 TC1602 液晶模塊的內(nèi)部顯示地址。控制單元生成的數(shù)據(jù)發(fā)送到數(shù)據(jù)通道所需的信號,同時接收來自數(shù)據(jù)通道處理過的狀態(tài)信號,到達監(jiān)控整個設(shè)計單元實現(xiàn)的過程。 RS 為寄存器選擇控制輸出信號,當 RS 為低電平時,表示數(shù)據(jù)總線傳輸?shù)氖敲羁刂菩盘枺?RS 為高電平時,表示數(shù)據(jù)總線傳 輸?shù)氖菙?shù)據(jù)信號; RW 為讀 /寫控制輸出信號,當 RW 為低電平時,表示向液晶顯示屏控制芯片寫數(shù)據(jù),反之,為讀取數(shù)據(jù); E 為讀 /寫操作允許控制脈沖輸出信號,高電平有效; data 為數(shù)據(jù)信號。 指令 10:寫數(shù)據(jù) 。功能:將 CGRAM 地址送入 AC 中。功能: S/C 和 R/L 對應(yīng)操作: 0 0:光標由右向左移動且 AC 減一。 I/D 表示計算機讀 /寫 DDRAM 或 CGRAM 后,地址的修改方式,也是光標的移動方式: I/D=0:光標自右往左移動, AC 減一。它的讀寫操作、屏幕和光標的操作都是通過指令編程來實現(xiàn)的。 第 6 腳: E 端為使能端,當 E 端由高電平轉(zhuǎn)變?yōu)?低電平時,液晶模塊 開始 執(zhí)行命令。一般認為 Verilog HDL 在系統(tǒng)級抽象方面比 VHDL 略差 一些,而在門級開關(guān)電路描述方面比 VHDL 強得多。 VHDL 其英文全名為 VHSIC HARDWARE DESCRIPTION Language, 而 VHSIC 則東北大學(xué)東軟信息 學(xué)院 畢業(yè)設(shè) 計(論文) 第 3章 系統(tǒng)分析 8 是 Very High Speed Integerated CIRCUIT 的縮寫詞, 譯為 甚高速集成電路 ,所以 VHDL準確的中文譯名為甚高速集成電路的硬件描述語言。簡單的語言描述就可以完成復(fù)雜的功能,且 不需要手工繪圖。 “自頂向下”的優(yōu)越性是 比較顯而易見的。ModelSim 采用直接優(yōu)化的編譯技術(shù), Tcl/TK 技術(shù)和單一內(nèi)核仿真技術(shù),使在編譯仿真時候速度快,編譯的代碼與平臺關(guān)系無關(guān),便于保護 IP 核,個性化的圖形界面和用戶接口,全面支持 VHDL 和 Verilog 語言對 IEEE 標準的準確,除眾多優(yōu)勢之外,它還能夠支持 C/C++功能調(diào)試和調(diào)用。 C(寬溫) 工作電流: 屏幕視域尺寸: 二、 TC 1602 字符液晶 模塊特點 可與 8 位或者 4 位微處理器直接連接; 內(nèi)置字符發(fā)生器 ROM 可提供 160 種工業(yè)標準字符,包括全部大小寫字母、阿拉伯數(shù)字及日文片假名,以及 32 個特殊字符或符號顯示; 內(nèi)置 RAM 可根據(jù)用戶需要,自行設(shè)計定義字符或符號; 東北大學(xué)東軟信息學(xué)院畢業(yè)設(shè)計(論文) 第 2章 關(guān)鍵技術(shù)介紹 6 +5V 單電源供電; 低功耗。多數(shù)大屏幕液晶顯示器還配備了其它模擬視頻輸入接口和 毫米音頻輸入接口以供多媒體應(yīng)用,部分產(chǎn)品甚至還配 備 USB Hub。 FPGA 是 ASIC 電路中 開發(fā)費用最低、設(shè)計 周期最短、風(fēng)險最小的器件之一 LCD 簡介 2. LCD 的簡介 LCD 顯示器 是 Liquid Crystal Display 的簡稱, LCD 液晶顯示器 的構(gòu)造是在兩片平行的玻璃 之 中放 入 液態(tài)的晶體,兩片玻璃 的中間含 有 很 多垂直 的 和水平的細小電線, 通過 為 不同的液晶單元供 電 來控制桿狀水晶分子 方向 的 改變,將光線折射出來產(chǎn)生畫面。同時要能將儲存模塊中的 數(shù)據(jù)正常地顯示在 LCD 液晶顯示器 上。 經(jīng)過 2021 年 LCD 液晶顯示器 大幅度調(diào)價,消費者發(fā)現(xiàn) LCD 液晶顯示器 的價格與CRT 顯示器進一步接近了,尤其是大尺寸 LCD 液晶顯示器 的售價和同尺寸的 CRT 顯示器相比甚至有一些尺寸開始有優(yōu)勢 。 2021 年以后 LCD 液晶顯示器 技術(shù)開始走上成熟發(fā)展之路、但仍然生存在 CRT 顯示器陰影下 (CRT 直譯中文為:陰極射線管 , 英文名稱為 CathodeRay Tube)。 雖然 是 用 單色顯示 的方式 , 但 它仍 然 被推廣到了電子表、計算器等領(lǐng)域。 FPGA 是 Field- Programmable Gate Array 的縮寫,即現(xiàn)場可編程 門陣列,它是在GAL、 CPLD、 PAL 等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。 19 第 6 章 系統(tǒng)測試 17 系統(tǒng)主程序代碼節(jié)選 13 流程圖和狀態(tài)機的設(shè)計 13 接口電路設(shè)計 8 系統(tǒng)開發(fā)環(huán)境 7 VERILOG HDL 和 VHDL 的異同 1 選題目的 I 摘 要 最后實現(xiàn)使用 FPGA 在 LCD 上顯示任意的英文字符和阿拉伯數(shù)字 ,另外要能根據(jù)輸入數(shù)據(jù)的變化同步變化 LCD 上顯示的內(nèi)容。 論文題目 基于 FPGA 的 LCD 驅(qū)動顯示電路的設(shè)計與實現(xiàn) 姓 名 學(xué) 院 東北大學(xué)東軟信息 學(xué)院 專 業(yè) 電子信息工程 (集成電路設(shè)計與系統(tǒng)方向 ) 指導(dǎo)教師 備 注 2021 年 5 月 4 日 基于 FPGA 的 LCD 驅(qū)動顯示電路的設(shè)計與實現(xiàn) 作 者 姓 名 : 指 導(dǎo) 教 師 :
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